关于DDR3布线规范和技巧

  

转自于：http://blog.csdn.net/qq_29350001/article/details/51781419

关于DDR3布线的一些规范(个人总结) 本规范为个人总结，介绍得比较简单。当然，具体规范不止这么点。写得不好的地方还请见谅。 1. 一、阻抗方面 DDR3要严格控制阻抗，单线50ohm，差分100ohm，差分一般为时钟、DQS。以下为一个6层板阻抗层叠，具体信息可参考附件阻抗表文件。   在走线过程中，尽量减小阻抗跳变的因素，比如：换层（无法避免）、保证参考平面完整不跨分割、线宽变化、避免stub线等。