EDA软件_Cadence_Allegro 16.6添加封装库路径(导入网表时需要)

    按照《Cadence 高速电路板设计与仿真》(第5版)9.2节的输入网络表操作,无法正确导入网络表,原因是封装库路径没有设置,具体的设置方法如下。

    选择Setup->User Preferences,弹出 User Preferences Editor 对话框,点击 Paths 前面的‘+’号展开,再点击Library,需要设置其中三个参数,将封装库添加到目录下,如下图所示。

EDA软件_Cadence_Allegro 16.6添加封装库路径(导入网表时需要)_第1张图片


参考链接:http://wenku.baidu.com/link?url=4k8-osDTGGnTdNgACP8Rsw3d3uRA3lN7gJ-dIwDxaPRRpch7g9IujdiMUpuoLywS28kihhsnPhHDwAgbtECPr7ja79Czi0SKv0tc_mZkw_7

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