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一、Ultra96-V2开发板介绍
二、开发板文件配置
三、vivado
四、Vitis
Ultra96板子是AVNET开发的。是基于Xilinx Zynq UltraScale+ MPSOC系列的芯片,具体使用的是:Xilinx Zynq UltraScale+ MPSoC ZU3EG SBVA484。板子本身比较比较小,外设模块也很少,其主要特点及开发板框架如下所示:
开发板学习资料:Ultra96-V2 | Avnet Boards
开发板的开机与关机(裸机):
①与Ultra96开发板配套的JTAG是Ultra96 USB-to-JTAG/UART Pod,如下所示,microUSB连接电脑,下载调试。
连接开发板与下载器,下载器连接UART-USB的USB接口到PC的USB。将12V电源插入插座,然后将插孔连接到您的ultra96v2上的J10。绿色Vin状态LED D17将点亮,但主板尚未通电。
②上电:按下并释放电源按钮(SW4)。4个用户LED灯亮起绿色。
③断电:当完成了对你的ultra - 96- v2的实验,并希望断电。可以按下和释放电源按钮(SW4),位于你的Ultra96- v2的顶部旁边的USB端口J8。要想关掉Ultra96- v2,要按住SW4键10秒钟。
请注意,如果你不让你的Ultra96- v2电源按断电顺序要求(如拔下插孔),你的microSD卡可能会损坏或损坏。
下载Ultra96的开发板定义文件(Board Definition Files),https://github.com/Avnet/bdf,从GitHub上下载AVNET所有开发板文件,打开后如下所示:
对于Ultra96现在有ultra96v2_1.2,ultra96v2_1.1,ultra96v2_1.0两个版本。将其拷贝到Vivado对应的board_files文件夹下,
这样在使用vivado配置开发板的时候就可以选择ultra96v2啦。
创建工程——>选择Ultra96开发板——>创建模块——>添加Zynq MP SoC——>Run Block Automation——>连接时钟、验证设计——>Generate Output Products——>Create HDL wrapper——>Generate Bitstream——>导出bitstream到SDK(File —Export —Export Hardware;Include bitstream)。
使用vivodo创建工程,开发板的配置以及信息如下:
设计文件如下图所示
这里只是展示ultra96的开发流程,输出一个“hello world”实验,所以不需要额外配置PL端。
最后按照上面的流程导出硬件流即可。
这里需要注意的是:Ultra96开发板用的UART1作为串口输入输出,按如下图,需要修改stdin和stdout选择psu_uart_1。
连接JTAG模块,设置拨码开关到JTAG启动,在vitis串口终端中配置串口波特率115200;
然后配置启动方式为JTAG。
编译整个工程, 先下载PL部分,点击Program Device,然后下载PS部分。
然后打开串口,如下图串口输出信息