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【数字IC前端常见笔/面试问题】Verilog、SystemVerilog、UVM篇（附详细解答）

文章目录

    • 前言
    • Verilog 常见面试问题
      • 基础级别问题
        • 1. 阻塞和非阻塞赋值之间的区别
        • 2. 任务和函数之间的区别
        • 3. wire和reg之间的区别
        • 4. 什么是Verilog中的generate块及其用途？
        • 5. while循环和do-while循环之间的区别。
        • 6. 任务中自动关键字是什么意思？
        • 7. 组合电路和时序电路之间的差异。
        • 8. 触发器（flip-flop）与锁存器（latch）之间的差异。
        • 9. 通过示例解释静态变量与自动变量之间的差异。
        • 10. Mealy状态机与Moore状态机之间有何不同？
        • 11. 使用2:1 MUX实现XOR门
        • 12. 使用2:1 MUX实现OR门
        • 13. $stop 和 $finish 有何不同。

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