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74ls390设计任意进制计数器_低功耗设计之RTL级降低功耗

by IamSarah

来自微信公众号 “数字芯片实验室”


最近在看《硬件架构的艺术》这本书，本篇博文也是来自书中的内容。
随着工艺的进步，低功耗设计显得越来越重要了。作为一个数字前端设计师，我们就来看看如何在RTL级别降低功耗。
实质上在大规模ASIC设计中，当RTL级设计完成的时候，整个系统至少80%的功耗就已经确定。后端流程没有办法修复微架构，而微架构和RTL代码风格对于动态和静态功耗有极大的影响。下面就说说在RTL级别可以从哪几个方面降低功耗。状态机的编码和解码

74ls390设计任意进制计数器_低功耗设计之RTL级降低功耗_第1张图片

在各种状态机的编码中，格雷码是最适合低功耗设计的。因为它在状态转换过程中每次只有一个触发器变化，同时，格雷码编码的状态机也消除了依赖于状态组合等式中存在毛刺的风险。上图中是二进制编码和格雷码编码的比较。二进制数表示方法

74ls390设计任意进制计数器_低功耗设计之RTL级降低功耗_第2张图片


在大多数的应用中都是用补码表示有符号数的，但是原码与补码切换过程中，很多位都发生变化，

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