Verilog 中输入输出信号的类型?

虽然只有一句话,但很重要,足以总结标题上的疑问?

输入端口可以由wire/reg驱动,但输入端口只能是wire;输出端口可以使wire/reg类型,输出端口只能驱动wire。

 

 

 

 

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