数字电路与逻辑设计 之 组合逻辑电路

文章目录

  • 组合电路的分析过程
  • 组合电路的设计过程
  • 电路竞争冒险
  • 编码器
  • 编码器的应用

组合电路的分析过程

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数字电路与逻辑设计 之 组合逻辑电路_第2张图片
数字电路与逻辑设计 之 组合逻辑电路_第3张图片
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在上面的例子中是 奇校验 功能,怎么改可以变成偶 校验呢
如果是增加一个异或门可以实现吗,答案是不可以,四个异或门也是实现奇校验功能,五个也是,
所以最好的办法就是在输出的时候加一个非门
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组合电路的设计过程

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电路竞争冒险

电路传输有延迟,且电路中众多的门也使得延迟加剧
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编码器

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只有一个输入为 1 ,对应一个输出
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将其他的 12 中组合输入记录为 0
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其中 x 取值 0 或者 1 的时候对输出没有影响
在这里插入图片描述
优先级如上
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上面的这个考虑了优先级
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增加一个 输出 GS (工作状态输出端)来辨别是否有按键合上

编码器的应用

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EI 等于 0 的时候禁止工作
在这里插入图片描述
在这里插入图片描述
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为了有效区分这三种情况, GS 为0 , EO 为0 说明没有工作, GS = 0 ,EO为1 的时候说明是无效输入
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