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Module LUT6 is not defined

在综合后仿真中，有时会出现如下错误：

Module 'LUT6' is not defined

解决办法：

没有加载ISE的unisims_ver库

-L D:\Xilinx\13.3\ISE_DS\ISE\verilog\mti_se\6.5e\nt\unisims_ver

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