HDL——FPGA

【优秀文章】7月优秀文章推荐

优秀文章智能自主运动体与人工智能技术——环境感知、SLAM定位、路径规划、运动控制、多智能体协同作者：fpga和matlabC++之红黑树认识与实现作者：zzh_zao【手把手带你刷好题】–C语言基础编程题
·2025-07-07 19:07

xilinx工具编译ADI官方no-os和HDL工程步骤

以AD738x这款ADC为例，xilinx软件版本为2022.2：HDL工程：下载HDL工程：GitHub-analogdevicesinc/hdlathdl_2022_r2（GitHub-analogdevicesinc
ni1978·2025-07-07 18:05

FPGA的开发流程

FPGA（现场可编程门阵列）的开发流程是一个系统化的过程，涉及从设计构思到最终硬件实现的多步骤工作。
InnoLink_1024·2025-07-07 05:32

从 PCB 到 FPGA/IC 设计，小白到 CTO 的必学秘籍 硬核知识点全揭秘！从c语言入门到mcu与arm架构及外设相关

【硬核揭秘】嵌入式硬件工程师的“底裤”：从入门到牛逼，你必须知道的一切！第一部分：破冰与认知——嵌入式硬件工程师的“世界观”嘿，各位C语言老铁，以及所有对“让硬件听你话”充满好奇的朋友们！我是你们的老朋友，一个常年“折腾”在代码和电路板之间的码农。今天，咱们要聊一个真正能让你“硬”起来的话题——如何成为一个合格、优秀、牛逼的嵌入式硬件工程师！你可能正坐在电脑前，敲着C语言代码，刷着力扣算法题，心里
small_wh1te_coder·2025-07-06 21:39

basic verilog 语法--FPGA入门1

Assignisonlyforwiretypevarity;1.1definemodulemain(inputclkIn,//50M,20nsinputspi_clk,inputspi_mosi,inputspi_cs,inputreset_FPGA
Kent Gu·2025-07-05 15:27

FPGA实现JPEG编码器的完整项目指南

本文还有配套的精品资源，点击获取简介：JPEG编码是一种广泛使用的数字图像压缩技术，通过在FPGA上实现该编码器，可以为嵌入式系统提供高效的图像处理。
·2025-07-05 15:27

Verilog HDL基础语法1-1

一、语法特点及规则①Verilog采用模块化结构，数据类型和变量、基本运算符等基本语法，语法类型和C语言很相似。②每行只写一个声明语句或说明，每个VerilogHDL源文件中只能写一个顶层模块，也不能把一个顶层模块分成几部分写在几个源文件中。③源文件名字和文件内容有关，最好与顶层文件同名，命名时，第一个字符为字母或下划线。④源文件用层层缩进的格式来写。⑤变量名的大小写应自始至终保持一致。⑥对关键步
酱酱酱酱酱·2025-07-05 15:54

FPGA原型验证方法学：提升芯片设计验证效率的利器

FPGA原型验证方法学：提升芯片设计验证效率的利器去发现同类优质开源项目:https://gitcode.com/项目介绍在芯片设计领域，验证阶段是确保设计功能正确性和性能优化的关键环节。
窦莎言Firm·2025-07-05 14:13

FPGA原型验证资源下载：助力工程师提升工作效率

FPGA原型验证资源下载：助力工程师提升工作效率去发现同类优质开源项目:https://gitcode.com/项目介绍在当今电子设计领域，FPGA原型验证作为ASIC设计流程中的重要环节，对于确保设计质量
·2025-07-05 14:13

usb3.0开发

本项目使用了EP0的in和out端点作为控制端点EP1的in和out端点作为pc与fpga传输数
小xiao白·2025-07-05 07:24

FPGA内部资源介绍

FPGA内部资源介绍目录逻辑资源块LUT（查找表）加法器寄存器MUX（复用器）时钟网络资源全局时钟网络资源区域时钟网络资源IO时钟网络资源时钟处理单元BLOCKRAMDSP布线资源接口资源用户IO资源专用高速接口资源总结
cycf·2025-07-05 02:58

【教程4＞第7章＞第26节】基于FPGA的RS(204,188)译码verilog实现10——RS译码模块整体实现与性能仿真评估

ErasureHandling）2.3多项式乘法（PolynomialMultiplication）2.4欧几里得算法（EuclideanAlgorithm）2.5钱搜索（ChienSearch）3.RS译码模块整体FPGA
fpga和matlab·2025-07-04 01:40

PCIe Crosslink

这种技术主要用于高性能计算（HPC）、FPGA加速、GPU直连等场景，以降低延迟并提高带宽利用率。1.PCIeCrossl
zly8865372·2025-07-04 00:31

可编程逻辑器件的发展与比较

可编程逻辑器件的发展与比较文章目录可编程逻辑器件的发展与比较一、早期的离散逻辑芯片二、复杂可编程逻辑器件（CPLD）（一）CPLD的诞生（二）CPLD的结构（三）CPLD的特点三、现场可编程门阵列（FPGA
cycf·2025-07-03 21:43

FPGA设计的上板调试

FPGA设计的上板调试指南文章目录一、如何解决问题（一）开发板状态检查当系统出现问题时，首先需要确认开发板是否工作正常。开发板的预测试和日常检查是确保调试顺利进行的关键步骤。
cycf·2025-07-03 21:43

呼吸灯 verilog FPGA 基础练习8

呼吸灯verilogFPGA基础练习8发现问题，用技术解决问题。兴趣是自己的源动力!
cycf·2025-07-03 21:43

90.xilinx复位低电平(一般使用低电平复位)

XilinxFPGA中的寄存器（Flip-Flop）**确实支持异步复位**，但具体实现方式取决于你使用的设计方法（HDL代码风格或原语实例化）。以下是详细说明：---###1.
cmc1028·2025-07-03 15:29

116-基于5VLX110T FPGA FMC接口功能验证6U CPCI平台

FPGA接1片DDR2内存条2GB，32MBNorflash存储器，用于存储程序。外扩SATA、PCI、PCIexpress、千兆网络接口、SFP接口，自定义总线支持最大到266个IO。该
Anin蓝天（北京太速科技-陈）·2025-07-03 00:07

FPGA FMC 接口

1FMC介绍FMC接口即FPGAMezzanineCard接口，中文名为FPGA中间层板卡接口。
LEEE@FPGA·2025-07-03 00:34

山东大学FPGA课程实验一 加法器设计

【实验题目】设计一个16位二进制全加器模块。用层次化设计方法，设计一个16位二进制全加器模块。设计一个16位二进制超前进位全加器模块。设计一个16-bit8421-BCD码全加器模块。【实验软件工具】QuartusII;ModelSimSE.【实验要求】实验内容与原理说明（包括框图、逻辑表达式和真值表）；实验模块程序代码（设计模块DesignBlock）和激励代码（激励模块TestBench）；仿
小田不甜~·2025-07-01 14:29

FPGA设计的时序分析概要

FPGA设计的时序分析文章目录FPGA设计的时序分析时序分析的概念和必要性时序分析的分类映射后时序分析时序约束与时序分析的关系特殊情况小总结时序分析的概念和必要性时序分析，也叫静态时序分析（StaticTimingAnalysis
cycf·2025-07-01 09:27

Xilinx FPGA ICAP原语实现多重配置

文章目录1.FPGA可以运行几个固件2.XilinxICAP原语简介3.ICAP原语模板的使用4.ICAP在Spartan-6上的使用5.ICAP在Kintex-7上的使用工程下载1.FPGA可以运行几个固件众所周知
whik1194·2025-06-30 19:54

基于 Kintex UltraScale 系列 2 路 QSFP+40G 光纤 PCIe 数据传输卡 / 光纤适配器（5GByte/s 带宽KU060光纤 PCIe 数据传输卡）

板卡采用Xilinx的高性能KintexUltraScale系列FPGA作为实时处理器，板载2组独立的72位DDR4SDRAM大容量缓存。板卡具有1个RJ45千兆以太网口以及若干IO信号。
F_white·2025-06-29 23:51

中科亿海微SoM模组——基于FPGA+RSIC-V的计算机板卡

基于FPGA+RSIC-V的计算机板卡主芯片使用中科亿海微EQ6HL45-CSG324FPGA芯片和高性能微控制器HPM6880，并集合ADCLHA6958H、6通道数字隔离器SiLM5760、SiLM5763
ehiway·2025-06-29 15:16

mb_bootloop_le.elf是使用microblaze默认的elf文件，这个文件包括哪些内容？

一、mb_bootloop_le.elf说明1.mb_bootloop_le.elf是使用microblaze的FPGA的时候的默认的elf文件；2.XilinxSDK中的.elf文件全称为“ExecutableandLinkingFormat
hahaha6016·2025-06-29 15:45

可编程逻辑器件的演进与对比分析

可编程逻辑器件的演进与对比分析目录离散逻辑芯片与早期PLD的限制CPLD的诞生与结构特点FPGA的架构创新CPLD与FPGA的核心差异总结1.离散逻辑芯片与早期PLD的限制在还没有发明出可编程逻辑器件（
cycf·2025-06-29 15:15

Linux configfs机制

1、在使用intelSOC过程中，驱动的DTS需要在内核启动以后把FPGAcoreload以后加载PL侧设备的DTS，此时使用的是Linux的dts的overlay机制，该机制本质是使用Linux的configfs
liujiliei·2025-06-29 04:02

FPGA和嵌入式系统的核心区别

灵活性：FPGA具有高度的灵活性，可以根据需要重新编程以实现不同的功能。嵌入式系统的硬件功能通常是固定的，无法进行大规模的硬件级别的修改。
2301_82243800·2025-06-29 00:01

[FPGA]嵌入式系统FPGA设计资源

嵌入式系统FPGA设计资源一、供应商https://www.altera.com-AlteraFPGA供应商网站https://www.altera.com/events/northamerica/intel-soc-fpga-developer-forum
元直数字电路验证·2025-06-29 00:30

FPGA(现场可编程门阵列)是什么？

FPGA(现场可编程门阵列)是什么？
Yashar Qian·2025-06-27 20:16

异构计算解决方案（兼容不同硬件架构）

异构计算解决方案通过整合不同类型处理器（如CPU、GPU、NPU、FPGA等），实现硬件资源的高效协同与兼容，满足多样化计算需求。
ARM2NCWU·2025-06-27 17:29

FPGA与Verilog实现的Cordic算法测试项目

本文还有配套的精品资源，点击获取简介：Cordic算法是一种在FPGA和Verilog硬件描述语言中实现高效的数值计算技术，它简化了硬件资源需求，特别适合资源有限的嵌入式系统。
weixin_42668301·2025-06-27 04:01

实时解码技术：基于FPGA芯片的即时错误诊断与修正系统，实现计算过程中的动态纠错

以下基于资料构建的基于FPGA的实时动态纠错系统技术框架，涵盖原理、实现路径与典型应用：一、FPGA芯片的核心特性支撑实时动态纠错FPGA（现场可编程门阵列）的硬件可重构性和并行架构是动态纠错系统的物理基础
百态老人·2025-06-27 03:52

零起步的 FPGA 学习圣经：Project F 开源项目深度解读

在FPGA学习过程中，你是否也曾遇到过这些问题：教材晦涩难懂，电路图和代码脱节？找不到既系统又实战的开源学习资料？工具链配置复杂，不知从何下手？
OpenFPGA·2025-06-27 03:46

基于FPGA的数字图像处理【1.5】

第2章FPGA与图像处理随着图像分辨率的大幅度提升和图像处理算法复杂度的提升，传统的串行处理器已经越来越不能满足图像处理的实时性需求。
BinaryStarXin·2025-06-26 21:39

【教程4＞第7章＞第23节】基于FPGA的RS(204,188)译码verilog实现7——欧几里得迭代算法模块

目录1.软件版本2.RS译码器逆元欧几里得算法模块原理分析3.RS译码器逆元欧几里得算法模块的verilog实现3.1RS译码器逆元欧几里得算法模块verilog程序3.2程序解析欢迎订阅FPGA/MATLAB
fpga和matlab·2025-06-26 20:29

FPGA的星辰大海

编者按时下风头正盛的DeepSeek，正值喜好宏大叙事的米国大统领二次上岗就业，OpenAI、软银、甲骨文等宣布投资高达5000亿美元“星际之门”之际，对比尤为强烈。某种程度上，，是低成本创新理念的直接落地。包括来自开源社区的诸多赞誉是，并非体现技术有多“超越”，而是让更多的人可以直接体验，把通往AGI的门票，从奢侈品变成了日用品。四十年前的上世纪八十年代初，美国发起的星球大战，高昂的重金投入比拼
forgeda·2025-06-26 17:38

基于高云GW5AT-15 FPGA的SLVS-EC桥MIPI设计方案分享

设计需求设计一个4LanesSLVS-EC桥接到2组4lanesMIPIDPHY接口的电路模块：（1）CMOS芯片：IMX537-AAMJ-C，输出4lanesSLVS-EC4.752GbpsLane速率；（2）FPGA
_Hello_Panda_·2025-06-26 17:38

基于ARM+FPGA+ADC的储能协调控制器/EMS，支持全国产，支持实时系统

协调控制器是一款灵活可定制逻辑的多功能控制装置，可根据实际应用环境需求定制对应的控制逻辑，应用范围广泛，既可作为新能源站（光伏、风电、储能）的协调控制器，也可作为微网控制器或者综合控制器。产品特点1、支持图形化逻辑组态工具实现装置接口信号、处理逻辑、输出控制及事故告警的现场可视化组态、程序升级，可根据现场需求灵活定制功能；2、具备多路信号采集、多路控制输出；3、具有多种通讯接口，具备强大快速的通信
深圳信迈主板定制专家·2025-06-26 16:59

7a系列mrcc xilinx_Xilinx 7 Series FPGA!型号列表

Xilinx7SeriesFPGA型号列表SupportedDevice(1),(2)CoreVersionSignalingEnvironmentVirtex-5XC5VFX70T-FF1136-2C
·2025-06-26 15:27

XC7K160T-1FBG484I、XC7A100T-2CSG324I FPGA可编程门阵列 PDF规格书

1、XC7K160T-1FBG484I说明：Kintex®-7FPGA有-3、-2、-1、-1L和-2L速度等级，其中-3具有最高的性能。
Summer-明佳达电子·2025-06-26 15:27

调试HDMI音频能8通道播放声音

一、使用场景我们是通过rk主控的hdmi接口播放音视频给到ite68051芯片解析出8声道数据，分别通过4路i2s的数据脚给给到fpga去解析调试步骤：1.根据相关手册配置hdmi输出，hdmi声卡注册
hxHardway·2025-06-26 05:48

ModelSim在FPGA设计中的功能仿真与时序仿真

在FPGA（现场可编程门阵列）设计的复杂流程中，仿真环节扮演着至关重要的角色。它不仅能够帮助设计师在物理实现之前发现并修正设计错误，还能通过模拟实际工作环境来评估设计的性能和稳定性。
chao189844·2025-06-26 01:52

VIVADO导出仿真数据到MATLAB中进行分析

VIVADO导出仿真数据到MATLAB中进行分析目录前言一、导出仿真数据需要编写的RTL代码二、MATLAB读入txt文件中的数据三、需要注意的点总结前言在使用XilinxVivado进行FPGA开发时
FPGA与信号处理·2025-06-25 16:14

VxWorks在Zynq平台上的移植详细流程

Zynq平台以其独特的FPGA与ARMCortex-A处理单元结合的设计，广泛应用于工业控制、航空航天、通信设备等多个领域。本文档深入浅出，旨在帮助开发者理解和掌握如何在这一平台上成
缪超争Lighthearted·2025-06-25 14:35

TeleScan PE

目录物理层深度剖析通道结构信号完整性关键技术链路训练（LinkTraining）协议层核心技术TLP（事务层包）结构虚拟通道管理原子操作（PCIe5.0+）硬件实现关键FPGA实现方案信号完整性设计规范总结
fei_sun·2025-06-25 12:20

SPI代码详解FPGA-verilog部分（FPGA+STM32）（一）

声明：本篇文章面向在已对SPI的四种时序有所了解的人我们采用SPI3模式以及将FPGA作从机，STM32作主机的方式讲解，在STM32控制部分采用的是半双工模式，但其实半双工与全双工区别不大，稍加修改即可本文章属于
MinJohnson·2025-06-24 18:02

混沌保密音频传输系统设计与评估

详细阐述了系统架构、混沌电路实现、FPGA/微控制器平台部署方案，并制定了全面的评估指标体系（包括音频失真度、误码率、加密/解密时间、密钥空间、敏感性分析、统计特性等）。
神经网络15044·2025-06-24 14:07

FPGA基础 -- Verilog 锁存器简介

由浅入深地讲解Verilog中的锁存器（Latch）**，包括：什么是锁存器（定义与作用）锁存器的分类（透明锁存器vs边沿触发器）Verilog中锁存器的建模方式锁存器与触发器的区别锁存器的时序特性与设计陷阱实际应用与避免锁存器的最佳实践综合工具识别锁存器的方式与调试技巧一、什么是锁存器（Latch）？锁存器是一种电平敏感的时序逻辑单元，用于在特定控制信号（如enable或clk为高电平）时锁存输
sz66cm·2025-06-24 11:20

FPGA基础 -- Verilog 竞争/竞态（Race Condition）

一、什么是“竞争/竞态（RaceCondition）”？概念说明典型后果信号竞争（GlitchRace）由两条或多条逻辑路径传播延迟不同导致。同一时刻从不同路径到达的电平先后顺序不可预知，产生毛刺或错误翻转。硬件级：产生额外脉冲，触发错误状态或计数。事件竞争/仿真竞态（SchedulingRace）仿真器在同一个时刻deltacycle内对同一变量存在多个驱动且调度顺序不确定（典型如=阻塞赋值）。
·2025-06-24 11:20
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