- FPGA 设计中的 “Create HDL Wrapper“ 和 “Generating Output Products“ 的区别
行者..................
fpga开发
CreateHDLWrapper(创建HDL包装器)目的:为顶层设计模块(通常是BlockDesign/IPIntegrator设计)创建一个HDL包装文件功能:将图形化/框图设计的BlockDesign转换为可综合的HDL代码(Verilog或VHDL)创建一个顶层模块,将所有IP核和连接实例化使用场景:当使用IPIntegrator创建BlockDesign后需要将图形化设计转换为HDL代码以
- xilinx工具编译ADI官方no-os和HDL工程步骤
ni1978
驱动fpgac语言驱动开发
以AD738x这款ADC为例,xilinx软件版本为2022.2:HDL工程:下载HDL工程:GitHub-analogdevicesinc/hdlathdl_2022_r2(GitHub-analogdevicesinc/hdlathdl_2022_r2)解压后,打开vivado2022.2,此时不要建工程,在tclconsole里输入cdc:/hdl-hdl_2022_r2/projects/
- Verilog HDL基础语法1-1
酱酱酱酱酱
Verilog与FPGAfpga开发
一、语法特点及规则①Verilog采用模块化结构,数据类型和变量、基本运算符等基本语法,语法类型和C语言很相似。②每行只写一个声明语句或说明,每个VerilogHDL源文件中只能写一个顶层模块,也不能把一个顶层模块分成几部分写在几个源文件中。③源文件名字和文件内容有关,最好与顶层文件同名,命名时,第一个字符为字母或下划线。④源文件用层层缩进的格式来写。⑤变量名的大小写应自始至终保持一致。⑥对关键步
- 90.xilinx复位低电平(一般使用低电平复位)
cmc1028
笔记笔记
XilinxFPGA中的寄存器(Flip-Flop)**确实支持异步复位**,但具体实现方式取决于你使用的设计方法(HDL代码风格或原语实例化)。以下是详细说明:---###1.**Xilinx寄存器的复位特性**-**同步复位和异步复位均支持**,但需要通过代码或原语明确指定。-异步复位的信号通常会直接连接到寄存器的`CLR`(Clear,低电平有效)或`PRE`(Preset,高电平有效)端口
- ModelSim在FPGA设计中的功能仿真与时序仿真
chao189844
fpga开发
在FPGA(现场可编程门阵列)设计的复杂流程中,仿真环节扮演着至关重要的角色。它不仅能够帮助设计师在物理实现之前发现并修正设计错误,还能通过模拟实际工作环境来评估设计的性能和稳定性。ModelSim作为业界领先的HDL(硬件描述语言)仿真工具,以其强大的功能、灵活的配置和直观的界面赢得了广泛的应用。本文将深入探讨ModelSim在FPGA设计中如何进行功能仿真和时序仿真,并介绍其在实际应用中的优势
- System-Verilog 实现DE2-115 流水灯
qwert_qqq
物联网学习fpga开发
文章目录一、什么是SystemVerilog二、代码实现实现结果一、什么是SystemVerilogSystemVerilog是一种硬件描述语言(HDL),它用于设计和验证电子系统,特别是在集成电路(IC)和系统级芯片(SoC)的设计过程中。SystemVerilog是Verilog语言的一个超集,它添加了许多新的特性和增强功能,使得设计者可以更高效地进行工作。应用领域:集成电路设计:System
- FPGA基础 -- Verilog语言要素之标识符
sz66cm
fpga开发
一、什么是标识符(Identifier)在Verilog中,标识符是用户定义的名字,用于标识模块、变量、端口、函数、任务、参数、宏定义等各种语言要素。就像C语言的变量名、函数名一样,Verilog中的标识符为HDL代码提供了可读性与结构组织的能力。二、Verilog标识符的定义规则(IEEEStd1364/1800)1.普通标识符(不带转义字符)必须以字母(az,AZ)或下划线_开头后续字符可以是
- 第四篇 Verilog HDL入门-行为级建模
一、过程语句使用中需要注意的问题在信号定义形式方面,无论是对时序逻辑还是组合逻辑描述,Verilog要求在过程语句(initial和always)中,被赋值信号必须定义为reg类型。在敏感事件表方面,这是VerilogHDL语言中一个关键性设计,如何选取敏感事件作为过程的触发事件,在VerilogHDL程序中有一定的设计要求。(1)、采用过程对组合电路进行描述时,作为全部的输入信号需要列入敏感信息
- FPGA基础 -- Verilog语言要素之数组
sz66cm
fpga开发
Verilog是一种用于硬件建模的硬件描述语言(HDL),其数组机制不同于软件语言,须考虑硬件资源映射、综合约束、位宽优化等硬件特性。以下是对Verilog中数据类型的数组使用的全面讲解,分为一维数组、二维数组、memory数组、reg与wire中数组的差异、packed与unpacked数组(SystemVerilog)等方面,并指出综合注意事项与最佳实践。一、Verilog数组的分类1.一维数
- DeepSeek AI功能演示:如何生成Verilog脚本
在EDA设计流程中,Verilog语言作为主要的硬件描述语言(HDL),广泛用于芯片设计的各个阶段,包括设计、仿真和综合。然而,手动编写Verilog代码过程繁琐,易出错且耗时。随着AI技术的发展,将人工智能融入到Verilog脚本的生成过程中,逐渐成为业界提升设计效率的重要趋势。CFA平台推出的DeepSeekAI工具,旨在帮助芯片设计工程师快速、准确地生成高质量的Verilog代码。本篇文章将
- 通过vivado HLS设计一个FIR低通滤波器
fpga和matlab
VivadoHLS开发vivadoHLSFIR低通滤波器
目录1.FIR参数确定2.FIR系数计算3.C/C++代码实现4.VivadoHLS项目创建与配置4.1在VivadoHLS中创建新项目并配置4.2在VivadoHLS中执行C仿真4.3执行C综合以将C代码转换为RTL4.4进行RTL级仿真验证4.5导出IP4.6在Vivado中集成IPVivadoHLS是一款强大的高层次综合工具,可将C/C++代码转换为硬件描述语言(HDL),显著提升FPGA开
- Verilog HDL Test Bench 仿真
昵称?不存在的!
VerilogtestbenchFPGA
VerilogHDLTestBench仿真TestBench功能编写TestBench基本注意事项:Verilog系统任务和系统函数延时模型激励信号产生参考文献TestBench功能Verilog测试平台TestBench的主要功能:例化待验证的模块实体通过Verilog程序的行为描述,为待测模块实体提供激励信号收集待测模块实体的输出结果,必要时将该结果与预置的所期望的理想结果进行比较并给出报告根
- 3.9/Q2,Charls最新文章解读
医只鸡腿子
数据库开发数据挖掘线性回归数据库数据分析
文章题目:Associationbetweenhs-CRP/HDLwithtype2diabetesmellitusinmiddle-agedandelderlypeople:across-sectionalstudyfromCHARLSDOI:10.3389/fendo.2025.1471292中文标题:hs-CRP/HDL与中老年人2型糖尿病的相关性:CHARLS的一项横断面研究发表杂志:Fr
- Vscode搭建verilog开发环境
transfer_ICer
vscode编辑器fpga开发
1、Vscode下载安装详见另一篇文章:Vscode+Anaconda配置Python环境_vscode配置python及anaconda-CSDN博客https://blog.csdn.net/weixin_61081689/article/details/143469236?spm=1001.2014.3001.55012、Verilog-HDL插件自定义代码补全:在Vscode+Anacon
- Verilog HDL:分频器设计
弄曲幽篁
HDLfpga开发
分频器的设计(VerilogHDL)在fpga应用中,有时需要对系统时钟进行分频。通常情况下有两种情况,一种是偶分频,一种是奇分频。偶分频偶分频指的是分频系数是偶数的分频器。比如,假设输入时钟是100MHz,分频系数是2,则输出的方波频率为50MHz。偶分频的实现比较简单。分频系数实际上代表的是输出信号的周期同输入信号的周期的倍数。因此,设分频系数为N,则每隔N/2个输入信号周期,输出信号电平发生
- verilog 介绍(附状态机实例)
hjjdebug
fpgafpga开发嵌入式硬件verilog状态机密码锁
author:hjjdebugdate:2024年10月12日星期六15:02:56CSTdescription:verilog介绍(附状态机实例)初学者可以把菜鸟教程中的verilog当参考手册.但那里介绍的太多了,精简入门(或者入门后的概括)看看本博就够了.1.什么是HDL?HDL,hardwaredescriptionlanguage,硬件描述语言其分为两部分:a.逻辑功能设计.用HDL语言
- HDL学习札记
CJLee_3636
FPGA学习VHDL学习开发语言
VHDL代码结构一段完整的VHDL代码的3个基本组成部分:库(LIBRARY)声明、实体(ENTITY)和构造体(ARCHITECTURE)。VHDL代码基本单元LIBRARY(库)声明:列出当前设计中需要用到的所有库文件,如ieee,std和work等。ENTITY(实体):定义了电路的输入/输出引脚;给出了电路外部连接端口(PORTS)的定义;定义电路模块的外部属性。ARCHITECTURE(
- 【verilog】在同一个 always 块中写了多个“看起来独立”的 if / if-else,到底谁先谁后,怎么执行?会不会冲突?
爱吃羊的老虎
fpga开发
问题本质在一个always@(posedgeclk)块中,所有的代码都是顺序执行的。但这不意味着它就像软件一样“一条一条执行”,因为最终是电路!电路是并行存在的!Verilog是硬件描述语言(HDL),你写的if看起来像判断语句,实际上是用来描述硬件行为的。比如赋值,就是描述电路连线和寄存器触发器之间的连接与更新方式。例子一:多个if控制不同变量(并行)always@(posedgeclk)beg
- fpga系列 HDL:tips 初始化错误排查 & 仿真和实际不符的可能原因
FakeOccupational
硬件和移动端fpga开发
在Verilog中,SYS_RST系统复位信号(SystemReset)的主要作用是将模块的内部状态和寄存器初始化为已知的默认值。复位信号在硬件设计中非常重要,因为它确保了系统在启动、错误恢复或特定条件下能够进入一个稳定且可预测的状态。没有正确的服务初始化,可能导致仿真和实际不符:例如,在仿真中某个信号的默认电平可能为低,但在实际芯片中默认初始化为高,并且没有在系统复位时初始化为低就会产生错误。代
- 在pzp203上运行ad9361 no-os工程
qq_27158179
SDRFPGA驱动开发
0.环境-pzp203-ubuntu18+vivado2018pzp203是一款plutosdr的国产兼容版。出厂默认是基于linux系统的,用libiio调用。软硬件兼容adalm-pluto。开发板提供网盘资料,是添加了板卡适配的。1.hdl1.1准备源码hdlhttps://github.com/analogdevicesinc/hdl/releases切换分支到2019_r1,通过Down
- 数字集成电路中时延不可综合与时间单位介绍
夜雨听萧瑟
硬件语言fpga开发
问题引出:verilog中连续赋值延时语句中的延时,用于控制任意操作数发生变化到语句左端赋予新值之间的时间延时。时延一般是不可综合的。3.2Verilog时延|菜鸟教程1、综合介绍在Verilog或硬件描述语言(HDL)中,“综合”(Synthesis)是指将用高级抽象语言(如Verilog或VHDL)描述的行为级或寄存器传输级(RTL)设计,转换为具体的门级实现的过程。换句话说,综合工具会将HD
- 【数字系统】LED动态显示模块设计:数据输入/动态显示/按键信号转换 Quartus II 环境/Verilog HDL语言/编程+仿真+开发板/FPGA/CPLD/EDA
StormBorn_
数字系统设计fpgafpga/cpldverilog硬件芯片
一、实验目的1.学习理解LED动态显示的工作原理2.进一步掌握VerilogHDL层次化的设计方法。3.掌握VerilogHDL行为级描述与结构化描述方法。4.显示数值的数据输入模块、数据动态显示模块、信息可调整的动态显示顶层模块的设计与仿真。二、实验过程步骤1、设计模块1:显示数值的数据输入display_decodea.模块功能要求八段数码管有两种不同的形式:一种是八个发光二极管的阳极都连在一
- 手把手教你学verilog(三)--搭建 Verilog 的开发环境
小蘑菇二号
手把手教你学Verilogfpga开发
目录选择工具安装步骤1.下载并安装仿真工具2.获取许可证3.配置环境变量4.安装综合工具(可选)5.设置IDE(如果适用)测试环境注意事项搭建Verilog的开发环境涉及到几个关键步骤,包括选择合适的硬件描述语言(HDL)编译器/综合器、安装必要的软件工具以及设置开发环境。下面是详细的步骤指南:选择工具首先需要确定你希望使用的工具集。常见的Verilog工具包括:仿真工具:如ModelSim、Ac
- 硬件描述语言
算法资料吧!
硬件
介绍:大多数人都熟悉用于开发软件应用程序的传统编程语言,如C、C++、Java、Python等。但是,许多人不知道Verilog和VHDL等硬件描述语言。在本文中,我们将讨论硬件描述语言。我们走吧。历史:硬件描述语言作为设计捕获媒介的概念最早是在1950年代引入的,但直到1985年之后才开始被设计社区广泛采用。从历史上看,软件编程语言的发展刺激了HDL的发展。第一种硬件描述语言出现在1960年末,
- 探索数字电路的奥秘:时序电路的 HDL 设计
甄亚凌
探索数字电路的奥秘:时序电路的HDL设计【下载地址】实验八时序电路的HDL设计实验八时序电路的HDL设计项目地址:https://gitcode.com/open-source-toolkit/0f348项目介绍在数字电路的世界中,时序电路的设计是不可或缺的一环。本项目“实验八时序电路的HDL设计”旨在帮助电子工程和计算机工程专业的学生及工程师深入理解时序电路的核心概念,并通过实际的HDL设计来掌
- 【从零开始学习计算机科学】数字逻辑(四)数字系统设计
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学习数字逻辑verilog数字系统HDL数字电路FPGA
【从零开始学习计算机科学】数字逻辑(四)数字系统设计数字系统设计硬件描述语言HDL(HardwareDescriptionLanguage)VerilogHDL的起源与发展HDL软核、固核和硬核的重用HDL的应用数字系统设计实现数字系统设计一个数字集成电路的可以从不同的层次(系统级、算法级、寄存器传输级、门级、开关级)以及不同的领域(行为领域、结构领域、物理领域)进行描述。三个领域主要含义如下:行
- 使用Modelsim手动仿真
寒听雪落
FPGA专栏_verilogfpga开发
FPGA设计流程在设计输入之后,设计综合前进行RTL级仿真,称为综合前仿真,也称为前仿真或功能仿真。前仿真也就是纯粹的功能仿真,主旨在于验证电路的功能是否符合设计要求,其特点是不考虑电路门延迟与线延迟。在完成一个设计的代码编写工作之后,可以直接对代码进行仿真,检测源代码是否符合功能要求。这时,仿真的对象为HDL代码,可以比较直观的观察波形的变化,在设计的最初阶段发现问题,节省大量的精力。在布局布线
- 【从零开始学习计算机科学】数字逻辑(五) Verilog HDL语言
贫苦游商
学习fpga开发数字逻辑verilogHDL硬件开发逻辑电路
【从零开始学习计算机科学】数字逻辑(五)VerilogHDL语言VerilogHDL语言8位全加器8位计数器2位比较器三态驱动器VerilogHDL模块的结构模块声明。端口定义。信号类型。功能描述verilog描述级别verilog关键字verilog标识符编写VerilogHDL源代码的标准数据类型常量变量nets型变量register型变量reg型变量运算符及表达式算术运算符逻辑运算符位运算符
- 深入解析:FIR滤波器在FPGA上的设计与实现全流程
king-agic
FPGAfpga开发经验分享
在FPGA中实现FIR(FiniteImpulseResponse)滤波器涉及多个步骤,包括滤波器设计、系数量化、硬件架构设计、HDL(HardwareDescriptionLanguage)编码、综合、布局布线以及验证。1.滤波器设计使用软件工具如MATLAB、Octave或者Python中的SciPy库来设计FIR滤波器。定义滤波器的规格,例如采样频率、截止频率、通带和阻带衰减等。生成滤波器的
- FPGA基础知识----第二章 FPGA 开发流程
原来如此呀
FPGA学习之旅单片机嵌入式硬件
第二章FPGA开发流程FPGA的设计流程就是利用EDA开发软件和编程工具对FPGA芯片进行开发的过程。原理图和HDL(Hardwaredescriptionlanguage,硬件描述语言)是两种最常用的数字硬件电路描述方法。其中,运用HDL设计方法具有更好的移植性、通用性以及利于模块划分的特点,在工作学习中被广泛使用。典型FPGA的开发流程一般如下图所示,其包括功能定义/器件选型、设计输入、功能仿
- Java 并发包之线程池和原子计数
lijingyao8206
Java计数ThreadPool并发包java线程池
对于大数据量关联的业务处理逻辑,比较直接的想法就是用JDK提供的并发包去解决多线程情况下的业务数据处理。线程池可以提供很好的管理线程的方式,并且可以提高线程利用率,并发包中的原子计数在多线程的情况下可以让我们避免去写一些同步代码。
这里就先把jdk并发包中的线程池处理器ThreadPoolExecutor 以原子计数类AomicInteger 和倒数计时锁C
- java编程思想 抽象类和接口
百合不是茶
java抽象类接口
接口c++对接口和内部类只有简介的支持,但在java中有队这些类的直接支持
1 ,抽象类 : 如果一个类包含一个或多个抽象方法,该类必须限定为抽象类(否者编译器报错)
抽象方法 : 在方法中仅有声明而没有方法体
package com.wj.Interface;
- [房地产与大数据]房地产数据挖掘系统
comsci
数据挖掘
随着一个关键核心技术的突破,我们已经是独立自主的开发某些先进模块,但是要完全实现,还需要一定的时间...
所以,除了代码工作以外,我们还需要关心一下非技术领域的事件..比如说房地产
&nb
- 数组队列总结
沐刃青蛟
数组队列
数组队列是一种大小可以改变,类型没有定死的类似数组的工具。不过与数组相比,它更具有灵活性。因为它不但不用担心越界问题,而且因为泛型(类似c++中模板的东西)的存在而支持各种类型。
以下是数组队列的功能实现代码:
import List.Student;
public class
- Oracle存储过程无法编译的解决方法
IT独行者
oracle存储过程
今天同事修改Oracle存储过程又导致2个过程无法被编译,流程规范上的东西,Dave 这里不多说,看看怎么解决问题。
1. 查看无效对象
XEZF@xezf(qs-xezf-db1)> select object_name,object_type,status from all_objects where status='IN
- 重装系统之后oracle恢复
文强chu
oracle
前几天正在使用电脑,没有暂停oracle的各种服务。
突然win8.1系统奔溃,无法修复,开机时系统 提示正在搜集错误信息,然后再开机,再提示的无限循环中。
无耐我拿出系统u盘 准备重装系统,没想到竟然无法从u盘引导成功。
晚上到外面早了一家修电脑店,让人家给装了个系统,并且那哥们在我没反应过来的时候,
直接把我的c盘给格式化了 并且清理了注册表,再装系统。
然后的结果就是我的oracl
- python学习二( 一些基础语法)
小桔子
pthon基础语法
紧接着把!昨天没看继续看django 官方教程,学了下python的基本语法 与c类语言还是有些小差别:
1.ptyhon的源文件以UTF-8编码格式
2.
/ 除 结果浮点型
// 除 结果整形
% 除 取余数
* 乘
** 乘方 eg 5**2 结果是5的2次方25
_&
- svn 常用命令
aichenglong
SVN版本回退
1 svn回退版本
1)在window中选择log,根据想要回退的内容,选择revert this version或revert chanages from this version
两者的区别:
revert this version:表示回退到当前版本(该版本后的版本全部作废)
revert chanages from this versio
- 某小公司面试归来
alafqq
面试
先填单子,还要写笔试题,我以时间为急,拒绝了它。。时间宝贵。
老拿这些对付毕业生的东东来吓唬我。。
面试官很刁难,问了几个问题,记录下;
1,包的范围。。。public,private,protect. --悲剧了
2,hashcode方法和equals方法的区别。谁覆盖谁.结果,他说我说反了。
3,最恶心的一道题,抽象类继承抽象类吗?(察,一般它都是被继承的啊)
4,stru
- 动态数组的存储速度比较 集合框架
百合不是茶
集合框架
集合框架:
自定义数据结构(增删改查等)
package 数组;
/**
* 创建动态数组
* @author 百合
*
*/
public class ArrayDemo{
//定义一个数组来存放数据
String[] src = new String[0];
/**
* 增加元素加入容器
* @param s要加入容器
- 用JS实现一个JS对象,对象里有两个属性一个方法
bijian1013
js对象
<html>
<head>
</head>
<body>
用js代码实现一个js对象,对象里有两个属性,一个方法
</body>
<script>
var obj={a:'1234567',b:'bbbbbbbbbb',c:function(x){
- 探索JUnit4扩展:使用Rule
bijian1013
java单元测试JUnitRule
在上一篇文章中,讨论了使用Runner扩展JUnit4的方式,即直接修改Test Runner的实现(BlockJUnit4ClassRunner)。但这种方法显然不便于灵活地添加或删除扩展功能。下面将使用JUnit4.7才开始引入的扩展方式——Rule来实现相同的扩展功能。
1. Rule
&n
- [Gson一]非泛型POJO对象的反序列化
bit1129
POJO
当要将JSON数据串反序列化自身为非泛型的POJO时,使用Gson.fromJson(String, Class)方法。自身为非泛型的POJO的包括两种:
1. POJO对象不包含任何泛型的字段
2. POJO对象包含泛型字段,例如泛型集合或者泛型类
Data类 a.不是泛型类, b.Data中的集合List和Map都是泛型的 c.Data中不包含其它的POJO
 
- 【Kakfa五】Kafka Producer和Consumer基本使用
bit1129
kafka
0.Kafka服务器的配置
一个Broker,
一个Topic
Topic中只有一个Partition() 1. Producer:
package kafka.examples.producers;
import kafka.producer.KeyedMessage;
import kafka.javaapi.producer.Producer;
impor
- lsyncd实时同步搭建指南——取代rsync+inotify
ronin47
1. 几大实时同步工具比较 1.1 inotify + rsync
最近一直在寻求生产服务服务器上的同步替代方案,原先使用的是 inotify + rsync,但随着文件数量的增大到100W+,目录下的文件列表就达20M,在网络状况不佳或者限速的情况下,变更的文件可能10来个才几M,却因此要发送的文件列表就达20M,严重减低的带宽的使用效率以及同步效率;更为要紧的是,加入inotify
- java-9. 判断整数序列是不是二元查找树的后序遍历结果
bylijinnan
java
public class IsBinTreePostTraverse{
static boolean isBSTPostOrder(int[] a){
if(a==null){
return false;
}
/*1.只有一个结点时,肯定是查找树
*2.只有两个结点时,肯定是查找树。例如{5,6}对应的BST是 6 {6,5}对应的BST是
- MySQL的sum函数返回的类型
bylijinnan
javaspringsqlmysqljdbc
今天项目切换数据库时,出错
访问数据库的代码大概是这样:
String sql = "select sum(number) as sumNumberOfOneDay from tableName";
List<Map> rows = getJdbcTemplate().queryForList(sql);
for (Map row : rows
- java设计模式之单例模式
chicony
java设计模式
在阎宏博士的《JAVA与模式》一书中开头是这样描述单例模式的:
作为对象的创建模式,单例模式确保某一个类只有一个实例,而且自行实例化并向整个系统提供这个实例。这个类称为单例类。 单例模式的结构
单例模式的特点:
单例类只能有一个实例。
单例类必须自己创建自己的唯一实例。
单例类必须给所有其他对象提供这一实例。
饿汉式单例类
publ
- javascript取当月最后一天
ctrain
JavaScript
<!--javascript取当月最后一天-->
<script language=javascript>
var current = new Date();
var year = current.getYear();
var month = current.getMonth();
showMonthLastDay(year, mont
- linux tune2fs命令详解
daizj
linuxtune2fs查看系统文件块信息
一.简介:
tune2fs是调整和查看ext2/ext3文件系统的文件系统参数,Windows下面如果出现意外断电死机情况,下次开机一般都会出现系统自检。Linux系统下面也有文件系统自检,而且是可以通过tune2fs命令,自行定义自检周期及方式。
二.用法:
Usage: tune2fs [-c max_mounts_count] [-e errors_behavior] [-g grou
- 做有中国特色的程序员
dcj3sjt126com
程序员
从出版业说起 网络作品排到靠前的,都不会太难看,一般人不爱看某部作品也是因为不喜欢这个类型,而此人也不会全不喜欢这些网络作品。究其原因,是因为网络作品都是让人先白看的,看的好了才出了头。而纸质作品就不一定了,排行榜靠前的,有好作品,也有垃圾。 许多大牛都是写了博客,后来出了书。这些书也都不次,可能有人让为不好,是因为技术书不像小说,小说在读故事,技术书是在学知识或温习知识,有
- Android:TextView属性大全
dcj3sjt126com
textview
android:autoLink 设置是否当文本为URL链接/email/电话号码/map时,文本显示为可点击的链接。可选值(none/web/email/phone/map/all) android:autoText 如果设置,将自动执行输入值的拼写纠正。此处无效果,在显示输入法并输
- tomcat虚拟目录安装及其配置
eksliang
tomcat配置说明tomca部署web应用tomcat虚拟目录安装
转载请出自出处:http://eksliang.iteye.com/blog/2097184
1.-------------------------------------------tomcat 目录结构
config:存放tomcat的配置文件
temp :存放tomcat跑起来后存放临时文件用的
work : 当第一次访问应用中的jsp
- 浅谈:APP有哪些常被黑客利用的安全漏洞
gg163
APP
首先,说到APP的安全漏洞,身为程序猿的大家应该不陌生;如果抛开安卓自身开源的问题的话,其主要产生的原因就是开发过程中疏忽或者代码不严谨引起的。但这些责任也不能怪在程序猿头上,有时会因为BOSS时间催得紧等很多可观原因。由国内移动应用安全检测团队爱内测(ineice.com)的CTO给我们浅谈关于Android 系统的开源设计以及生态环境。
1. 应用反编译漏洞:APK 包非常容易被反编译成可读
- C#根据网址生成静态页面
hvt
Web.netC#asp.nethovertree
HoverTree开源项目中HoverTreeWeb.HVTPanel的Index.aspx文件是后台管理的首页。包含生成留言板首页,以及显示用户名,退出等功能。根据网址生成页面的方法:
bool CreateHtmlFile(string url, string path)
{
//http://keleyi.com/a/bjae/3d10wfax.htm
stri
- SVG 教程 (一)
天梯梦
svg
SVG 简介
SVG 是使用 XML 来描述二维图形和绘图程序的语言。 学习之前应具备的基础知识:
继续学习之前,你应该对以下内容有基本的了解:
HTML
XML 基础
如果希望首先学习这些内容,请在本站的首页选择相应的教程。 什么是SVG?
SVG 指可伸缩矢量图形 (Scalable Vector Graphics)
SVG 用来定义用于网络的基于矢量
- 一个简单的java栈
luyulong
java数据结构栈
public class MyStack {
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private int top;
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- 基础数据结构和算法八:Binary search
sunwinner
AlgorithmBinary search
Binary search needs an ordered array so that it can use array indexing to dramatically reduce the number of compares required for each search, using the classic and venerable binary search algori
- 12个C语言面试题,涉及指针、进程、运算、结构体、函数、内存,看看你能做出几个!
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12个C语言面试题,涉及指针、进程、运算、结构体、函数、内存,看看你能做出几个!
1.gets()函数
问:请找出下面代码里的问题:
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memset(buff,0,sizeof(buff));
- ITeye 7月技术图书有奖试读获奖名单公布
ITeye管理员
活动ITeye试读
ITeye携手人民邮电出版社图灵教育共同举办的7月技术图书有奖试读活动已圆满结束,非常感谢广大用户对本次活动的关注与参与。
7月试读活动回顾:
http://webmaster.iteye.com/blog/2092746
本次技术图书试读活动的优秀奖获奖名单及相应作品如下(优秀文章有很多,但名额有限,没获奖并不代表不优秀):
《Java性能优化权威指南》