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vivado IP核调用

在开发PL时一般都会用到分频或倍频，对晶振产生的时钟进行分频或倍频处理，产生系统时钟和复位信号，下面就介绍一下在vivado2017.3中进行PL开发时调用IP的方法。
    首先打开vivado2017.3新建一个RTL项目。
    点击Flow navigator的IP Catalog 选项，如下图所示：

 vivado IP核调用_第1张图片

vivado IP核调用_第2张图片

 

 

 

在搜索框中输入clock；

如图；依次展开，找到clockingwizard；双击

vivado IP核调用_第3张图片

出现如下提示

vivado IP核调用_第4张图片

点击generate 进入配置界面



 

选用PLL（锁相环）


vivado IP核调用_第5张图片

 

 

 

 

 

 

 


下拉；设置输入时钟

 vivado IP核调用_第6张图片

 

 

 

然后点击第二项output Clock设置输出，这里用两个输出，一个倍频，一个分频

vivado IP核调用_第7张图片

 

 

 

 

 

 

 

 

之后OK；在source栏 IP source可看到加入了clk_wiz_0;

双击打开clk_wiz_0.veo可查看调用模板。如图所示；

vivado IP核调用_第8张图片

 

 

 

现在就可以调用了，编写仿真测试文件

vivado IP核调用_第9张图片

vivado IP核调用_第10张图片

 

 

 

仿真如图，可以看到两个输出分别为100hz,25hz。

vivado IP核调用_第11张图片

 

 

学习愉快！

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