【芯片设计- RTL 数字逻辑设计入门 16 -- verilog CRC-8 实现】

CRC 校验

CRC校验（Cyclic Redundancy Check）是一种用于检测数据传输或存储后是否出现错误的技术。其核心思想是通过发送方和接收方都遵循同一算法生成一个数据块的校验码，然后接收方将其与接收到的数据的校验码进行比较。如果两者一致，那么数据很可能是完整和未受损的；如果不同，那么数据在传输或存储过程中可能发生了错误。

简单通俗的介绍：
假设你有一本书，你想检查这本书是否完整，没有丢失任何页面。CRC校验就像是你在书的每一页上都做一个特殊的标记，然后计算所有这些标记的总和。你告诉接收者（比如你的朋友）也按照同样的方法来做。你的朋友收到书后，也按照相同的方法做标记并计算总和。然后，他将他的总和与你的总和进行比较。如果两者相同，那么书很可能是完整的；如果不同，那么书可能在传输过程中丢失了一些页面。

verilog and testbench

VCS 仿真波形

仿真结果可以使用网页版本 CRC工具：http://www.ip33.com/crc.html

综合图