FPGA开发入门

嵌牛2

姓名李泽浩学号21181214372学院广州研究院转载自https://blog.csdn.net/FPGADesigner/article/details/88675808【嵌牛导读】定时器使用示例【
李泽浩·2024-02-15 08:23

m基于FPGA的RS+卷积级联编译码实现,RS用IP核实现,卷积用verilog实现,包含testbench测试文件

目录1.算法仿真效果2.算法涉及理论知识概要2.1卷积码编码2.2RS码编码2.3级联编码2.4解码过程3.Verilog核心程序4.完整算法代码文件获得1.算法仿真效果Vivado2019.2仿真结果如下：2.算法涉及理论知识概要级联码是一种通过将两种或多种纠错码结合使用来提高纠错能力的编码方案。在RS+卷积级联编码中，通常首先使用卷积码对原始数据进行编码，以增加冗余并提供一定的纠错能力。然后，
我爱C编程·2024-02-15 04:40

Linux 下C++开发入门指南

原文链接：http://blog.csdn.net/luoduoduojiayou/article/details/54585114本文目的是针对将熟悉C/C++语法，如何在Linux下进行的C/C++开发的入门指南。Linux下的开发和在Windows下的开发类似，主要区别点在于操作系统不同，开发工具，开发API，编译调试方法不一样，故主要将针对这些不同点进行阐述，使在Windows开发的程序员
Xiacedar·2024-02-15 02:42

CRC校验 - 基于FPGA的实现

CRC校验-基于FPGA的实现0背景CRC即循环冗余校验：常用于数据通信领域中，通常由发送端添加校验码于单帧数据的尾部，并由接受方进行提取和校验该帧数据传输是否正确。
CAOXUN_FPGA·2024-02-14 15:25

AMD FPGA设计优化宝典笔记（4）复位桥

高亚军老师的这本书《AMDFPGA设计优化宝典》，他主要讲了两个东西：第一个东西是代码的良好风格；第二个是设计收敛等的本质。
徐丹FPGA之路·2024-02-14 07:06

AMD FPGA设计优化宝典笔记（3）控制集

控制集1控制集的个数要求控制集controlset：因为7系列FPGA，一个slice只能有一种控制集（触发器的使用方式比如有复位/有时钟使能等等），多了就会分布到不同的slice里，所以代码尽量统一触发器的控制集使用方式
徐丹FPGA之路·2024-02-14 07:36

【INTEL（ALTERA）】为什么 PCI Express 的 P-tile Avalon Streaming FPGA IP 显示 RDC-50002 警告？

说明由于英特尔®Quartus®PrimeProEdition软件版本21.4及更高版本存在一个问题，您可能会看到PCIExpress*的P-tileAvalon®流式传输英特尔®FPGAIP违反以下设计助手规则
神仙约架·2024-02-13 22:58

【INTEL（ALTERA）】为什么altera FPGA主板测试系统报告power的电流读数高

说明您可能会观察到alteraFPGA主板测试系统中电源实用程序显示的高电流值，这与直接连接到电源寄存器时测量的值不同。
神仙约架·2024-02-13 22:27

基于嵌入式linux开发的“2048”游戏综合设计

学号：17020110019姓名：高少魁【嵌牛导读】本设计将之前提到的在FPGA开发平台上设计的游戏2048移植到了嵌入式开发平台上，利用基于qemu开源软件的虚拟mini2440开发板，使用Framebuffer
Clearlovekui9·2024-02-13 18:29

全定制FPGA硬件电路设计实现最大公约数求取算法（Quartus II）

设计原理及结构方案四、电路设计描述1.32位D触发器2.32位多路选择器3.32位减法器4.32位求余电路5.GCDOUT信号产生电路6.DONE_L信号产生电路五、仿真激励设计方案及电路仿真结构六、设计总结当前，FPGA
2402_82964571林·2024-02-13 17:41

《FPGA至简设计原理与应用》学习笔记2 —— FPGA至简设计原理

课程资源视频：https://www.bilibili.com/video/BV14K4y1u7kH/资料：https://www.aliyundrive.com/s/E9H7Mc5hqhu第1章高效编辑器GVIMGVIM官方的四种操作模式命令模式插入模式可视模式正常模式本课程至简设计法将GVIM分为三种模式：命令模式：只能看代码和发出命令，不能进行文本编辑编辑模式：文本编辑列操作模式：对多行的某
|惜取少年时·2024-02-13 15:06

AMD FPGA设计优化宝典笔记（1）触发器

高亚军老师的这本书《AMDFPGA设计优化宝典》，他主要讲了两个东西：第一个东西是代码的良好风格；第二个是设计收敛等的本质。
徐丹FPGA之路·2024-02-13 09:13

AMD FPGA设计优化宝典笔记（2）亚稳态

一亚稳态亚稳态的产生是由于寄存器采样不满足建立时间或保持时间要求导致的，亚稳态的产生是无法避免的，我们能做的只是想办法降低其发生的频率。在跨时钟域设计中，由于时钟域存在跨域，如果不采取手段，则会有很大概率会引入亚稳态。今天看了亚稳态这一章，感觉印象最深刻的是，它对应的是异步的处理，也就是发送的寄存器的时钟是一个，接收寄存器的时钟是另外一个。1单bit的信号如果是一个单比特的信号，那么可以通过让接收
徐丹FPGA之路·2024-02-13 08:12

FPGA_工程_基于rom的vga显示

一框图二代码修改moduleDisplay#(parameterH_DISP=1280,parameterV_DISP=1024,parameterH_lcd=12'd150,parameterV_lcd=12'd150,parameterLCD_SIZE=15'd10_000)(inputwireclk,inputwirerst_n,inputwire[11:0]lcd_xpos,//lcdho
哈呀_fpga·2024-02-12 18:44

vivado中关于mark_debug综合被优化的问题

vivado中关于mark_debug综合被优化的问题最近项目中到了FPGA验证阶段，使用vivado2010版本百度各种方法去探测想要debug的信号，一些简单的信号，直接在netlist中标记即可，
weixin_37639451·2024-02-12 16:10

AD9689 input clock not detect

网址如下：AD9689inputclocknotdetect-Q&A-High-SpeedADCs-EngineerZone(analog.com)OurFPGAboardhastwoAD9689，oneworksok
jjzw1990·2024-02-12 16:39

JESD204B接口调试记录3 - 总结

六、FPGA工程里JESD204IP如何设置？七、传输层如何解包？
jjzw1990·2024-02-12 16:09

【Vivado】JTAG连着FPGA启动失败问题

问题描述：Vivado2016以后的版本，JTAG连着FPGA并且VivadoHardwareManger打开的情况下，会出现上电后启动失败的问题。
jjzw1990·2024-02-12 16:08

一个Vivado仿真问题的debug

我最近在看Synopsys的MPHY仿真代码，想以此为参考写个能实现PWM-G1功能的MPHY，并应用于ProFPGA原型验证平台。
jjzw1990·2024-02-12 16:37

阿里集团基于 Fluid+JindoCache 加速大模型训练的实践

在计算方面，以GPU和FPGA等异构硬件为例，他们通过短周期的迭代和演进来适应不断变化的需求。阿里集团通过统一调度、统一资源池以及全面弹性等调度手段满足了复杂的计
阿里技术·2024-02-12 15:00

Vitis AI 集成

在设计时兼顾高效率和易用性，充分发挥了XilinxFPGA和ACAP上AI加速的潜力。TVM中当
·2024-02-12 12:42

Android开发入门经典实例 - My notes

/*Android开发入门经典实例*/Mynoteshttps://www.tianmaying.com/tutorial/a-simple-sample-for-android-development
程序猪小羊·2024-02-12 12:53

【Vitis/Vivado】在一台PC上同时调试多块FPGA开发板的方法

参考文献https://support.xilinx.com/s/article/75316?language=en_US问题描述需要对多个开发板之间的数据交互进行调试，而手头只有一台PC（和拓展坞），下文将介绍如何利用仅有的PC连接多个板卡进行单步调试。步骤连接多块开发板到电脑，启动开发板，如果接口不够可以用拓展坞或者只连接JTAG接口，在系统菜单里找到XilinxDesignTools，从中找
wjh776a68·2024-02-12 11:27

Vivado用ILA抓波形保存为CSV文件

将ILA观察到的波形数据捕获为CSV文件，抓10次，把文件合并，把源文件删除运行方法：Vivado的Tclconsole窗口输入命令settcl_dirF:/KLD_FPGA/Code/simsettcl_filenameTCL_ILA_TRIG_V1.2
nomil9·2024-02-12 10:36

Djiango后端开发入门学习之task04--serializers（序列化器，准确说是数据类型转化器）及应用

  本文根据datawhale开源Djiango后端开发入门(https://github.com/Joe-2002/sweettalk-django4.2）Task04：序列化器serializers
小鳄鱼队里一只小蜗牛·2024-02-12 10:30

QGIS开发入门知识

1.基础知识QGIS是一个开源的基础地理信息系统平台软件，是在GNU公共许可证(GPL)版本2或更高版本下发布的,这也意味着用户始终可以免费地获取、修改和使用QGIS。开发技术基于C++和Qt库，具有跨平台的特性，可运行在包括macos、windows等操作系统在内的多个终端平台上。支持多种矢量、栅格、网格等空间数据格式，优异的插件架构也能很容易地支持新的数据格式。支持的栅格数据格式：GRASS、
mj348940862·2024-02-12 10:18

卫星通讯领域FPGA关注技术：算法和图像方面（2）

最近关注的公众号提到了从事移动通信、卫星通讯等领域的FPGA、ASIC、信号处理算法等工程师可能需要关注的技术，有MVDR算法、高速基带芯片、RF芯片、毫米波有源相控阵天线、无线AI，以下做了一些基础的调研
徐丹FPGA之路·2024-02-11 17:12

卫星通讯领域FPGA关注技术：算法和图像方面（4）

最近关注的公众号提到了从事移动通信、卫星通讯等领域的FPGA、ASIC、信号处理算法等工程师可能需要关注的技术，有5GNTN、多址技术、低轨通信卫星LEO，以下做了一些基础的调研：15GNTN来自《5GNTN
徐丹FPGA之路·2024-02-11 17:12

卫星通讯领域FPGA关注技术：算法和图像方面（1）

最近关注的公众号提到了从事移动通信、卫星通讯等领域的FPGA、ASIC、信号处理算法等工程师可能需要关注的技术，有LMS算法、RLS算法、LCMV算法、SAR图像处理，以下做了一些基础的调研：1LMS算法
徐丹FPGA之路·2024-02-11 17:42

卫星通讯领域FPGA关注技术：算法和图像方面（3）

最近关注的公众号提到了从事移动通信、卫星通讯等领域的FPGA、ASIC、信号处理算法等工程师可能需要关注的技术，有通感融合、RNSS授时、惯导，以下做了一些基础的调研：1通感融合1）来自博鳌亚洲论坛·创新报告
徐丹FPGA之路·2024-02-11 17:12

[从零开始学习FPGA编程-28]：进阶篇 - 基本组合电路-奇偶校验生成器（Verilog语言版本）

作者主页(文火冰糖的硅基工坊)：文火冰糖（王文兵）的博客_文火冰糖的硅基工坊_CSDN博客本文网址：目录第1章奇偶校验生成器1.1什么是奇校验1.2Verilog语言描述
文火冰糖的硅基工坊·2024-02-11 08:14

fpga 需要掌握哪些基础知识？

个人根据自己的一些心得总结一下fpga需要掌握的基础知识，希望对你有帮助。
宸极FPGA_IC·2024-02-11 01:30

13. 串口接收模块的项目应用案例

1.使用串口来控制LED灯工作状态使用串口发送指令到FPGA开发板，来控制第7课中第4个实验的开发板上的LED灯的工作状态。
Dale_e·2024-02-10 21:43

CPLD/FPGA/Verilog_如何写代码减少逻辑单元的使用数量

如何写代码减少逻辑单元的使用数量工作中遇到的问题，芯片级的资源有限制，没办法只能改进逻辑单元综合电路逻辑。一....尽量不要使用"大于""小于"这样的判断语句,这样会明显增加使用的逻辑单元数量.看一下报告,资源使用差别很大.例程:always@(posedgeclk)begincount1=count1+1;if(count1==10000000)feng=1;//no_ringelseif(co
Peter_hust·2024-02-10 09:11

Vitis AI 集成

在设计时兼顾高效率和易用性，充分发挥了XilinxFPGA和ACAP上AI加速的潜力。T
HyperAI超神经·2024-02-10 08:33

Google Gemini 与 ChatGPT的区别

我的新书《AndroidApp开发入门与实战》已于2020年8月由人民邮电出版社出版，欢迎购买。点击进入详情目录为什么是谷歌？为什么现在？
ChatGPTer·2024-02-10 07:12

电力电子技术

5.0简介5.1基本斩波电路5.1.1降压斩波电路BuckChopper5.1.1.1小纹波近似5.1.2升压斩波电路11DC-DC变换器数字控制11.1基于单片机控制11.2基于DSP控制11.3基于FPGA
万码无虫·2024-02-10 06:07

AUTOSAR汽车电子嵌入式编程精讲300篇-基于FPGA和CAN协议2.0B的总线控制器研究与设计（续）

目录3.2寄存器管理模块3.2.1寄存器规划及设计3.2.2BasicCAN模式3.2.3PeliCAN模式
格图素书·2024-02-10 06:55

FPGA实现ISP用于无人车、无人机配送的方案调研

查到一个always奥唯思公司做的用FPGA实现ISP的方案，采用易灵思钛金16nm的FPGATi60F225，通过MIPICSIRX采集图像传感器的数据，在FPGA内部经过一系列复杂的ISP运算后，再通过
徐丹FPGA之路·2024-02-10 00:35

平时积累的FPGA知识点（4）

回答:用emio或者gp接口，如果是控制fpga芯片外部信号，用mio。
徐丹FPGA之路·2024-02-10 00:35

数字IC实践项目（9）— Tang Nano 20K: I2C OLED Driver

写在前面的话硬件模块RTL电路和相关资源报告SSD1306OLED驱动芯片SSD1306I2C协议接口OLED驱动模块RTL综合实现总结写在前面的话之前在逛淘宝的时候偶然发现了TangNano20K，十分感慨国产FPGA
IC_Brother·2024-02-09 22:35

Diamond软件的使用--(1)软件安装及配置

3.12版本64位官网链接(简单注册账户即可下载)：https://www.latticesemi.com/en/Products/DesignSoftwareAndIP/FPGAandLDS/LatticeDiamond
zidan1412·2024-02-09 19:07

Diamond3.5软件的使用--(2)新建工程并生成可烧录文件

相关参考：https://www.stepfpga.com/doc/lattice_diamond%E7%9A%84%E4%BD%BF%E7%94%A8====1.新建工程并导入verilog文件===
zidan1412·2024-02-09 19:07

vscode开发FPGA(0)--windows平台搭建

一、从官网下载安装VScodeDownloadVisualStudioCode-Mac,Linux,Windows二、安装配置插件1.安装Chinese（simplified）中文汉化包2.安装Verilog-HDL/systemVerilog插件(支持verilog语法)3.配置CTagsSupport插件(支持代码跳转)1)在github下载universalctags最新版本Release2
zidan1412·2024-02-09 19:35

微信小程序开发一些经验

对于微信小程序开发入门，还是比较简单的，只需要具备基本的css+js知识就可以了，成本比较低。
极乐叔·2024-02-09 19:47

2024-02-01 Unity Shader 开发入门4 —— ShaderLab 语法

文章目录1材质和Shader1.1UnityShader和Shader的区别1.2Unity中的材质和Shader1.3创建材质1.4创建Shader2ShaderLab的基本结构2.1什么是ShaderLab2.2ShaderLab的基本结构3Shader名称4Shader属性4.1Shader属性的作用4.2Shader属性的基本语法4.3数值类型4.4颜色和向量类型4.5纹理贴图类型5子着色
蔗理苦·2024-02-09 12:21

VH6501CAN干扰仪CANDisturbance干扰测试

因为VH6501中的FPGA时钟频率是160Mhz，所以一个tick就是6.25ns，而CAN总线速率100kbi
LLLTM·2024-02-09 11:51

Quartus工程的qsf配置约束文件介绍

一、qsf文件概述qsf：QuartusSettingFile，是Quartus工程的配置文件；包含一个Quartus工程的所有约束，包括工程的软件版本信息、FPGA器件信息、引脚约分配、引脚电平分配，
GBXLUO·2024-02-09 09:02

用pcimem读写x64平台下的PCIE外设寄存器

背景在之前的一篇文章用devmem2读写设备IO内存中，我介绍了devmem2这个通过读写/dev/mem文件实现从用户空间访问外设寄存器的工具，但是对于PCIE设备，特别是FPGA模拟出来的自定义PCIE
六个九十度·2024-02-09 05:11

FPGA_ip_pll

一pllip核简介pll即锁相环，可以对输入到fpga的时钟信号，进行分频，倍频，占空比的调整，从而输出期望的时钟。
哈呀_fpga·2024-02-08 23:24
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