Quartus II 9.0下载与安装

【教程4＞第5章＞第28节】基于帧同步+相位同步+位同步的QPSK调制解调通信系统整体性能分析 fpga和matlab #fpga开发帧同步+相位同步+位同步 QPSK 教程4
欢迎订阅FPGA/MATLAB/Simulink系列教程《★教程1:matlab入门100例》《★教程2:fpga入门100例》《★教程3:simulink入门60例》《★教程4:FPGA/MATLAB/Simulink联合开发入门与进阶X例》目录1.软件版本2.系统资源占用3.系统性能分析3.1信噪比设置3.2时偏设置3.3相位偏差设置4.总结
【PCIe XDMA开发】Windows环境下再也不用重启电脑了 RunningCamel PCIe fpga开发 FPGA Xilinx
Windows环境下开发，使用FPGA开发PCIeXDMA驱动，重新下载bit文件后，通常会遇到主机无法识别到固件更改的问题。一般有以下方式，可以解决识别问题：1.热重启（HotReset）适用场景：FPGA固件通过bit文件临时加载（未固化到Flash）。操作步骤：在主机开机状态下，断开并重新连接FPGA开发板的电源。再次执行硬件扫描。右键点击“此电脑”→“管理”→“设备管理器”。点击顶部菜单栏
串行通信接口-Modbus通信 FPGArea FPGA通信接口 fpga开发 Modbus RS-485 UART
文章目录1.Modbus介绍1.1协议模型1.2网络拓扑1.3帧结构1.4通讯模型1.5寄存器类型1.6功能码2.搭建实验环境3.FPGA实现3.1接收端3.1.1接收状态机3.1.2数据缓存3.1.3接口设计3.2发送端3.2.1发送状态机3.2.2数据缓存3.2.3接口设计4.传送门1.Modbus介绍1.1协议模型Modbus协议是一种用于工业控制的网络通讯协议，即一种机器与机器之间进行数据
『FPGA开发必备技能』汇总导航 FPGArea FPGA开发必备技能 fpga开发 FPGA Vivado Xilinx
※Welcome大家好，欢迎来到瑾芳玉洁的博客！励志开源分享诗和代码，三餐却无汤，顿顿都被噎。有幸结识那个值得被认真、被珍惜、被捧在手掌心的女孩，不出意外被敷衍、被唾弃、被埋在了垃圾堆。喜欢舞文弄墨咬文嚼字的混沌世界，懵懂无知走上了工科直男01的不归路。八十公斤的体重勉强与大鹏一日同风起的浮力动态平衡，做不到宠辱不惊无欲无求的匀速直线运动，就按部就班的小波浪式前进，螺旋式蠕动。<我是一名专注于FP
fpga原理和结构 pdf_一文带你认识FPGA~ weixin_39849888 fpga原理和结构 pdf fpga芯片架构设计与实现 pdf
在我们嵌入式中，有这样一朵奇葩介于软件与硬件之间，这朵奇葩就是FPGA。可能很多平时玩MCU比较多的朋友不太了解。之前我也不太了解，但是最近两年的这两份工作都有与FPGA挂钩，所以我精通FPGA程序的烧写(不仅如此，我还精通电脑的开关机，哈哈)：下面我们一起来简单了解一下。什么是FPGAFPGA(FieldProgrammableGateArray)，即现场可编程逻辑门阵列，属于专用集成电路中的一
fpga原理和结构 pdf_FPGA最小系统的设计方法 weixin_39998795 fpga原理和结构 pdf
FPGA最小系统是可以使FPGA正常工作的最简单的系统。它的外围电路尽量最少，只包括FPGA必要的控制电路。一般所说的FPGA的最小系统主要包括FPGA芯片、下载电路、外部时钟、复位电路和电源。如果需要使用SOPC软嵌入式处理器还要包括SDRAM和Flash。一般以上这些组件是FPGA最小系统的组成部分。本文以EP2C8Q208C8为主芯片进行FPGA最小系统的设计。FPGA芯片管脚介绍对于需要在
简述fpga的原理和结构_几组实用FPGA原理设计图 Tengfei Jiang 简述fpga的原理和结构
FPGA(Field－ProgrammableGateArray)，即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。FPGA的开发相对于传统PC、单片机的开发有很大不同。FPGA以并行运算为主，以硬件描述语言来实现；相比于PC或单
国产化板卡设计原理图：2288-基于FMC接口的JFM7K325T PCIeX4 3U VPX接口卡 hexiaoyan827 3U VPX FMC子卡 JFM7K325T板卡软件无线电处理平台数据采集IO卡
基于FMC接口的JFM7K325TPCIeX43UVPX接口卡一、板卡概述标准VPX3U板卡，基于JFM7K325T芯片，pin_to_pin兼容FPGAXC7K410T-2FFG900，支持PCIeX8、64bitDDR3容量2GByte，HPC的FMC连接器，板卡支持各种接口输入，软件支持windows，Linux驱动。可应用于高性能计算，频域算法，如与FFT的加速等；配合AD，DAFMC子卡
Altera PDN 设计和 FPGA 收发器性能 FPGA技术实战 Xinx FPGA硬件设计 FPGA 收发器电源
本文档介绍在电源分配网络(PDN)设计中采用现代开关稳压器的优势，利用这些优势获得最佳FPGA收发器性能。本白皮书为怎样在低噪声应用中选择稳压器提供指南，还包括一个测试案例，展示不同类型稳压器和电源线配置的收发器性能。引言：面向收发器(SERDES)FPGA的PDN设计对电源有严格的要求，需要干净的电压源。虽然低功耗应用中通常采用低泄漏(LDO)线性稳压器，但这一方法必须仔细的隔离电压源。电路板设
FPGA状态机设计 FPGA小学生 fpga 状态机 verilog
B站对应讲解本文视频链接状态机：状态机是逻辑设计里面重要的内容，许多公司的硬件和逻辑工程师面试中，状态机设计几乎是必选题目。所以本次以状态机为话题进行重点讨论，以及如何写好状态机。状态机全称是有限状态机（FiniteStateMachine、FSM），是表示有限个状态以及在这些状态之间的转移和动作等行为的数学模型。本篇博客对相关概念以及使用状态机实现特定字符串的检测，并通过程序具体理解一段式、两段
《解锁AI芯片新境界：提升专用人工智能芯片通用性与灵活性的热点技术》程序猿阿伟人工智能
在人工智能飞速发展的当下，专用人工智能芯片虽在特定任务上表现出色，但提升其通用性和灵活性已成为行业关键课题。以下是一些相关的热点技术。可重构架构技术可重构架构允许芯片在运行时根据不同任务需求动态改变自身的硬件结构和功能。如现场可编程门阵列（FPGA），内部有大量可配置逻辑单元和布线资源，用户能通过编程实现不同的逻辑功能，可针对不同的人工智能算法和应用场景快速重构，像在图像识别和自然语言处理任务间灵
spi iic和串口的区别_IIC协议解释 weixin_39995943 spi iic和串口的区别两个单片机iic通讯程序模拟iic和硬件iic区别
欢迎FPGA工程师加入官方微信技术群点击蓝字关注我们FPGA之家-中国最好的纯工程师社群(1)概述I2C(Inter-IntegratedCircuitBUS)集成电路总线，该总线由NXP(原PHILIPS)公司设计，多用于主控制器和从器件间的主从通信，在小数据量场合使用，传输距离短，任意时刻只能有一个主机等特性。经常ＩＩＣ和ＳＰＩ接口被认为指定是一种硬件设备，但其实这样的说法是不尽准确的，严格的
均薪23W还缺人，FPGA工程师到底有多重要? 博览鸿蒙 FPGA fpga开发
近两年，随着FPGA行业的快速发展，FPGA工程师的需求量持续增长。FPGA技术在通信、人工智能、自动驾驶、数据中心等领域的广泛应用，使得这一岗位变得尤为重要。尤其是在高性能计算、边缘计算等场景下，FPGA凭借其高并行计算能力和灵活性，成为不可或缺的技术方案。FPGA工程师的核心职责FPGA工程师主要负责FPGA的开发、调试和优化，具体包括：逻辑设计与实现：使用Verilog/VHDL等硬件描述语
点亮你的LED灯张口口 fpga开发
一、前言对于每一个FPGA的初学者，经过一段时间的理论学习后，都会有跃跃欲试的感觉，迫不及待的想通过建立一个完整的工程来验证软件安装是否正确，验证综合编译的流程是否正确，以及成功上板的喜悦感。点亮一个LED灯似乎是大多数人的选择，我的记录生涯也从点亮第一个LED开始吧。二、程序RTL代码`timescale1ns/1nsmoduleled(outputwireled_out//点亮你的LED灯);
Verilog 实现 FPGA 复杂算法的案例百态老人 fpga开发
在数字电路设计领域，FPGA（现场可编程门阵列）因其灵活性和高性能而备受青睐。有许多利用Verilog实现FPGA复杂算法的案例。例如，有一个项目是在FPGA中用Verilog实现开方运算。该项目充分利用Verilog的强大功能，通过深入理解FPGA的内部结构优化代码资源利用率，采用经典数学算法确保计算结果的准确性和高效性。具有高效性、可移植性和易用性等优势，适用于对实时性要求较高的应用场景，为开
FPGA极易入门教程----数码管篇（1）静态显示_数码管静态显示 2401_87555332 fpga开发
图2：共阴极数码管显示数字“1”其他数字的演示就不做了，根据这个原理可以整理出0~9这10个数字的编码方式（适用共阳极，共阴极只要将编码取反即可）：图3：共阳极数码管编码表这里涉及到两个概念：段选：单个数码管的二极管控制信号（a~g），控制段选可以实现数码管显示不同的数字位选：单个数码管的“电源开关”信号，只有在位选有效的情况下（有电情况下），控制数码管的段选才有意义也就是说通过控制位选可以控制数
AUTOSAR汽车电子嵌入式编程精讲300篇-基于FPGA的CAN FD汽车总线数据交互系统设计格图素书 fpga开发汽车
目录前言汽车总线以及发展趋势汽车总线技术汽车总线发展趋势CANFD总线国内外研究现状2系统方案及CANFD协议分析2.1系统控制方案设计2.2CANFD总线帧结构分析2.2.1数据帧分析2.2.2远程帧分析2.2.3过载帧分析2.2.4错误帧分析2.2.5帧间隔分析2.3位流编码以及位时序分析2.3.1位流编码分析2.3.2位时间分析2.3.3位时间切换及位同步分析本文篇幅较长，分为上中下三篇，文
Verilog 语法篇硬件描述语言 7yewh 【FPGA 知识点笔记汇总】fpga开发硬件工程驱动开发 arm开发物联网 iot
Verilog是一种硬件描述语言，用于设计、模拟和综合数字电路和系统。它主要用于描述ASIC（专用集成电路）或FPGA（现场可编程门阵列）等硬件设备的结构和行为。定义与用途：Verilog是一种硬件描述语言（HDL），主要用于数字电路的建模、仿真、综合与验证。设计人员利用它来描述电路的结构、行为以及时序关系，从而生成实际的硬件电路（如FPGA或ASIC）。发展背景：1984年，PhilMoorby
Xilinx 7系列FPGA架构之时钟资源（一） FPGA技术实战 FPGA器件架构 Xinx FPGA硬件设计 FPGA 架构时钟时钟输入
引言：从本文开始，我们陆续介绍Xilinx7系列FPGA的时钟资源架构，熟练掌握时钟资源对于FPGA硬件设计工程师及软件设计工程师都非常重要。本章概述7系列FPGA时钟，比较了7系列FPGA时钟和前几代FPGA差异，总结7系列FPGA中的时钟连接。有关7系列FPGA时钟资源使用的详细信息，请关注后续文章。时钟资源架构概述7系列FPGA与前一代FPGA时钟资源差异时钟资源连接概述1.时钟资源架构概述
FPGA与ASIC：到底选哪个好？博览鸿蒙 FPGA fpga开发
不少人想转行FPGA，但在ASIC和FPGA之间犹豫不决。要做出选择，首先需要清楚两者的区别和各自特点。FPGA(FieldProgrammableGateArray)是一种现场可编程门阵列芯片，本质上它是一种半定制的芯片，可以根据需要重新编程，以适应不同的功能需求。FPGA兼具硬件和软件的特点，可以在硬件层面进行控制，也可以编程实现算法功能，具有较高的灵活性和快速开发的优势。而ASIC(Appl
入行FPGA设计工程师需要提前学习哪些内容？博览鸿蒙 FPGA fpga开发
FPGA作为一种灵活可编程的硬件平台，广泛应用于嵌入式系统、通信、数据处理等领域。很多人选择转行FPGA设计工程师，但对于新手来说，可能在学习过程中会遇到一些迷茫和困惑。为了帮助大家更好地准备，本文将详细介绍入行FPGA设计工程师所需学习的内容。FPGA设计的重要性FPGA设计是硬件设计中非常重要的一环，具有高灵活性、快速的验证周期以及较短的产品上市时间等优势。相较于ASIC，FPGA设计不需要进
星辰——人工智能中台 jingmuxu123 人工智能自然语言处理 nlp
星辰闪耀，赋能不止。2020年，智慧眼AILab正式发布并启用新一代人工智能平台—星辰人工智能中台。星辰人工智能中台主要包括算力层、容器层、引擎层和能力层四部分，为行业智能应用提供AI能力支撑的统一共享服务平台，满足了人工智能算法场景的高度定制化需求。人工智能中台四个部分介绍算力层面：可以实现对众多CPU、GPU、FPGA和ARM等国内外计算资源进行有机整合。容器层面：支持和数据中台进行无缝对接，
（16）System Verilog联合体union详解宁静致远dream System Verilog教程 stm32 深度学习机器学习
（16）SystemVerilog联合体union详解1.1目录1）目录2）FPGA简介3）SystemVerilog简介4）SystemVerilog联合体union详解5）结语1.2FPGA简介FPGA（FieldProgrammableGateArray）是在PAL、GAL等可编程器件的基础上进一步发展的产物。它是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的
FPGA约束：如何生成时钟多路复用器及时钟约束？编码实践 fpga开发 matlab
FPGA约束：如何生成时钟多路复用器及时钟约束？在现代数字电路设计中，高速信号的传输对时钟信号的要求非常严格。设计者通常需要生成各种时钟信号，并为其指定合适的时钟约束。为了优化资源使用，FPGA中经常使用时钟多路复用器来同时提供多个时钟。本文将介绍如何使用VerilogHDL编写时钟多路复用器，并为其生成合适的时钟约束。时钟多路复用器的实现代码如下所示：moduleclk_mux#(paramet
（52）多路时钟复用FPGA如何约束一（片外时钟复用约束）宁静致远dream FPGA求职核心竞争力 fpga开发被问的面试题求职路上
1.1多路时钟复用FPGA如何约束一（片外时钟复用约束）1.1.1本节目录1）本节目录；2）本节引言；3）FPGA简介；4）多路时钟复用FPGA如何约束一（片外时钟复用约束）；5）结束语。1.1.2本节引言“不积跬步，无以至千里；不积小流，无以成江海。就是说：不积累一步半步的行程，就没有办法达到千里之远；不积累细小的流水，就没有办法汇成江河大海。1.1.3FPGA简介FPGA（FieldProgr
多路复用时钟和双沿时钟 Hack电子 fpga开发单片机嵌入式硬件
关注、星标公众号，精彩内容每日送达来源：网络素材时钟多路器用于使同一个逻辑功能具有不同的时钟，比如在通信系统中，为了适应不同的数据速率要求，经常要进行时钟切换。有时为了节约功耗，也会把高速时钟切换到低速时钟，或者进行时钟休眠操作。下图是某一类型的时钟多路器：虽然在时钟信号上引入多路逻辑会产生毛刺等问题，但是在不同的应用中，对多路时钟的要求区别很大。时钟切换的最佳途径是使用FPGA内部的专用Cloc
多路时钟复用FPGA约束和实现 MZEing fpga开发
多路时钟复用FPGA约束和实现多路时钟复用（Multi-ClockMultiplexing）是一种常见的技术，在FPGA设计中用于管理多个时钟域。通过合理使用多路时钟复用技术，可以有效减少资源消耗，并简化时钟域交叉问题的处理。本文将介绍多路时钟复用的约束方法，并提供相应的源代码示例。时钟域划分（ClockDomainPartitioning）多路时钟复用的第一步是将设计中的信号划分到不同的时钟域。
厚物科技PXIe/PXI一体化测控平台HW-1043d 厚物科技 PXIe/PXI/VPX 集成测试自动化产品运营科技
PXIe测控系列HW-1043d专为各种测试和测量应用而设计自带嵌入式控制器控制功能及扩展功能一体化设计外部IO接口丰富内置Intel®Core™第七代双核四线程CPU内存最大支持32GB提供4个3UPXIe/PXI混合扩展槽第4槽支持双槽宽的PXIe/PXI功能模块可内置数采、航空总线、FPGA、射频及开关等功能模块系统带温控电路对风扇进行PWM转速控制散热设计符合PXIe/PXI总线规范支撑仰
Intel 与 Yocto 项目的深度融合：全面解析与平台对比嵌入式Jerry Yocto linux 嵌入式硬件 eureka 容器 docker
在嵌入式Linux领域，Yocto项目已成为构建定制化Linux发行版的事实标准，广泛应用于不同架构的SoC平台。Intel作为x86架构的领导者，在Yocto生态中投入了大量资源，为其嵌入式处理器、FPGA和AI加速硬件提供了完整的支持。本文将详细介绍Intel如何在Yocto项目中构建、优化和维护其嵌入式Linux解决方案，并与其他芯片平台（如NXP、AMD、RaspberryPi）进行对比，
基于 FPGA 的 CNN 卷积神经网络整体实现鱼弦人工智能时代 fpga开发 cnn 人工智能
基于FPGA的CNN卷积神经网络整体实现介绍卷积神经网络（CNN）是一种强大的深度学习架构，广泛用于图像识别、物体检测和自然语言处理等领域。FPGA以其并行处理能力、低延迟和灵活性，是加速CNN推理的理想硬件平台。通过在FPGA上实现CNN，可以显著提高实时应用中的推理效率。应用使用场景实时图像识别：如智能手机摄像头中的面部识别。自动驾驶：环境感知和障碍物检测。医疗影像分析：快速处理MRI或X-R
二分查找排序算法周凡杨 java 二分查找排序算法折半
一：概念二分查找又称折半查找（折半搜索/ 二分搜索），优点是比较次数少，查找速度快，平均性能好；其缺点是要求待查表为有序表，且插入删除困难。因此，折半查找方法适用于不经常变动而查找频繁的有序列表。首先，假设表中元素是按升序排列，将表中间位置记录的关键字与查找关键字比较，如果两者相等，则查找成功；否则利用中间位置记录将表分成前、后两个子表，如果中间位置记录的关键字大于查找关键字，则进一步
java中的BigDecimal bijian1013 java BigDecimal
在项目开发过程中出现精度丢失问题，查资料用BigDecimal解决，并发现如下这篇BigDecimal的解决问题的思路和方法很值得学习，特转载。原文地址：http://blog.csdn.net/ugg/article/de
Shell echo命令详解 daizj echo shell
Shell echo命令 Shell 的 echo 指令与 PHP 的 echo 指令类似，都是用于字符串的输出。命令格式： echo string 您可以使用echo实现更复杂的输出格式控制。 1.显示普通字符串: echo "It is a test" 这里的双引号完全可以省略，以下命令与上面实例效果一致： echo Itis a test 2.显示转义
Oracle DBA 简单操作周凡杨 oracle dba sql
--执行次数多的SQL select sql_text,executions from ( select sql_text,executions from v$sqlarea order by executions desc ) where rownum<81; &nb
画图重绘朱辉辉33 游戏
我第一次接触重绘是编写五子棋小游戏的时候，因为游戏里的棋盘是用线绘制的，而这些东西并不在系统自带的重绘里，所以在移动窗体时，棋盘并不会重绘出来。所以我们要重写系统的重绘方法。在重写系统重绘方法时，我们要注意一定要调用父类的重绘方法，即加上super.paint(g)，因为如果不调用父类的重绘方式，重写后会把父类的重绘覆盖掉，而父类的重绘方法是绘制画布，这样就导致我们
线程之初体验西蜀石兰线程
一直觉得多线程是学Java的一个分水岭，懂多线程才算入门。之前看《编程思想》的多线程章节，看的云里雾里，知道线程类有哪几个方法，却依旧不知道线程到底是什么？书上都写线程是进程的模块，共享线程的资源，可是这跟多线程编程有毛线的关系，呜呜。。。线程其实也是用户自定义的任务，不要过多的强调线程的属性，而忽略了线程最基本的属性。你可以在线程类的run()方法中定义自己的任务，就跟正常的Ja
linux集群互相免登陆配置林鹤霄 linux
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mysql : Lock wait timeout exceeded; try restarting transaction aigo mysql
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Socket编程基本的聊天实现。 alleni123 socket
public class Server { //用来存储所有连接上来的客户 private List<ServerThread> clients; public static void main(String[] args) { Server s = new Server(); s.startServer(9988); } publi
多线程监听器事件模式(一个简单的例子) 百合不是茶线程监听模式
多线程的事件监听器模式监听器时间模式经常与多线程使用,在多线程中如何知道我的线程正在执行那什么内容,可以通过时间监听器模式得到创建多线程的事件监听器模式思路: 1, 创建线程并启动,在创建线程的位置设置一个标记 2,创建队
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spring的事务的TransactionTemplate，其源码如下： public class TransactionTemplate extends DefaultTransactionDefinition implements TransactionOperations, InitializingBean{ ... } TransactionTemplate继承了DefaultT
Oracle中询表的权限被授予给了哪些用户 bijian1013 oracle 数据库权限
Oracle查询表将权限赋给了哪些用户的SQL，以备查用。 select t.table_name as "表名", t.grantee as "被授权的属组", t.owner as "对象所在的属组"
【Struts2五】Struts2 参数传值 bit1129 struts2
Struts2中参数传值的3种情况 1.请求参数绑定到Action的实例字段上 2.Action将值传递到转发的视图上 3.Action将值传递到重定向的视图上一、请求参数绑定到Action的实例字段上以及Action将值传递到转发的视图上 Struts可以自动将请求URL中的请求参数或者表单提交的参数绑定到Action定义的实例字段上，绑定的规则使用ognl表达式语言
【Kafka十四】关于auto.offset.reset[Q/A] bit1129 kafka
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nginx gzip压缩配置 ronin47 nginx gzip 压缩范例
nginx gzip压缩配置更多 0 nginx gzip 配置随着nginx的发展，越来越多的网站使用nginx，因此nginx的优化变得越来越重要，今天我们来看看nginx的gzip压缩到底是怎么压缩的呢？ gzip(GNU-ZIP)是一种压缩技术。经过gzip压缩后页面大小可以变为原来的30%甚至更小，这样，用
java-13.输入一个单向链表，输出该链表中倒数第 k 个节点 bylijinnan java
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Spring源码学习-JdbcTemplate queryForObject bylijinnan java spring
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[冰川时代]在冰川时代,我们需要什么样的技术? comsci 技术
看美国那边的气候情况....我有个感觉...是不是要进入小冰期了? 那么在小冰期里面...我们的户外活动肯定会出现很多问题...在室内呆着的情况会非常多...怎么在室内呆着而不发闷...怎么用最低的电力保证室内的温度.....这都需要技术手段... &nb
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一、sh 脚本不执行的原因 sh脚本不执行的原因只有2个 1.权限不够 2.sh脚本里路径没写完整。二、解决You have new mail in /var/spool/mail/root 修改/usr/share/logwatch/default.conf/logwatch.conf配置文件 MailTo = MailFrom 三、查询连接数
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zookeeper windows 入门安装和测试 greemranqq zookeeper 安装分布式
一、序言以下是我对zookeeper 的一些理解： zookeeper 作为一个服务注册信息存储的管理工具，好吧，这样说得很抽象，我们举个“栗子”。栗子1号：假设我是一家KTV的老板，我同时拥有5家KTV，我肯定得时刻监视
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简单的说JDK是面向开发人员使用的SDK，它提供了Java的开发环境和运行环境。SDK是Software Development Kit 一般指软件开发包，可以包括函数库、编译程序等。 JDK就是Java Development Kit JRE是Java Runtime Enviroment是指Java的运行环境，是面向Java程序的使用者，而不是开发者。如果安装了JDK，会发同你
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关键字：Hive元数据、Hive元数据表结构之前在 “[一起学Hive]之一–Hive概述，Hive是什么”中介绍过，Hive自己维护了一套元数据，用户通过HQL查询时候，Hive首先需要结合元数据，将HQL翻译成MapReduce去执行。本文介绍一下Hive元数据中重要的一些表结构及用途，以Hive0.13为例。文章最后面，会以一个示例来全面了解一下，
Spring 3.2.14，4.1.7，4.2.RC2发布 wiselyman Spring 3
Spring 3.2.14、4.1.7及4.2.RC2于6月30日发布。其中Spring 3.2.1是一个维护版本(维护周期到2016-12-31截止)，后续会继续根据需求和bug发布维护版本。此时，Spring官方强烈建议升级Spring框架至4.1.7 或者将要发布的4.2 。其中Spring 4.1.7主要包含这些更新内容。

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