RISCV

Risc-V学习日记04

=target[生成的可执行文件不在主机上运行]x86_64-linux-gnu-gcc-9riscv64unknown-elf-gcca.out[在riscv64linux上运行]调试器GDB:TheGNU

YH-MRyrz·2025-04-03 13:30

RISC-V ISA Simulator系列之fesvr＜5＞

深入解析FESVR（Front-EndServer）url:https://github.com/riscv/riscv-isa-sim.gitcommid:fcbdbe7946079650d0e656fa3d353e3f652d471f

CDerL·2025-04-02 07:33

RISC-V ISA Simulator系列之fesvr＜3＞

深入解析FESVR（Front-EndServer）url:https://github.com/riscv/riscv-isa-sim.gitcommid:fcbdbe7946079650d0e656fa3d353e3f652d471f

CDerL·2025-04-02 07:03

RISC-V ISA Simulator系列之fesvr＜1＞

深入解析FESVR（Front-EndServer）url:https://github.com/riscv/riscv-isa-sim.gitcommid:fcbdbe7946079650d0e656fa3d353e3f652d471f

CDerL·2025-03-31 07:47

在Ubuntu 22.04上安装RISCV工具链时出错

报错信息：../fesvr/dtm.cc:505:14:error:‘runtime_error’isnotamemberof‘std’解决方法：在/fesvr/dtm.cc中添加头文件即可解决问题，该问题还会出现在device.h等其他文件中，操作一样。#include

oppenyes·2025-03-30 21:40

core-v-verif系列之cva6 verilator Model编译

5966/directed_testsWed,19Mar202511:18:28DEBUGWed,19Mar202511:18:28INFOCompilingtest:/cva6/verif/tests/riscv-arch-test

CDerL·2025-03-25 03:03

core-v-verif系列之cva6 cva6.py执行示例(1)

执行命令bashverif/regress/dv-riscv-arch-test.shbashverif/regress/dv-riscv-arch-test.sh备注，这里我们设置了环境变量exportRISCV

CDerL·2025-03-24 22:55

riscv linux 汇编,RISC-V汇编快速入门

当今，强大的编译器将C或者更高级的语言编译成机器码后，其效能损失已经很小了，再加上芯片的性能越来越强，让汇编语言显得可有可无。但对于嵌入式来说至少在下面两种情况还需要汇编：1是启动代码，2是OS的上下文切换。另外在极端情况下使用汇编提高效率也是有必要的，例如芯片内核非常新编译器优化不够好可以在非常清楚CPU的微结构下进行指令集编码提高性能。因此学习一种新的体系结构，了解其汇编语言是非常有必要的。实

勤小墨·2025-03-19 16:11

RISC-V指令集架构的形式语义——基于Haskell的实现

RISC-V指令集架构的形式语义——基于Haskell的实现riscv-semanticsAformalsemanticsoftheRISC-VISAinHaskell项目地址:https://gitcode.com

富珂祯·2025-03-17 04:06

RISC-V汇编学习（二）—— 汇编语法

RISCV汇编学习系列：RISC-V汇编学习（一）——基础认识RISC-V汇编学习（二）——汇编语法RISC-V汇编学习（三）——RV指令集RISC-V汇编学习（四）——R

禾仔仔·2025-03-15 14:28

RISC-V架构测试项目教程

RISC-V架构测试项目教程riscv-arch-test项目地址:https://gitcode.com/gh_mirrors/ri/riscv-arch-test项目介绍RISC-V架构测试项目（riscv-arch-test

卢颜娜·2025-03-13 16:00

RISC-V ISA 模拟器Spike安装与使用指南

RISC-VISA模拟器Spike安装与使用指南riscv-isa-simSpike,aRISC-VISASimulator项目地址:https://gitcode.com/gh_mirrors/ri/

郝赢泉·2025-03-10 06:12

riscv运行linux,首款基于RISC-V，支持Linux的PC——HiFive Unleashed已诞生！

对于常在开源硬件界混的小伙伴，相信对市面上的一些单板计算机都不陌生，什么树莓派、香蕉派、BeagleBoneBlack、UpBoard等等，这些大多数都是采用ARMCoretx-A系列应用处理器或者更高端一些会采用x86系列处理器，无论性能或是功能都基本上可以满足现在小伙伴的需求。但是，不觉得少了点什么吗？整个被ARM围绕的世界是如此单一，我们就没有更好或者更别具一格的选择了吗？有！HiFiveU

扎伊德·2025-02-23 21:54

一文了解riscv软件系列之linux内核编译运行

Linux加油站·2025-02-23 21:19

RISC-V 快速中断控制器（CLIC）项目常见问题解决方案

RISC-V快速中断控制器（CLIC）项目常见问题解决方案riscv-fast-interruptProposalforaRISC-VCore-LocalInterruptController(CLIC

gitblog_00881·2025-02-23 21:18

M1 Mac双系统搭建qemu riscv linux仿真

前言实验需要riscv仿真，网上没有针对m1的配置教程，故在此整理下。本人用的m1macbookpro，系统12.3。

灰灰h·2025-02-18 13:28

Run-On-Arch GitHub Action：跨架构CI/CD的利器

run-on-arch-actionAGithubActionthatexecutesjobs/commandsonnon-x86cpuarchitectures(ARMv6,ARMv7,aarch64,s390x,ppc64le,riscv64

怀创宪·2025-02-17 02:49

RISCV AIA (一)

概述riscvAIAspecv1.0包含如下三个方面：a、卷二riscv特权架构规范的扩展，b、两种标准的中断控制器---APLIC和IMSIC，c、对与中断相关的其他系统的要求。

啊节奏不对·2025-02-06 19:03

MIT-6.s081-OS lab cow: Copy-on-Write Fork for xv6

代码：https://github.com/RedemptionC/xv6-riscv-6s081/tree/cow本实验仍然是虚拟内存，所以暂且跳过了中间的内容（指lec和课本）分析copyonwritefork

RedemptionC·2025-02-04 01:25

Docker Ubuntu 20.04执行CI任务交叉编译riscv64-linux-gcc时no such file or directory

第一次接触rsicv64的交叉编译环境（其他交叉编译环境也基本没接触过，只是知道概念和原理），目前的需求是需要在gitlab上给一套rsicv64-linux-gcc执行CI任务，默认直接在本地服务器执行交叉编译，需要经常清理服务器文件，且成熟的开发环境不适合作为测试环境来运行，因此考虑将CI任务直接在Docker中执行，也需要配置最小化且测试环境最干净的Docker镜像。手工在服务器执行，全套流

Wentao Wu·2025-02-03 04:38

一键教会OpenHarmony-4.1-Release的small系统的rootfs制作过程

itopen组织1、提供OpenHarmony优雅实用的小工具2、手把手适配riscv+qemu+linux的三方库移植3、未来计划riscv+qemu+ohos的三方库移植+小程序开发4、一切拥抱开源

wenfei11471·2024-09-06 19:54

【RISC-V 指令集】RISC-V 向量V扩展指令集介绍(八)- 向量整数算术指令

1.引言以下是《riscv-v-spec-1.0.pdf》文档的关键内容：这是一份关于向量扩展的详细技术文档，内容覆盖了向量指令集的多个关键方面，如向量寄存器状态映射、向量指令格式、向量加载和存储操作、

瑶光守护者·2024-08-25 17:31

探索RISC-V架构测试：一个开源的硬件验证工具链

探索RISC-V架构测试：一个开源的硬件验证工具链riscv-arch-test项目地址:https://gitcode.com/gh_mirrors/ri/riscv-arch-test在软件开发领域

钟洁祺·2024-08-23 07:05

riscv简单常用汇编指令xv6

文章目录前言entry.Smretasmvolatilereadcsrwritecsrriscv常见csr寄存器ecall,系统调用指令cpu执行异常处理指令的三种事件异常处理相关寄存器用户态trapsret指令页表切换操作用户态系统调用过程总结内核态trap缺页异常中断与设备驱动Locking调度文件系统操作系统拥有的资源xv6系统启动过程1.准备C代码执行环境2.进入mainchar*argv

耶耶耶耶耶~·2024-08-22 13:46

[嵌入式系统-29]：开源的虚拟机监视器和仿真器：Windows环境下安装QEMU（Quick EMUlator）

windowsqemu的安装包下载步骤2：安装1.选择语言默认英文2.安装开始，选择Next3.安装选项，这里可以通过打开Systememulation中的下落项选择需要模拟的系统x86_64，arm，riscv64

文火冰糖的硅基工坊·2024-02-19 19:14

SP1：基于Plonky3构建的zkVM

SP1zkVM基于的指令集为：riscv32im（与RISCZero的指令集一样）在SP1zkVM中运行某程序之前，需将该程序

mutourend·2024-02-19 13:09

RSIC-V

RISC-V环境搭建riscv-gnu-toolchain一、编译安装riscv-gnu-toolchain方式一、手动编译安装1、Cloneriscv-toolchain2、安装相关依赖库3、创建riscv

h~k~f·2024-02-15 06:09

NJU PA2思路(riscv32)

运行NEMU后，当键入c或si时的原理是一样的，都是调用cpu_exec(n)，执行n条指令，n是一个无符号整数，传入-1的话变成无符号整数的最大值，可视为把指令不停地执行下去无停顿，否则执行完n条指令后程序会回到sdb_mainloop中等待下一条用户的sdb命令。这段代码是cpu_exec函数的实现，下面是对其功能的详细说明：首先，根据传入的参数n和预定义的MAX_INST_TO_PRINT比

idMiFeng·2024-02-07 19:17

NJU PA3思路(riscv32)

异常响应机制(riscv32架构)riscv32提供ecall指令作为自陷指令,并提供一个mtvec寄存器来存放异常入口地址.为了保存程序当前的状态,riscv32提供了一些特殊的系统寄存器,叫控制状态寄存器

idMiFeng·2024-02-07 19:17

QEMU&KVM 虚拟机实例demo以及RISCV上KVM的实现分析

KVM（KernelVirtualMachine)是基于Linux内核的开源的虚拟化解决方案，KVM从linux-2.6.20版本开始被合入kernel主分支维护，成为linux的重要模块之一。KVM本身能够提供CPU虚拟化和内存虚拟化等部分功能，而其它设备的虚拟化和虚拟机的管理工作，则需要依靠QEMU完成，在KVM虚拟化环境中，一个虚拟机就是一个传统的Linux进程，运行在Qemu-KVM进程的

papaofdoudou·2024-02-05 18:35

ch32vxx模仿stm32位带操作

stm32系列中内核为cm3的芯片支持位带操作，国产芯片模仿stm32规格的很多（c8t6现实标准），最近买了块沁恒的ch32v103r8t6板子，ch32vxx系列是riscv内核的，不支持位带操作，

飙风者·2024-02-03 19:41

Difftest踩坑笔记(一)

最著名的模拟器当属Qemu，此外伯克利也提供了针对riscv的模拟器spike，但两者的实现都比较复杂，中科院采用了南大

icfg66·2024-02-01 19:34

Gem5 O3 可视化

/build/RISCV/gem5.opt--debug-flags=O3PipeView--debug-start=78000--debug-file=trace.outconfigs/example

icfg66·2024-02-01 19:34

RISC-V架构常见gcc编译选项（-march、-mabi=、-mcmodel、-mlittle-endian、-mbig-endian）

1、-march=RISCV_ARCH用于告诉编译器目标芯片的架构情况，生成对应的二进制代码比如：-march=rv32imrv32：告诉编译器生成的代码实在RISC-V架构的32位芯片上运行，就不会使用

正在起飞的蜗牛·2024-01-31 21:08

alios things开发板_AliOS-Things: AliOS Things AliOS家族旗下面向IoT领域的轻量级物联网嵌入式操作系统AliOS Things将致力于搭建云端一体化IoT基...

AliOS家族旗下的、面向IoT领域的、高可伸缩的物联网操作系统，于2017年10月20号宣布在github上开源.架构总览AliOSThings支持多种CPU架构，包括：ARM，C-Sky，MIPS，RISCV

小仙元·2024-01-29 18:48

物联网操作系统AliOS Things之连接能力

AliOSThings支持多种CPU架构，包括：ARM，C-Sky，MIPS，RISCV等，下图是AliOSThings的系统框架图，架构图中跟网络连接相关的模块有网络组件、蓝牙组件、连接协议族。

LinkEverything·2024-01-29 18:12

RISC-V 的MMU

以rv64为例riscv64的MMU为code增加了一个新概念:虚拟地址,在这个概念之上,加了很多限制目前好像是无法在物理地址上直接加限制的//MPU就是这样子的,但是颗粒度大相关的限制size:有效位数

__pop_·2024-01-26 14:33

RISC-V 常用汇编指令

程序DNA·2024-01-26 14:33

11 Ubuntu | 省时省事| riscv-gnu-toolchain工具链安装|无需编译

入门RISC-V，当然需要安装RISCV的工具链，目前大多数教程都是编译安装的，这很难顶。

早上真好·2024-01-26 07:14

清华大学操作系统rCore实验-第一章-应用程序与基本执行环境

清华大学操作系统实验—rCore—应用程序与基本执行环境零、前言一、创建新项目neos二、配置执行环境1、切换riscv目标平台2、移除标准库std依赖（1）切换Rust核心库-core（2）注释println

Dr.Neos·2024-01-25 19:28

ubuntu-base（arm64与riscv64）根文件系统

ubuntu-base（arm64与riscv64）根文件系统有个小需求，是在arm64和riscv64上都跑起来speccpu2017首先在Qemu上跑起来，需要考虑需要的【Linux内核、根文件系统

京雨·2024-01-25 03:13

获取编译工具链默认的链接脚本

1、ld命令使用“–verbose”参数命令：riscv64-linux-gnu-ld--verbose想使用自己的链接脚本，链接时使用“-T”指定

正在起飞的蜗牛·2024-01-25 02:36

Ubuntu22.04安装riscv64-toolchain和QEMU

riscv64-toolchain环境搭建安装跨平台工具提供跨平台编译的各种库sudoaptinstalllibc6-riscv64-cross适用于GNU/Linux的linux-gnu-toolchain

9174583·2024-01-25 00:33

基于Ubuntu Base构建根文件系统

1.什么是UbuntuBaseUbuntu针对不同的CPU架构提供相应的ubuntubase根文件系统，目前提供的架构有amd64、arm64、armhf、i386、s390x、ppc64el、riscv642

牛角上的男孩·2024-01-24 13:47

Qemu 启动 Linux（aarch64 与 riscv64）

Qemu启动Linux（aarch64与riscv64）我的平台架构为x86_64，操作系统为Ubuntu22.04.3这部分涉及内核的编译以及文件系统的制作本博客中涉及了aarch64以及riscv64

京雨·2024-01-23 11:51

汇编语言学习1

CompilerExplorer(godbolt.org)这个网站可以把我们写的C语言等实时翻译为汇编等语言，便于参考一个不错的视频讲解riscv(RISC-V)指令集(MIT)A01Introduction

aaajj·2024-01-22 12:26

构建 aarch64 以及 riscv64 交叉编译工具链（裸机）

构建aarch64以及riscv64交叉编译工具链（裸机）因为我的需求是构建裸机的程序，所以我选择了裸机相关的交叉工具链其他工具链也类似，在给出的两个官方链接中提供了所有的交叉工具链，选择合适的工具构建即可一

京雨·2024-01-18 07:00

RISCV架构单周期CPU设计

指令选取R类型指令31-2524-2020-1915-1411-76-0funct7rs2rs1funct3rdopcode编号指令名称1addrd,rs1,rs2加2andrd,rs1,rs2与3orrd,rs1,rs2取或4xorrd,rs1,rs2异或5srlrd,rs1,rs2逻辑右移6sllrd,rs1,rs2逻辑左移7sltrd,rs1,rs2小于则置位8slturd,rs1,rs2无

大树D·2024-01-14 12:00

T40 T40N T40XP T40A 北京君正摄像头主控芯片

T40君正T40是一款4K视频和AI视觉应用处理器，T40采用了双核XBurst2及增强RISCV协处理器，启动速度、性能、功耗、首帧效果上进一步提升。

电子元器件专业户·2024-01-09 18:39

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R128S2是全志提供的一款M33(ARM)+C906(RISCV-64)+HIFI5(Xtensa)三核异构SoC，同时芯片内部SIP有1MSRAM、8MLSPSRAM、8MHSPSRAM以及16MNORFLASH

DOT小文哥·2024-01-07 15:17

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