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Fpga
Chipyard BOOM环境搭建
ChipyardBOOM环境搭建安装流程安装依赖下载chipyard并配置BOOM使用BOOM进行Dhrystone测试：使用BOOM核仿真自己编写的C程序移植到
FPGA
上Linux综合生成SmallBOOMConfig
diamond_biu
·
2023-11-30 07:58
硬件基础
Spectre
and
Meltdown
ubuntu
risc-v
FPGA
学习笔记五：Moore状态机与Mealy状态机的区别（基于Verilog）
目录前言一、状态机及其描述二、Moore状态机和Mealy状态机设计对象描述及其原理（一）Moore状态机（二）Mealy状态机总结前言本篇博客主要基于一些状态机书写的规范以及其构成结构進行相应的简单分析，同时依据HDLBits中两道典型的题目（HDLBits第139题：简单Moore状态机的实现和HDLBits第140题：简单Mealy状态机的实现）分析两種状态机的异同和电路描述特点。一、状态机
STI浅结隔離
·
2023-11-30 04:00
HDLBits题目
有限状态机
verilog
fpga
moore状态机
mealy状态机
计算机组成原理--TPU
算是读书笔记吧极客时间--深入浅出计算机组成原理现场可编程门阵列--
FPGA
（Field-ProgrammableGateArray）
FPGA
本质上是一个可以通过编程，来控制硬件电路的芯片。
kirito_song
·
2023-11-29 17:38
【Intel
FPGA
】D5005 使用笔记
项目总目标，在AFU中实现xx算法+DDR1.
FPGA
device：1SX280HN2F43E2VG2.硬件架构图3.DDR信息4.FIM（FPAGInterfaceManager）TheFIMcontainsthe
FPGA
logictosupporttheaccelerators
茶茶酱和FPGA
·
2023-11-29 16:53
fpga开发
基于
FPGA
的五子棋游戏设计
基于
FPGA
的五子棋游戏设计本文基于
FPGA
设计五子棋游戏，使用按键输入，使用VGA接口输出。五子棋的棋具与围棋相同，棋子分为黑白两色，棋盘为10×10，棋子放置于棋盘线交叉点上。
LEEE@FPGA
·
2023-11-29 16:15
FPGA开发项目
fpga开发
游戏
DDR-MIG 学习记录
MIG调试总结：对vivado软件中用于控制DDR2/DDR3的控制器MIG(MemoryInterfaceGenerator)IP核进行了仿真测试，以学习如何用IP核来控制
FPGA
板载SDRAM的读写
little ur baby
·
2023-11-29 16:25
fpga开发
笔记-PC端wireshark采集
FPGA
数据的操作
wireshark采集
FPGA
的数据目录一、准备工作二、操作步骤一、准备工作1、软件：wireshark2、平台：PC（本人是win11）、带有以太网功能的zynq平台3、网线:用网线连接zynq板子和
彭飞万里
·
2023-11-29 16:20
fpga开发
笔记
wireshark
FPGA
万花筒之(七)：
FPGA
实现神经网络加速的Hello World
姓名：张俸玺学号：20012100022学院：竹园三号书院转自https://blog.csdn.net/weixin_38712697/article/details/82818683【嵌牛导读】
FPGA
张俸玺20012100022
·
2023-11-29 13:18
C2--Vivado开发环境之bit生成，文件组成，代码固化2022-12-08
1.
FPGA
的开发流程
Fpga
代码的开发分为以下流程：设计定义（处于架构阶段，对需求进行定义，分析，模块划分）设计输入（verilogRTL代码输入、原理图）功能仿真分析和综合（由源文件综合编译runsynthesis
晓晓暮雨潇潇
·
2023-11-29 11:42
FPGA积累——基础篇
fpga开发
vivado
xilinx
FPGA
Verilog实现JK触发器 再实现模12加法计数器
JK触发器，无法仿真，代码如下，按照老师PPT写的`timescale1ns/1psmoduleJKtrigger(Q,CLK,RESET,SET,J,K);inputCLK,RESET,SET,J,K;outputQ;regQ;always@(posedgeCLKornegedgeRESETornegedgeSET)begin//异步复位与置位触发器的复位和置位与时钟信号无关//按照逻辑表达式写
Sharninjak
·
2023-11-29 10:23
FPGA
fpga开发
（91）Verilog实现D触发器
（91）Verilog实现D触发器1.1目录1）目录2）
FPGA
简介3）VerilogHDL简介4）Verilog实现D触发器5）结语1.2
FPGA
简介
FPGA
（FieldProgrammableGateArray
宁静致远dream
·
2023-11-29 10:19
fpga开发
Xilinx Zynq-7000系列
FPGA
多路视频处理：图像缩放+视频拼接显示，提供工程源码和技术支持
目录1、前言免责声明2、相关方案推荐
FPGA
图像处理方案
FPGA
图像缩放方案
FPGA
视频拼接叠加融合方案推荐3、设计思路详解HLS图像缩放介绍VideoMixer介绍4、vivado工程介绍PL端
FPGA
9527华安
·
2023-11-29 05:45
菜鸟FPGA图像处理专题
FPGA视频拼接叠加融合
FPGA图像缩放
fpga开发
音视频
Xilinx
Zynq
图像缩放
视频拼接
【
FPGA
】八、UART串口通信
文章目录前言一、UART简介1、基本概念2、UART协议3、波特率简介二、UART串口回环实验1、设计思路2、程序代码①串口接收模块②串口发送模块③串口顶层模块④串口仿真模块3、仿真验证总结前言在我们进行
FPGA
卡夫卡与海
·
2023-11-29 00:26
FPGA基础
人工智能
fpga开发
菜鸟学
FPGA
本菜鸟今天开始学习
FPGA
，每天分享学习进程。
z15190486824
·
2023-11-29 00:26
fpga开发
学习
SPI通讯
0.Intro本仓库实现两种基于SPI的
FPGA
与MCU通讯方式：类SRAM接口与指令解析。不论哪种方式，MCU都是通过修改
FPGA
内部一些控制寄存器的值实现对
FPGA
硬件的控制。
凉风有诗意
·
2023-11-29 00:56
嵌入式硬件
FPGA
学习路线by老石谈芯
入行十年，我总结了这份
FPGA
学习路线：搞定这四点，你也能轻松进阶（老石谈芯）.摘要
FPGA
学习路线(一）编程语言1硬件描述语言HDL2寄存器输入集语言RTL2.1如何入门2.2最大的思维转变3推荐转向学习
班花i
·
2023-11-29 00:56
FPGA
fpga
FPGA
记录系列（二）：Verilog中的参数传递和不同的调用子模块写法
文章目录项目场景：Verilog代码截图：Verilog代码分析：项目场景： 阅读了一下systemgenerator生成的源代码，一开始对testbench中的调用模块的方式不是很理解，后来发现其实这就是Verilog中的参数传递，特此记录。Verilog代码截图： Verilog调用函数的代码如下图所示： Tips：可以直接把vivado的编辑界面转到vscode里面，具体位置在Tool
yufan_fw
·
2023-11-29 00:25
FPGA与嵌入式
fpga开发
FPGA
学习路线整理
FPGA
学习路线整理收集整理
FPGA
资料帮助大家进行
FPGA
的入门，分享
FPGA
路线、相关的书籍、学习网站等。
YprgDay
·
2023-11-29 00:25
FPGA
fpga开发
学习
FPGA
学习之串口篇
FPGA
学习之串口篇文章目录
FPGA
学习之串口篇前言二、UART发送代码三、UART接收代码三、总结前言 UART（UniversalAsynchronousReceiver/Transmitter）
IC小白'
·
2023-11-29 00:55
fpga开发
Vivado IP核解锁
Vivado工程中有IP核被锁住的情况，主要原因有用新版本的Vivado去打开旧版本的工程、Vivado工程导入IP核的原工程和当前工程的
FPGA
开发板不一致等。
Yaellll
·
2023-11-29 00:54
Vivado
fpga开发
FPGA
开发基础篇之一（接口篇）UART串口
写在前面从本文开始，将连载
fpga
开发基础知识，将这几年浅显的
fpga
开发经验整理出来，一是梳理一下这几年给别人做
fpga
的经历，同时也是分享给大家，也希望大牛批评指正。
mayidianzi
·
2023-11-29 00:54
FPGA开发基础篇
接口篇
fpga开发
FPGA
实现UART串口通信流程及代码实现
FPGA
（Field-ProgrammableGateArray）是一种可编程逻辑器件，用于实现数字电路的硬件加速和高性能计算。串口通信是一种常见的通信方式，可以用于在
FPGA
和其他设备之间传输数据。
qq_46475176
·
2023-11-29 00:22
学习资料分享
fpga开发
开发语言
学习使用Vivado和SDK进行Xilinx ZYNQ
FPGA
开发 | （四）安装并破解Modelsim | 2023.8.10/星期四/天气晴
系列文章目录学习使用Vivado和SDK进行XilinxZYNQ
FPGA
开发|（一）开始学习使用Vivado和SDK进行XilinxZYNQ
FPGA
开发|（二）学习方法选择学习使用Vivado和SDK进行
杨肉师傅
·
2023-11-29 00:21
学习Xilinx
ZYNQ
FPGA开发
学习
fpga开发
FPGA
-串口通信
串口通信概念UART通信原理UART(universalasynchronousreceiver-transmitter）是一种采用异步串行通信方式的通用异步收发传输器;它在发送数据时将并行数据转换成串行数据来传输,在接收数据时将接收到的串行数据转换成并行数据。UART串口通信需要两根信号线来实现，一根用于发送，另外一根接收（表明是异步全双工通信）。①协议层:通信协议(包括数据格式、传输速率等)。
学习云玩家
·
2023-11-29 00:21
fpga开发
学习使用Vivado和SDK进行Xilinx ZYNQ
FPGA
开发 | （三）安装并破解Vivado和SDK | 2023.8.9/星期三/天气晴
系列文章目录学习使用Vivado和SDK进行XilinxZYNQ
FPGA
开发|（一）开始学习使用Vivado和SDK进行XilinxZYNQ
FPGA
开发|（二）学习方法选择学习使用Vivado和SDK进行
杨肉师傅
·
2023-11-29 00:51
学习Xilinx
ZYNQ
FPGA开发
学习
fpga开发
电子类专业技术个人学习路线总结（大一到大三）
文章目录说明一、硬件和pcb部分1.AltiumDesigner2.嘉立创EDA3.CadenceAllegro4.电路设计二、单片机和
FPGA
部分1.arduino系列单片机2.51系列单片机3.stm32
Expert电子实验室
·
2023-11-29 00:48
学习
单片机
嵌入式硬件
FPGA
学习入门计划-小白入门
1.入门学习计划-再学习
FPGA
之前，先确定我们需要学习什么1.编程语言，
FPGA
的开发语言叫做硬件描述语言HDL，或者是寄存器传输级语言RTL，主流的硬件描述语言有VHDL和Verilog，SystemVerilog
一口闷一罐可乐
·
2023-11-29 00:47
fpga开发
学习
Verilog：动态位宽 rom [4+:3]
**升序**，则vect_1[4+:3]=vect_1[6:4]vect_1[4-:3]表示，起始位为4，宽度为3，**降序**，则vect_1[4-:3]=vect_1[4:2]用途：将网络参数放入
FPGA
崽崽今天要早睡
·
2023-11-29 00:16
#
▶Verilog语法
fpga开发
FPGA
：实现快速傅里叶变换（FFT）算法
前言第一次使用
FPGA
实现一个算法，搓手手，于是我拿出一股势在必得的心情打开了FFT的视频教程，看了好几个视频和好些篇博客，于是我迷失在数学公式推导中，在一位前辈的建议下，我开始转换我的思维，从科研心态转变为先用起来
崽崽今天要早睡
·
2023-11-29 00:46
#
▶FPGA其他项目
fpga开发
算法
快速傅里叶变换
一些
FPGA
和vivado中的简写&词汇
记录一些学习
FPGA
和使用vivado时遇见的简写和词汇，方便自己查找。
普安克山图格
·
2023-11-29 00:39
FPGA学习小笔记
fpga开发
FPGA
基础协议一：UART
FPGA
基础协议一：UART文章目录
FPGA
基础协议一：UART一、UART协议1.UART协议2.UART通信原理二、需求与设计分析1.系统模块划分2.模块解析2.1uart_rx串口接收模块2.2uart_ctrl
财不外漏_
·
2023-11-29 00:39
FPGA
fpga开发
EDA实验-----正弦信号发生器的设计（Quartus II ）
二、实验仪器PC机EDA实验箱一台三、实验原理
FPGA
中的波形发生器控制电路，它通过外来控制
Gretel Tade
·
2023-11-29 00:06
EDA实验
fpga开发
EDA实验
Quartus
II
开发板
硬件
FPGA
入门 ——
FPGA
UART 串口通信
FPGA
入门——
FPGA
UART串口通信串口简介UART通用异步收发传输器(UniversalAsynchronousReceiver/Transmitter)，通常称作UART。
ppqppl
·
2023-11-29 00:36
fpga开发
FPGA
：我的零基础学习路线（2022秋招已上岸）持续更新中~
可内推简历，丝我即可前言初次接触
FPGA
是在2022年3月左右，正处在研二下学期，面临着暑假找工作，周围的同学大多选择了互联网，出于对互联网的裁员形势下，我选择了
FPGA
，对于硬件基础知识我几乎是没有的
崽崽今天要早睡
·
2023-11-29 00:35
#
▶FPGA相关的专业知识
fpga开发
学习
Vivado IP核被锁的解除方法
在使用vivado进行开发时，我们经常会用到别人的工程，如果我们更改工程所使用的芯片型号（Vivado工程导入IP核的原工程和当前工程的
FPGA
开发板不一致），或者别人的工程所用到的vivado版本与我们不一致时
普安克山图格
·
2023-11-29 00:34
FPGA学习小笔记
fpga开发
FPGA
模块使用Verilog调用另一个Verilog模块
FPGA
模块使用Verilog调用另一个Verilog模块在
FPGA
设计中，常常需要将一个大的模块分解成多个子模块来实现。而这些子模块通常由Verilog代码编写而成。
CodeWG
·
2023-11-29 00:34
fpga开发
matlab
【MATLAB教程案例96】基于GA优化的WSN最大覆盖率和最少节点部署数量matlab仿真
欢迎订阅《
FPGA
学习入门100例教程》、《MATLAB学习入门100例教程》本课程学习成果预览：1.软件版本matlab2021a2.理论概述基于遗传算法（GeneticAlgorithm,GA）的无线传感器网络
fpga和matlab
·
2023-11-28 16:10
matlab
matlab教程
matlab入门案例
最少节点数
最大覆盖率
【MATLAB教程案例78】基于GA优化的WSN最大覆盖率matlab仿真——扩展到任意一种优化算法解决WSN覆盖率问题
欢迎订阅《
FPGA
学习入门100例教程》、《MATLAB学习入门100例教程》本课程学习成果预览：目录1.软件版本2.WSN网络覆盖率的优化问题理论简介
fpga和matlab
·
2023-11-28 16:40
matlab
GA优化
WSN最大覆盖率
matlab教程
matlab入门案例
【MATLAB教程案例79】基于移动节点WSN的最短路由matlab仿真——应用于车组网或无人机组网等
欢迎订阅《
FPGA
学习入门100例教程》、《MATLAB学习入门100例教程》本课程学习成果预览：目录1.软件版本2.移动节点WSN理论简介
fpga和matlab
·
2023-11-28 16:40
matlab
matlab教程
matlab入门案例
移动节点
移动路由
【MATLAB教程案例77】WSN网络覆盖率问题与matlab仿真
欢迎订阅《
FPGA
学习入门100例教程》、《MATLAB学习入门100例教程》目录1.软件版本2.WSN网络覆盖率的理论简介3.WSN网络覆盖率的matlab
fpga和matlab
·
2023-11-28 16:40
matlab
WSN网络覆盖率
matlab教程
matlab入门案例
西南科技大学数字电子技术实验二（SSI逻辑器件设计组合逻辑电路及
FPGA
实现 ）预习报告
一、计算/设计过程说明：本实验是验证性实验，计算预测验证结果。是设计性实验一定要从系统指标计算出元件参数过程，越详细越好。用公式输入法完成相关公式内容，不得贴手写图片。（注意：从抽象公式直接得出结果，不得分，页数可根据内容调整）1、1位半加器真值表：逻辑方程：S=`AB+A`BC=AB2、1位全加器真值表：AiBiCi-1SiCi000000011101011011000101001001011
Myon⁶
·
2023-11-28 16:35
数电实验
fpga开发
数电实验
数字电子技术
西南科技大学
西南科技大学数字电子技术实验二（SSI逻辑器件设计组合逻辑电路及
FPGA
实现 ）
FPGA
部分
4、学会用
FPGA
实现本实验内容。
Myon⁶
·
2023-11-28 16:35
模电实验
fpga开发
数字电子技术
数电实验
西南科技大学
diamond
芯片巨头“打响”智能汽车之战，
FPGA
巨头赛灵思胜算几何？
汽车正在成为继手机之后的下一个智能终端，这也吸引了包括高通、英伟达、英特尔等各大芯片巨头的强势布局。现阶段，英伟达、Mobileye已经先后针对自动驾驶推出了高算力的主控芯片，并且已经在车企的新平台项目上占据了市场先机。今年4月，英伟达再次公布了下一代自动驾驶芯片：DRIVEAtlan，单颗芯片的算力达到了1000TOPS，将用于L4及L5级别自动驾驶系统当中。而高通作为手机通信芯片巨头，过去几年
高工智能汽车
·
2023-11-28 15:07
Hobbit玩转Zynq MPSoC系列之1：VCU解码+DP显示
做图像处理的朋友们经常会有视频编解码的需求，常用的方法是要么增加一个专有芯片要么买专用的
FPGA
实现的IP，这都增加了设计复杂度以及成本，ZynqMPSoC的EV系列含有VCU视频编解码单元，就非常好的解决了这个问题
Humph-Hobbit
·
2023-11-28 07:59
Zynq
MPSoC
嵌入式
fpga
【读书】基于
FPGA
的数字信号处理 [高亚军 编著]
基于
FPGA
的数字信号处理[高亚军编著]第一章现场可编程门阵列技术分析1.1
FPGA
内部结构分析1.2
FPGA
设计流程分析1.3
FPGA
调试方法分析文章目录基于
FPGA
的数字信号处理[高亚军编著]前言1.1
FPGA
你的信号里没有噪声
·
2023-11-28 07:23
Xilinx
FPGA
带你看文档提升技术
fpga开发
信号处理
Power Estimation Using XPE Power Estimation Using XPE使用XPE进行功率估计
跟着Xilinx学习
FPGA
——PowerEstimationUsingXPEPowerEstimationUsingXPE使用XPE进行功率估计目标：使用XilinxpowerEstimator(XPE
你的信号里没有噪声
·
2023-11-28 07:53
Xilinx
FPGA小Tips
FPGA
fpga开发
Zynq和
FPGA
区别——快速认识Zynq开发
Zynq和
FPGA
区别——快速认识Zynq开发ZYNQ包含了2个部分，双核的ARM和
FPGA
。根据Xilinx提供的手册，用ARM实现的模块被称为PS，而用
FPGA
实现的模块被称为PL。
你的信号里没有噪声
·
2023-11-28 07:52
fpga开发
浅谈：“阻塞”与“非阻塞”两种赋值语句
FPGA
成长的小Tips之赋值语句深刻理解HDL的阻塞赋值和非阻塞赋值，就一定首先需要理解C语言的阻塞和非阻塞。
你的信号里没有噪声
·
2023-11-28 07:22
FPGA
FPGA小Tips
FPGA
面试
fpga开发
FPGA
中的防止扇出优化——max_fanout命令
vivado自带很多命令帮助编译器更好的实现设计者的想法，用得好会变成开发利器。比如，max_fanout命令，本身是用来约束扇出，减少布线拥塞的常用命令。然而很多读者向我反映，使用这个命令之后发现没有任何事情发生，完全没有任何效果。这里我就带大家理一理这个命令的使用方法。max_fanout起作用的条件打算降低扇出的网络必须是reg驱动。因为降低扇出的原理就是reg驱动超过N（设置参数）条网络的
你的信号里没有噪声
·
2023-11-28 07:22
FPGA小Tips
fpga开发
虹科干货 | 适用于基于
FPGA
的网络设备的IEEE 1588透明时钟架构
导读：在基于
FPGA
的网络设备中，精确的时间同步至关重要。IEEE1588标准定义的精确时间协议（PTP）为网络中的设备提供了纳秒级的时间同步。
虹科智能自动化
·
2023-11-28 07:44
fpga开发
工业通信
TSN时间敏感网络
透明时钟架构
IEEE
1588
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