Xilinx文档翻译

基于FPGA实现Aurora高速串行接口

）模块设计6）AuroraIP核简介7）AuroraIP核定制8）Aurora协议特点9）结束语1Aurora简介1）采用并行方式传输高速的数据流有很多设计难点，未来高速数据传输主要采用串行方式传输，Xilinx
宁静致远dream·2024-01-30 07:49

Xilinx ZYNQ7020密集访问内存出错

XilinxZYNQ7020密集访问内存出错问题问题描述：XilinxZYNQ7035和ZYNQ7020，没有跑linux系统，裸机和使用freertos如果频繁使用memset和memcpy会出现错误
觉皇嵌入式·2024-01-29 22:46

小牛翻译API接口的开通及JAVA调用实例演示

目录一、前言二、服务开通三、Java调用接口实例演示1.文本翻译1.代码展示2.术语文本翻译3.对照文本翻译4.注意事项2.文档翻译1.调用流程示意图2.官网Demo详情（示例只有上传并翻译流程的）3.
不吃榴莲千层·2024-01-29 17:56

Vivado中嵌入式逻辑分析仪ILA的使用（2）

FPGA综合出来的电路都在芯片内部，基本上是没法用示波器或者逻辑分析仪器去测量信号的，所以xilinx等厂家就发明了内置的逻辑分析仪。
Pilgrim2017·2024-01-29 15:16

FPGA逻辑资源评估之BRAM（以Xilinx为例）

在FPGA逻辑设计时，需要参考所需逻辑资源对FPGA进行选型，其中一项就是对BRAM的评估，在这里以xilinxUltraSCALE+系列FPGA为例，对BRAM进行简单介绍。
wkonghua·2024-01-29 13:38

Xilinx Vivado定制IP核调用和除法器IP核的latency和resource分析

加入定制的乘法IP核，必须在sources右键，用AddDirectories加入才完整加入文件夹后如下图：测试代码与主程序模块连接端口初学者容易出现错误输入端口：从模块内部来讲，输入端口必须为线网数据类型，从模块外部来看，输入端口可以连接到线网或者reg数据类型的变量。输出端口：从模块内部来讲，输出端口可以是线网或者reg数据类型，从模块外部来看，输出必须连接到线网类型的变量，而不能连接到reg
人工智能和FPGA AI技术·2024-01-29 13:07

Xilinx FPGA BRAM使用方法

BRAM使用方法在利用fpga进行数据处理的过程中，对高速数据采集或者传输的过程中，需要对数据尽心缓存，缓存一般有两种不同的方法，一种是FIFO，一种是RAM，FIFO在vivado中提供IP核，FIFO的缓存特性适用于先存先取得过程，没有寻址地址，数据只能按照次序读出，可以用于速率变换，位宽变换的应用中，数据的读写可以分开控制。RAM可以缓存数据，然后按照地址进行读出，这样不受顺序的限制，能够更
一支绝命钩·2024-01-29 13:36

FPGA | BRAM和DRAM

如Xilinx公司的结构中每个BRAM有36Kbit的容量，既可以作为一个36Kbit的存储器使用，也可以拆分为两个独立的18Kbit存储器使用。
初雪白了头·2024-01-29 13:35

Xilinx 7系列 BRAM概述

Xilinx7系列FPGA中的块RAM可存储36Kb的数据，可以配置为两个独立的18KbRAM或一个36KbRAM。
FPGA自学笔记分享·2024-01-29 13:34

[转]Bram和Dram的区别

2、bram有较大的存储空间，是fpga定制的ram资源；而dram是逻辑单元拼出来的，浪费LUT资源3、dram使用更灵活方便些补充：在XilinxAsynchronousFIFOCORE的使用时，有两种
ddk43521·2024-01-29 13:02

xilinx FPGA 除法器ip核（divider）的使用（VHDL&Vivado）

一、创建除法ip核vivado的除法器ip核有三种类型，跟ISE相比多了一个LuMult类型，总结来说就是LuMult：使用了DSP切片、块RAM和少量的FPGA逻辑原语（寄存器和lut），所以和Radix2相比占用fpga资源更少；可以选择有符号或者无符号类型数据；但是位数有限，只能用于运算量小的时候，被除数位宽：2~17，除数位宽：2~11；只能选择余数模式Radix2：使用FPGA逻辑原语（
坚持每天写程序·2024-01-29 13:58

doris安装文档翻译-标准部署(Standard deployment)

文档地址:对应1.2版本Standarddeployment-ApacheDorisThistopicisaboutthehardwareandsoftwareenvironmentneededtodeployDoris,therecommendeddeploymentmode,clusterscaling,andcommonproblemsoccurincreatingandrunningclu
zxfBdd·2024-01-29 06:11

MySQL存储过程学习笔记（基于8.0）

官方文档：https://dev.mysql.com/doc/refman/8.0/en/create-procedure.html目录MySQL存储过程语法（基于8.0）官方文档翻译DEFINER='
Louzen·2024-01-29 06:58

xilinx基础篇Ⅱ（2）vivado2017.4软件使用

1.打开软件，选择新建工程2.确认创建新工程3.选择创建工程名及路径4.选择创建工程类型，一般选择RTL5.选择FPGA芯片型号6.以下为工程概况，其中框中为选择的芯片型号，点击finish7.添加Xilinx
Roy-e·2024-01-29 02:00

ac3165 linux驱动_[干货]手把手教你用Zedboard学习Linux移植和驱动开发

重点介绍传统方式的Linux移植和Xilinx的Petalinux的快速移植开发两种。
weixin_39616090·2024-01-28 13:17

【FPGA】7系列 FPGA时钟资源及时钟IP核配置 Xilinx

7系列FPGA时钟资源及时钟IP核配置Xilinx7系列时钟资源1.分类全局时钟，区域时钟2.7系列时钟结构ClockBackbone：全局时钟线将芯片分成左右两个时钟区域；HorizontalCenter
原地打转的瑞哥·2024-01-28 05:23

ReactHooks 官网文档翻译

useCallback(fn,dependencies)useCallback是一个ReactHook，它允许您在重新渲染之间缓存函数定义。constcachedFn=useCallback(fn,dependencies)1、参数：fn：要缓存的函数值。它可以接受任何参数并返回任何值。React将在初始渲染期间返回（而不是调用！）您的函数。在下一次渲染中，如果自上次渲染以来依赖项没有更改，Rea
MissXu666·2024-01-28 01:59

基于xilinx的fifo IP核使用

一、FIFOIP核简介FIFO（FirstInFirstOut，即先入先出），是一种数据缓冲器，用来实现数据先入先出的读写方式。与ROM或RAM的按地址读写方式不同，FIFO的读写遵循“先进先出”的原则，即数据按顺序写入FIFO，先被写入的数据同样在读取的时候先被读出，所以FIFO存储器没有地址线。FIFO有一个写端口和一个读端口外部无需使用者控制地址，使用方便。FIFO存储器主要是作为缓存，应用
伊藤诚诚诚诚·2024-01-27 03:59

xilinx FIFO使用总结

XilinxFIFO使用总结FIFO是我们在FPGA开发中经常用到的模块，在数据缓存和跨时钟域同步等都会有涉及。在实际工程使用前，我们需要熟悉掌握FIFOIP的配置过程及时序特点。
wuzhirui志锐·2024-01-27 03:58

问题记录：关于xilinx不同模式的fifo计数器

平台：Vivado2018.3.芯片：xcku115-flva1517-2-i(active)最近在学习的过程中总结了关于xilinx的不同fifo的计数器。关于不同fifo的计数器表现的特征不一致。
爱漂流的易子·2024-01-27 03:26

Xilinx 7系列FPGA Multiboot介绍

Xilinx的双镜像方案成为Multiboot。本文
非鱼知乐·2024-01-26 18:10

risc-v 文档翻译: RVWMO Memory ConsistencyModel

前言多核处理器通过共享内存进行通信，如果内存操作乱序，相当于通信顺序乱序，而没有编写过多线程的程序员可能意识不到这一点，假设了通信是顺序执行的，这会对程序正确性产生影响。这部分在非特权级14章部分，目前版本为0.1，我们开始吧。总览本章定义了RISC-V内存一致性模型。内存一致性模型是一组规则，指定load内存返回的值。RISC-V使用一种称为“RVWMO”(RISC-V弱内存序)的内存模型，该模
lu_xi_xi·2024-01-26 14:02

英文文档翻译为中文

英文翻译阅读英文文章需要辅助阅读英文文章需要辅助Google文档翻译word自带翻译：审阅–>翻译（需要.docx为结尾）
createcrystal·2024-01-26 07:21

FPGA高端项目：Xilinx Artix7系列FPGA多路视频拼接 工程解决方案 提供4套工程源码和技术支持

目录1、前言版本更新说明给读者的一封信FPGA就业高端项目培训计划免责声明2、相关方案推荐我已有的FPGA视频拼接叠加融合方案本方案在XilinxKintex7系列FPGA上的应用3、设计思路框架视频源选择
9527华安·2024-01-26 07:17

FPGA高端项目：Xilinx Zynq7020系列FPGA多路视频拼接 工程解决方案 提供6套工程源码和技术支持

目录1、前言版本更新说明给读者的一封信FPGA就业高端项目培训计划免责声明2、相关方案推荐我已有的FPGA视频拼接叠加融合方案本方案在XilinxKintex7系列FPGA上的应用本方案在XilinxArtix7
9527华安·2024-01-26 07:42

Vivado官网下载

https://www.xilinx.com/support/download.html（需要注册一个AMD账号，之后即可免费下载）下载成功后开始安装：默认配置即可，50多G
圆喵喵Won·2024-01-26 00:11

Grafana官方文档翻译

欢迎来到Grafana文档Grafana是一个开源指标分析和可视化套件。它最常用于可视化基础设施和应用程序分析的时间序列数据，但许多应用于其他领域，包括工业传感器，家庭自动化，天气和过程控制。基本概念本文档是对Grafana中基本概念的“自下而上”介绍，可以用作开始熟悉核心功能的起点。数据源Grafana支持您的时间序列数据（数据源）的许多不同的存储后端。每个数据源都有一个特定的查询编辑器，该编辑
SkTj·2024-01-25 09:10

FPGA硬件架构

1.XilinxFPGA是异构计算平台（所谓异构，就是有很多不同的部分组成）：CLB,BRAM,DSP
燎原星火*·2024-01-25 07:22

Xamarin简介

Xamarin提供了使用C#完成iOS，Android和WindowsPhone三个移动平台开发的可能性Xamarin包括Xamarin.Andriod、Xamarin.IOS、Xamarin.Forms等官方文档翻译当考虑如何构建
Lulus·2024-01-24 19:50

数字信号处理-04- FPGA常用运算模块-除法器

写在前面本文是本系列的第四篇，本文主要介绍FPGA常用运算模块-除法器，xilinx提供了相关的IP以便于用户进行开发使用。
Vuko-wxh·2024-01-24 07:13

xilinx 除法ip核（divider） 不同模式结果和资源对比（VHDL&ISE）

1.Radix-2模式：基数-2使用整数操作数的非恢复整数除法，允许生成分数或整数余数。对于小于16位的操作数宽度或需要高吞吐量的应用程序，建议使用。基数-2非恢复算法使用加减法求解每个周期的一点商。该设计是完全流水线的，可以实现每个时钟周期一分的吞吐量。如果所需的吞吐量较小，则每个时钟参数的分法允许降低吞吐量和资源使用。该算法自然会生成一个余数，对于需要整数余数或模数结果的应用程序的选择也是如此
坚持每天写程序·2024-01-24 07:41

图像处理算法：白平衡、除法器、乘法器~笔记

参考：基于FPGA的自动白平衡算法的实现白平衡初探(qq.com)FPGA自动白平衡实现步骤详解-CSDN博客xilinx除法ip核（divider）不同模式结果和资源对比（VHDL&ISE）_ise除法器
NoNoUnknow·2024-01-24 07:00

Watch(监视器)+(综合案例)

Watch侦听器（监视器）作用：监视数据变化，执行一些业务逻辑或异步操作语法：①简单写法→简单类型数据，直接监视②完整写法→添加额外配置项①简单写法Document翻译成的语言：意大利英语德语文档翻译mealconstapp
W`hite·2024-01-24 06:06

14025.ZynqMP System Monitors 监控模块

参考xilinx手册ug1085,ug1087,ug580.2ZynqMpSystemMo
xhome516·2024-01-23 19:13

【惊喜揭秘】xilinx 7系列FPGA时钟区域内部结构大揭秘，让你轻松掌握！

  本文对xilinx7系列FPGA的时钟布线资源进行讲解，内容是对ug472手册的解读和总结，需要该手册的可以直接在xilinx官网获取，或者在公众号回复“xilinx手册”即可获取。
电路_fpga·2024-01-23 15:26

Xilinx FPGA 权威书籍指南 基于Vivado 2018 集成开发环境

数字系统设计教程_夏宇闻深入浅出玩转FPGA_吴厚航《深入浅出玩转FPGA》视频教程：35课时FPGA项目实例资料合集FPGA从入门到精通.实战篇数字逻辑基础与Verilog设计原书第3版,斯蒂芬·布朗XilinxFPGA
light6776·2024-01-23 13:41

rabbitmq官方文档翻译-12

备用exchange概览有时候希望让客户端处理交换机无法路由的消息（即，因为没有绑定队列我们没有匹配的绑定）。典型的例子是检测客户端何时意外或恶意发布无法路由的消息“或者”路由语义，其中一些消息是专门处理的，其余的是通用处理程序RabbitMQ的备用exchange（“AE”）功能解决了这些用例。如何定义备用Exchange对于任何给定的Exchange，客户端可以使用策略或Exchange的客户
wwq2020·2024-01-23 07:04

我的创作纪念日

目前市面上主流的FPGA图像缩放方案如下：1：Xilinx的HLS方案，该方案简单，易于实现，但只能用于Xilinx自家的FPGA；2：非纯Verilog方案，大部分代码使用Verilog实现，但中间的
攻城狮Wayne·2024-01-23 07:00

FPGA高端项目：Xilinx Zynq7020 系列FPGA纯verilog图像缩放工程解决方案 提供3套工程源码和技术支持

目录1、前言版本更新说明给读者的一封信FPGA就业高端项目培训计划免责声明2、相关方案推荐我这里已有的FPGA图像缩放方案本方案在XilinxKintex7系列FPGA上的应用本方案在XilinxArtix7
9527华安·2024-01-23 06:52

highlighting v5.0插件使用 一（持续更新）

根据官方文档翻译+理解+实践。1.简易使用方法1.1摄像机添加HighlightingRenderer；调整设置，以更改高亮显示的外观（粗细、强度）FillAlpha:更改填充封闭区域内的透明度。
love_c_s·2024-01-20 19:42

ZYNQ学习笔记-LINUX篇-字符设备驱动控制AXI-GPIO

ZYNQ学习笔记硬件平台：zynq-7000&xc7z100ffg900-2linux开发平台：ubuntu16.04.4LTSzynq-linux内核：linux-xlnx-xilinx-v2017.4LINUX
mlia·2024-01-20 15:30

FPGA高端项目：Xilinx Artix7 系列FPGA纯verilog图像缩放工程解决方案 提供4套工程源码和技术支持

目录1、前言版本更新说明给读者的一封信FPGA就业高端项目培训计划免责声明2、相关方案推荐我这里已有的FPGA图像缩放方案本方案在XilinxKintex7系列FPGA上的应用本方案在国产FPGA紫光同创系列上的应用本方案在国产
9527华安·2024-01-20 11:03

Unqlite Python文档翻译（二）

第一章安装你可以使用pip安装unqlite。pipinstallcythonunqlite这个项目的主页是https://github.com/coleifer/unqlite-python可以从以下的源被安装gitclonehttps://github.com/coleifer/unqlite-pythoncdunqlite-pythonpythonsetup.pybuildpythonset
564c562de7f5·2024-01-19 10:02

20-11版本AUTOSAR_PRS_LogAndTraceProtocol文档翻译

1简介和概述本协议规范规定了AUTOSAR协议Dlt的格式、消息序列和语义。该协议允许将诊断、日志和跟踪信息发送到通信总线上。因此，Dlt模块从应用程序或其他软件模块收集调试信息，向调试信息添加元数据，并将其发送到通信总线。此外，Dlt协议允许根据严重级别过滤调试信息，例如“致命”、“错误”或“信息”。此筛选器可以在运行时通过外部日志记录工具发送的Dlt控制消息进行修改。还可以直接向应用程序通知新
立夏陆之昂·2024-01-19 05:48

基于Xilinx的Kintex-7系列XC7K325T的硬件加速卡

产品型号:B-PCIE-K7F5XILINX的Kintex-7系列FPGA处理器B-PCIE-K7F5是一款基于PCIExpress总线架构的高性能FPGA算法加速卡，该板卡采用Xilinx的高性能28nm7
打怪升级ing·2024-01-18 21:07

光纤数据转发卡学习资料保存：基于Xilinx Kintex-7 XC7K325T 的FMC/千兆以太网/SATA/四路光纤数据转发卡

基于XilinxKintex-7XC7K325T的FMC/千兆以太网/SATA/四路光纤数据转发卡一.板卡概述本板卡基于Xilinx公司的FPGAXC7K325T-2FFG900芯片，pin_to_pin
hexiaoyan827·2024-01-18 21:35

基于Xilinx Kintex-7 FPGA K7 XC7K325T PCIeX8 四路光纤卡 光纤PCIe卡

基于XilinxKintex-7FPGAK7XC7K325TPCIeX8四路光纤卡一、板卡概述板卡主芯片采用Xilinx公司的XC7K325T-2FFG900FPGA，pin_to_pin兼容FPGAXC7K410T
hexiaoyan827·2024-01-18 21:35

基于Xilinx Kintex-7 FPGA K7 XC7K325T PCIeX8 四路光纤卡226

基于XilinxKintex-7FPGAK7XC7K325TPCIeX8四路光纤卡正在上传…重新上传取消一、板卡概述板卡主芯片采用Xilinx公司的XC7K325T-2FFG900FPGA，pin_to_pin
hexiaoyan827·2024-01-18 21:35

基于Xilinx K7-410T的高速DAC之AD9129开发笔记（一）

引言：从本文开始，我们介绍下项目中设计的并行LVDS高速DAC接口设计，包括DAC与FPGA硬件接口设计、软件设计等。项目设计高速DAC采用了ADI公司的AD9129，该芯片最大更新速率5.7Gsps，该芯片在宽带通信应用、LTE、雷达信号产生、干扰机等领域有广泛应用。1.AD9129概述AD9129是高性能14位RF数模转换器(DAC)，支持最高达2.85GSPS的数据速率。DAC内核基于一个四
FPGA技术实战·2024-01-18 21:34

数字信号处理（四）CIC IP核滤波器详解（一）

VivadoCICIP核滤波器详解（一）引言：从本文开始，我们详细介绍XilinxCICIP核滤波器相关知识，包括CICIP核提供的特性、IP核接口描述以及IP核设计指导等相关内容。
FPGA技术实战·2024-01-18 21:04
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