紫光同创FPGA开发笔记

【NI-RIO入门】理解Windows、Real Time与FPGA之间数据通信的原理

于NIkb摘录1.概述对于NIRIO系列设备（CompactRIO、sbRIO、myRIO等）进行编程时，需要注意有三个不同的组件。人机界面(HMI)。有时称为“主机”，为用户提供图形用户界面（GUI），用于监控系统状态和设置操作参数。使用HMI是可选的，因为RIO产品可以编程为无头运行，并且有些产品可以直接连接到嵌入式用户界面，但是当实施HMI时，它们可以采用Windows台式计算机、平板电脑或
東方神山·2023-12-22 19:01

【NI-RIO入门】使用其他文本语言开发CompactRIO

1.FPGA接口PythonAPIGettingStarted—FPGAInterfacePythonAPI19.0.0documentation2.FPGA接口CAPIFPGA接口CAPI是用于NI可重配置
東方神山·2023-12-22 19:01

FPGA项目（12）——基于FPGA的万年历设计

本次做的设计，使用了正点原子的开拓者FPGA开发板，并且在开发板上验证了功能，通过了实物测试。实物图片如下：对于本次设计，我还拍了实物演
嵌入式小李·2023-12-22 17:22

openKylin系统安装指南

OpenKylin简介openKylin（开放麒麟）社区是由基础软硬件企业、非营利性组织、社团组织、高等院校、科研机构和个人开发者共同创立的一个开源社区，旨在以“共创”为核心、以“开源聚力、共创未来”为社区理念
传说中的暗暗·2023-12-22 14:44

FPGA中的HP Bank、HR Bank、HD Bank。

在开发FPGA绑定管脚时，经常会看到HPBank、HRBank和HDBank，它们分别是什么意思？分别可以适用于哪些应用个？  
Me sl ··2023-12-22 11:55

ccf新闻（3）智能汽车之产学研协同突破创新 | CCDE2023专题论坛

中国数字经济产业发展大会智能网联汽车论坛将围绕“产学研协同创新成果”进行报告和展示，并就“促进前沿交叉技术商业化落地”和“促进行业协同创新”两个议题进行展望和研讨，为产业的高质量发展提供参考和建议。
m0_67295387·2023-12-22 10:26

跑马灯实验

2.掌握FPGA编程入门知识、利用门级方法实现简单逻辑电路。3.继续学习VerilogHDL语法、掌握跑马灯的设计、熟悉调试过程。
小i青蛙·2023-12-22 10:43

【FPGA 器件比较】Altera -- Xilinx

比较以下市场前二名的产品线及定位应用场景XilinxAltera高性能VersalAgilexF/I性能Virtex/Kintex/Artix/ZynqUltraScale+AgilexF/I/Stratix10中档Virtex/Kintex/Zynq~7/UltraScaleStratix10/Arria10低成本Artix-7Sparton-7Cyclone10如上表，altera被蓝厂收购后
hcoolabc·2023-12-22 10:43

FPGA高端项目：基于GTH的 4K HDMI 视频收发例程，提供工程源码和技术支持

目录1、前言免责声明2、相关方案推荐我已有的GT高速接口解决方案我已有的FPGA图像处理方案3、详细设计方案设计框图4KHDMI输入硬件解决方案VideoPHYControllerHDMI1.4/2.0ReceiverSubsystem4KHDMI
9527华安·2023-12-22 10:11

蕃茄田艺术×熊小米打造大电影，千名小作者海选启动

最近，小朋友和家长都在谈论的的大件事，莫过于儿童创新艺术教育品牌蕃茄田艺术和备受孩子们喜欢的动画IP熊小米联手，共同启动了一个让人激动的项目——海选一千名小朋友共同创作儿童动画大电影！
ZAKER科技动态·2023-12-22 03:15

这个32岁，有很多必须值得的事

2019年11月份开的线下实体阿胶糕店铺如今通过自己一年半的时间带领100来人的伙伴共同创业做阿胶糕卖，既是百人团队长，也是一名熬糕师傅，除了赚钱也要
小雪_0f39·2023-12-22 02:02

EDA实验-----4*4矩阵键盘模拟音符测试（Quartus II ）

2、实验仪器设备PC机一台FPGA实验开发系统一套。3、实验原理本实验根据蜂鸣器工作频率不同，从而发出不同的音符的声音。故本实验是将主时钟进
Gretel Tade·2023-12-22 02:35

EDA实验-----直流电机驱动设计（Quartus II ）

二、实验仪器设备PC机一台FPGA实验开发系统一套。三、实验的重点和难点重点：掌握直流电
Gretel Tade·2023-12-22 02:04

Achronix提供由FPGA赋能的智能网卡（SmartNIC）解决方案来打破智能网络性能极限

作者：Achronix随着人工智能/机器学习（AI/ML）和其他复杂的、以数据为中心的工作负载被广泛部署，市场对高性能计算的需求持续飙升，对高性能网络的需求也呈指数级增长。高性能计算曾经是超级计算机这样一个孤立的领域，而现在从超级计算机到边缘解决方案，在各个层面都可以看到高性能计算，随着我们推动更快的解决方案进入市场，网络安全和高复杂性应用在其中也扮演着更重要的角色。为了满足对网络加速的需求，并提
电子科技圈·2023-12-21 23:08

除夕祝福

弹一曲流年的静好，让紫光在琴音中流淌，让清欢在和鸣中徜徉，让悦色在律动中焕彩，让心花在弦歌中绽放。祝福您，祝福我，祝福天下每一家。一一赖仲文携家人，除夕敬贺。
觉解LZW·2023-12-21 22:27

在图像处理中应用深度学习技术

点击上方“小白学视觉”，选择加"星标"或“置顶”重磅干货，第一时间送达工业应用中FPGA上的神经元网络(CNN)深度学习应用凭借其在识别应用中超高的预测准确率，在图像处理领域获得了极大关注，这势必将提升现有图像处理系统的性能并开创新的应用领域
小白学视觉·2023-12-21 21:52

RK3588安装TVM-CPU版本

以下是关于TVM的详细介绍：TVM的目标是将深度学习模型的优化和编译过程自动化，以便开发人员可以轻松地将其模型部署到各种硬件平台上，包括CPU、GPU、FPGA等。
呆呆珝·2023-12-21 17:51

搭载紫光展锐芯的移远通信RedCap模组顺利通过中国联通OPENLAB实验室认证

近日，移远通信联合紫光展锐在中国联通5G物联网OPENLAB开放实验室，完成了RedCap模组RG207U-CN端到端测试验收，并获颁认证证书。
移远通信·2023-12-21 13:03

建设规范化的人力资源管理体系

在企业管理当中对企业员工实施职业生涯的规划、设计目的是为了适应企业长期战略发展，让员工了解员工个人生涯与企业发展之间的关系，在兼顾企业利益与员工个人利益的前提下设定个人目标，做到员工个人与企业间目标一致，行为一致，共同创业
三只小熊那些事·2023-12-21 12:09

中原焦点团队秦皇岛站徐娟坚持分享130天

对于当事人，咨询师并不是全知全能单身，对于自己与生活本来就有固定的看法，在离开晤谈时，可能会有些改变，也可能丝毫不被动摇换言之在咨询中通过单身所告知及彼此互动出来的讯息，单身与咨询师会共同创造一种治疗性的现实
平衡木_e706·2023-12-21 11:00

长文预警【深度学习】基于 Pytorch 的网络训练

我是雪天鱼，一名FPGA爱好者，研究方向是FPGA架构探索和数字IC设计。关注公众号【集成电路设计教程】，获取更多学习资料，并拉你进“IC设计交流群”。
雪天鱼·2023-12-21 09:08

UART协议——FPGA代码篇

一.串口（UART）协议简介UART串口通信有几个重要的参数，分别是波特率、起始位、数据位、停止位和奇偶检验位，对于两个使用UART串口通信的端口，这些参数必须匹配，否则通起始位：表示数据传输的开始，电平逻辑为“0”。数据位：可能值有5、6、7、8、9，表示传输这几个bit位数据。一般取值为8，因为一个ASCII字符值为8位。奇偶校验位：用于接收方对接收到的数据进行校验，校验“1”的位数为偶数(偶
我来挖坑啦·2023-12-21 08:15

【INTEL（ALTERA）】 quartus 使用Intel Agilex7 F-Tile 变体的以太网子系统 IP示例时仿真和硬件中都无法正常运行1

现象为什么具有40GbE、50GbE或100GbE端口的IntelAgilex®7F-Tile变体的以太网子系统英特尔®FPGAIP示例设计且客户端接口参数设置为“MACAvalonST”，在仿真和硬件中都无法正常运行
神仙约架·2023-12-21 08:45

【INTEL（ALTERA）】 quartus使用 F-tile IP 的 Cadence Xcelium* 和 Synopsys VCS* 模拟器上看到详细阐述错误英特尔® FPGA

说明由于英特尔®Quartus®PrimeProEdition软件23.3和23.2版本的更改，在使用CadenceXcelium*和SynopsysVCS*模拟器详细阐述时，您可能会看到以下错误：SynopsysVCS*模拟器错误-[ICPD_INIT]非法组合驱动程序/eda/sim_lib/synopsys/ctfb_hssi_atoms_ncrypt.sv、4246150CadenceXc
神仙约架·2023-12-21 08:45

【INTEL（ALTERA）】 quartus使用编译仿真库时为何会出现“指定仿真工具可执行文件位置”错误

说明由于英特尔®Quartus®Prime专业版软件23.3及更早版本存在一个问题，EDA仿真编译器在尝试使用Questa*英特尔®FPGA版编译库时可能无法找到仿真工具的位置，因为最新版本的工具名称中不包含
神仙约架·2023-12-21 08:45

高速视频采集卡设计方案：620-基于PCIe的高速视频采集卡

北京太速科技产品固化FPGA逻辑，适配视频连续采集，缓存容量2GB，开源的PCIeQT客户端软件，用户可以在很短的时间内完成视频程序的开发，开发效率高、难度小。适用于：实验室数据采集，记录等应用。
hexiaoyan827·2023-12-21 08:13

FPGA模块——以太网芯片MDIO读写

FPGA模块——以太网MDIO读写MDIO接口介绍MDIO接口代码（1）MDIO接口驱动代码（2）使用MDIO驱动的代码MDIO接口介绍MDIO是串行管理接口。
云影点灯大师·2023-12-21 08:13

【INTEL（ALTERA）】 quartus 在 F-Tile 以太网多速率英特尔® FPGA IP同时启用了自动协商和链路训练时生成严重警告

说明由于英特尔®Quartus®Prime专业版软件版本23.4存在问题，包含启用ANLT的F-Tile以太网多速率英特尔®FPGAIP的动态重新配置项目将生成严重警告。
神仙约架·2023-12-21 08:12

【自用】Ubuntu20.4从输入法到ddr200t运行HelloWorld

百度网盘安装三、Vivado2022.2安装四、编译蜂鸟E203自测样例1.环境准备2.下载e203_hbirdv2工程文件3.尝试编译自测案例1.安装RISC-VGNU工具链2.编译测试样例4.用vivado为FPGA
庚_·2023-12-21 03:01

FPGA实现 TCP/IP 协议栈 客户端 纯VHDL代码编写 提供4套vivado工程源码和技术支持

目录1、前言版本更新说明免责声明2、相关方案推荐我这里已有的以太网方案1G千兆网TCP-->服务器方案10G万兆网TCP-->服务器+客户端方案常规性能支持多节点FPGA资源占用少数据吞吐率高低延时性能
9527华安·2023-12-20 17:39

FPGA 实现 LeNet-5 卷积神经网络 数字识别，提供工程源码和技术支持

目录1、前言LeNet-5简洁基于Zynq7020的设计说明PL端FPGA逻辑设计PS端SDK软件设计免责声明2、相关方案推荐卷积神经网络解决方案FPGA图像处理方案3、详细设计方案PL端：ov7725
9527华安·2023-12-20 17:35

【一】FPGA实现SPI协议之SPI协议介绍

【一】FPGA实现SPI协议之SPI协议介绍一、spi协议解析spi协议有4根线，主机输出从机输入MOSI、主机输入从机输出MISO、时钟信号SCLK、片选信号SS\CS。一般用于主机和从机之间通信。
@晓凡·2023-12-20 16:36

高速口相关知识

一.不通系列fpga对高速口的叫法不一样：artix7——GTPkintex7——GTXvirtex7——GTH二.高速口的架构基本一致————4对rx/tx对+1个时钟模块（包含4个cpll+1个Qpll
燎原星火*·2023-12-20 16:04

FPGA未解之谜

一.ila一会能加载出波形，一会加载不出波形——在自己做的v7开发板中遇到，其他开发板从未遇到过1.小梅哥说：可能与硬件jtag连接不稳定导致。
燎原星火*·2023-12-20 16:32

zynqmp Linux + 裸机 （A53-0 Linux，A53-1 2 3 裸机大数据量实时处理，R5-0 协议处理，R5-1 屏幕显示逻辑等）填坑笔记

fpga和arm采用预留内存的方式，采用neon协处理器只能做到250M/S的速度，预留内存采用mmap的方式，当读取内存页的时候采用缺页中断的方式，导致速度拖沓而且预留内存没有进行Linux系统的内存管理
小坏坏_·2023-12-20 15:38

紫光展锐T820与飞桨完成I级兼容性测试 助推端侧AI融合创新

近日，紫光展锐高性能5GSoCT820与百度飞桨完成I级兼容性测试（基于PaddleLite工具）。测试结果显示，双方兼容性表现良好，整体运行稳定。
飞桨PaddlePaddle·2023-12-20 14:34

vivado 创建合成约束

AMDFPGA包括许多可以以多种不同方式使用的逻辑功能。你的需要约束来引导合成引擎找到满足所有设计的解决方案实现结束时的需求。
cckkppll·2023-12-20 14:26

iOS开发笔记-89:Swift5 - 状态栏文字颜色

最近又碰到这个问题，我的成功案例。时间：2019.5.6版本：swift5修改颜色代码：//状态栏文字颜色overridevarpreferredStatusBarStyle:UIStatusBarStyle{return.default//黑色字体}第一步：info.plist中修改屏幕快照2019-05-06上午9.36.59.pngUIViewControllerBasedStatusBar
原味蛋炒饭·2023-12-20 11:51

MCU Pin2Pin w STM32, FPGA Pin2Pin w Altera

1Deviceoverview1.1IntroductionTheAG32familyof32-bitmicrocontrollersisdesignedtooffernewdegreesoffreedomandrichcompatibleperipherals,andcompatiblepinandfeaturestoMCUusers.AG32productseriesofferssupreme
Embeded_FPGA·2023-12-20 10:35

AD采集卡设计方案：630-基于PCIe的高速模拟AD采集卡

北京太速科技，产品固化FPGA逻辑，适配2路1Gsps/2路2Gsps采集，实现PCIe的触发采集，单次采集容量2GB，开源的PCIeQT客户端软件，用户可以在很短的时间内完成采集器程序的开发，如连续信号采集
hexiaoyan827·2023-12-20 05:52

模拟适配器设计方案：360-基于10G以太网的模拟适配器

产品固化FPGA逻辑，适配8路125M
hexiaoyan827·2023-12-20 05:22

AD采集卡设计方案：130-基于PCIe的中速模拟AD采集卡

产品固化FPGA逻辑，适配8路125Msps/4路250Msps/2路500Msps/1路1Gsps采集，实现PCIe的触发采集，单次采集容量2GB，开源的PCIeQT客户端软件，用户可以在很短的时间内完成采集器程序的开发
hexiaoyan827·2023-12-20 05:22

FPGA实现PID控制算法(含仿真)

那么本篇文章将简要介绍一下算法的原理，然后带大家使用FPGA来实现(C语言实现过程特别简单)。二.PID算法PID取自比例、积分、微分三个英文字母的首字母。意味着算法由这三部分组成。
FPGA之旅·2023-12-19 22:33

Aurora8B10B(一) 从IP配置界面学习Aurora

一.简介哈喽，大家好，好久没有给大家写FPGA技术的文章，是不是已经忘记我是做FPGA的啦，O(∩_∩)O哈哈~。
FPGA之旅·2023-12-19 22:33

【FMC141】基于VITA57.4标准的4通道2.8GSPS 16位DA播放子卡（2片DAC39J84）

通道2.8GSPS/2.5GSPS/1.6GSPS采样率16位DA播放FMC子卡，该板卡为FMC+标准，符合VITA57.4与VITA57.1规范，16通道的JESD204B接口通过FMC+连接器连接至FPGA
北京青翼科技·2023-12-19 19:29

普冉（PUYA）单片机开发笔记 [完结篇]：使用体会

失败的移植：FreeRTOS当使用了PY32F003的各种接口和功能后，手痒痒想把FreeRTOS也搬到这个MCU上，参考STM32和GD32对FreeRTOS的移植步骤，把FreeRTOSv202212.00版本的源码搬到了Keil工程中，编译倒是通过了，程序尺寸大约是20K字节的样子，下载到板子上肯定是装得下的。但上烧录之后却运行不起来。对SysTick_Init改来改去也无法正常运行，修改了
硬核老骆·2023-12-19 15:23

vivado sdk mem超出

local_memory_ilmb_bram_if_cntlr_Mem_microblaze_0_local_memory_dlmb_bram_if_cntlr_Mem’overflowedby4288bytesuartC/C++Problem问题的产生：fpga
花椒且喵酱·2023-12-19 12:16

基于FPGA的视频接口之高速IO（CML）

FPGA的高速IO接口GTX，可完美覆盖CML的速度范围。应用应
Eidolon_li·2023-12-19 10:26

超低延时4K级可定制化专业视觉计算平台

4K30ISPIP，ISP延时0.7ms>内置GigEvisionIP支持GigEVision2.0、GenICamV2.4.0标准，支持用户自定义XML描述文件>内置工业机器视觉行业标准的U3visonIP>基于FPGA
深圳信迈科技DSP+ARM+FPGA·2023-12-19 10:23

建立SOPC工程后软件编译时报错rwdata is not within region ram解决办法

工程时使用了片上的存储器（onchipmemory）作为CPU（NIOSII）的程序和数据存储器，存储器的大小设置为4096，此时硬件编译能通过，在开发软件时，eclipse报错如下：c:/intelfpga
向阳花木木·2023-12-19 10:10
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