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射频收发子板

公司网站：www.luowave.com，欢迎登陆浏览更多产品信息射频收发子板-SBX频率覆盖:400-4400MHzRx/Tx最大信号处理带宽：40MHz、120MHz可提供100毫瓦的输出功率和

珞光电子USRP软件无线电平台·2024-02-07 13:36

X310 和子板，中心频率

X310XilinxKintex-7XC7K410TFPGA14bit200MS/sADC16bit800MS/sDACFrequencyrange:DC-6GHzwithsuitabledaughterboardUp160MHzbandwidthperchannelTwowide-bandwidthRFdaughterboardslotsOptionalGPSDOMultiplehigh-spe

东枫科技·2024-02-07 13:05

Linux进程信号详解

目录一.理解信号的前提知识1.人对于信号的反应2.信号产生的生命周期，人对应进程3.通过一段代码理解信号4.信号的发送与记录5.信号处理常见方式概述6.补充二.信号的产生1.通过终端按键产生信号2.通过系统函数向进程发送信号

GSX_M·2024-02-07 12:38

高级FPGA开发之基础协议PCIe(二)

高级FPGA开发之基础协议之PCIe（二）一、TLP报文类型在PCIe总线中，存储器读写、I/O读写和配置读写请求TLP主要由以下几类报文组成：1.1存储器读请求TLP和读完成TLP当PCIe主设备（RC

北京不北·2024-02-07 11:30

现代信号处理——阵列信号处理（空域滤波原理及其算法）

一、阵列信号处理简介1、阵列信号处理的研究内容：检测、估计、滤波、成像等。

清泉_流响·2024-02-07 11:59

PyTorch 中音频信号处理库torchaudio的详细介绍

它提供了丰富的音频信号处理工具、特征提取功能以及与深度学习模型结合的接口，使得在PyTorch中进行音频相关的机器学习和深度学习任务变得更加便捷。

科学禅道·2024-02-07 10:32

LabVIEW FPGA PCIe开发讲解-7.7节：上位机PC端Memory应用程序开发（LabVIEW/C调用DLL文件，神电提供lvlib库）

当FPGA硬件被系统识别成功后，我们就可以编写一个上位机PC端的应用程序来与之通信，比如用来监控下位机FPGA前面板上的控件值或者下发控制指令给FPGA了。

神电测控·2024-02-07 08:15

配备Apple T2 安全芯片的 Mac 机型及T2芯片mac电脑U盘装系统教程

T2芯片为Mac提供了一系列功能，例如加密储存和安全启动功能、增强的图像信号处理功能，以及适用于触控ID数据的安全保护功能。哪些电脑配备了T2安全芯片呢，T2芯片mac电脑又如何重装系统呢？

m0_72498124·2024-02-07 08:36

第12章：实践版OpenMIPS处理器设计与实现

12.1实践版OpenMIPS处理器的设计目标但在实际应用中，程序的体积可能非常大，指令存储器不能集成在FPGA内部了，一般使用FPGA芯片外部的Flash作为指令存储器，同理，一般使用FPGA芯片外部的

tanfuz·2024-02-07 07:26

JTAG 标准IEEE STD 1149.1-2013学习笔记（一·）Test logic architecture、Instruction register以及Test data registers

我是雪天鱼，一名FPGA爱好者，研究方向是FPGA架构探索和SOC设计。关注公众号【集成电路设计教程】，拉你进“IC设计交流群”。

雪天鱼·2024-02-07 07:55

回归预测 |POA-CNN-SVM鹈鹕算法优化卷积神经网络-支持向量机多变量回归预测 Matlab实现

前程算法matlab屋·2024-02-07 05:27

156基于Matlab的光纤陀螺随机噪声和信号

156信号处理自适应滤波降噪效果评估(xiaohongshu.com)

顶呱呱程序·2024-02-07 05:55

1.3 Verilog 环境搭建详解教程

FPGA开发环境有Xilinx公司的ISE（目前已停止更新），VIVADO；因特尔公司的QuartusII；ASIC开发环境有Synopsys公司的VCS；很多人也在用IcarusVerilog和GTKwave

二当家的素材网·2024-02-07 05:43

【INTEL（ALTERA）】为什么在编译 HDMI 英特尔® FPGA IP设计示例 VHDL 变体时看到错误（13879）？

说明由于英特尔®Quartus®PrimeProEdition软件版本23.2存在一个问题，您在编译HDMI英特尔®FPGAIP设计示例的VHDL变体时可能会看到以下错误：错误（13879）：VHDL绑定指示

神仙约架·2024-02-07 04:25

【lssvm回归预测】基于哈里斯鹰算法优化最小二乘支持向量机HHO-lssvm实现数据回归预测附matlab代码

Matlab科研辅导帮·2024-02-06 23:35

Vivado FIR IP核的使用

⭐️作者简介：小瑞同学，主要学习FPGA、信号处理、通信等。个人主页：小瑞同学的博客主页个人信条：越努力，越幸运！

hi小瑞同学·2024-02-06 20:09

vivado中IP核调用方法简介

、常用IP核调用方法案例2.1FIFOIP核2.2UARTIP核2.3DDR3IP核2.4PLLIP核2.5AXIGPIOIP核三、总结Vivado是Xilinx公司推出的一款集成化设计环境，可以用于FPGA

Simuworld·2024-02-06 20:37

Vivado Digilent IP核

最近在做FPGA的视频处理，学习中看见大佬使用现成的IP核会方便很多，其中就包括DynamicclockgeneratorIP核，根据视频分辨率不同产生动态时钟脉冲的IP核，可以说是相当的方便了，Dynamic

艾利芬特·2024-02-06 20:37

阿里云异构计算类云服务器介绍（GPU云服务器、FPGA云服务器等）

阿里云异构计算云服务器产品可为用户提供了软件与硬件结合的完整服务体系，助力您在人工智能业务中实现资源的灵活分配、弹性扩展、算力的提升以及成本的控制。异构计算类云产品包括GPU云服务器、神龙AI加速引擎AIACC、AI分布式训练通信优化库AIACC-ACSpeed、AI训练计算优化编译器AIACC-AGSpeed、集群极速部署工具FastGPU、GPU容器共享技术cGPU、弹性加速计算实例EAIS和

阿里云最新优惠和活动汇总·2024-02-06 20:28

使用VS2022WFDB读取ECG信号（Python）

本人使用的Python编译工具是VS2022，在参考文章ECG心电信号处理：使用WFDB对MIT-BIH数据集进行读取（Python）读取心电信号时，发现总是会报错UnicodeDecodeError:

八百里秦川.·2024-02-06 19:19

2018-04-15 FPGA Kernel Log

AMDprintf我们在kernel中增加了#pragmaOPENCLEXTENSIONcl_amd_printf:enable，以便在kernel中通过printf函数进行debug，这是AMD的一个扩展。printf还可以直接打印出float4这样的向量，比如printf(“%v4f”,vec)。#pragmaOPENCLEXTENSIONcl_amd_printf:enable__kerne

七点水Plus·2024-02-06 18:14

FPGA快速入门路径

适合新手的FPGA入门路径总体路径规划基础学习-verilog语言verilog语言学习，推荐verilog数字系统设计一书，讲解比较详实和全面。

zuoph·2024-02-06 18:14

FPGA-学习路径（更新中）

目前我还在入门FPGA，我想写下我的学习路径，仅供参考，希望帮到更多的人，也希望大家多多指教。

班花i·2024-02-06 18:14

FPGA学习笔记

FPGA和ASICFPGA（FieldProgrammableGateArray）现场可编程逻辑门阵列，ASIC(ApplicationSpecificIntegratedCircuit)即专用集成电路

橙橙养乐多·2024-02-06 18:11

数字电路实验二：FPGA实验箱内置单脉冲测试、数码管基础测试、74LS197产生8421码循环测试信号、实现8421码-＞格雷码译码器、3-8译码器、设计改进实现48译码器a段显示译码电路

数字电路实验报告二实验环境与仪器实验环境实验时间：2022.11.10地点：教学大楼A412气温：22℃实验仪器示波器/逻辑分析仪MSO5354FPGA实验箱元器件目录第一组数字电路实验报告二参与者一、

thinkerhui·2024-02-06 16:12

数字电路实验1:4联装7段数码管管脚功能、传统实验箱非门延迟、fpga各种虚拟门特性及边沿检测器

软件工程学院目录第一组数字电路实验报告一一、实验室环境与仪器1.实验环境2.实验仪器二、实验内容（1）测量4联装7段数码管管脚功能（2）测量74LS00与非门管脚功能与门延迟（使用传统实验箱）（3）74LS197产生测试信号（使用FPGA

thinkerhui·2024-02-06 16:41

GPS北斗详解

数字信号处理过程中得到的PRN码的起始点初始相位的精

爱搞研究的阿灿·2024-02-06 08:20

vivado在线调试、在线抓波形方法

7、点击program下载到FPGA，双

千寻xun·2024-02-06 08:18

【基于FPGA的可调数字钟设计】

基于FPGA的可调数字钟设计前言一、设计要求二、实现过程1.总体设计思想2.设计模块分析三、系统调试结语前言近年来由于美国对我国芯片行业的封锁，我国芯片行业迎来了一波发展的浪潮，FPGA这款小众而又实用的芯片也被划在制裁名单中

青柠味汽水·2024-02-06 08:48

VIVADO烧录之FLASH W25Q128JVSIQ

平台：vivado2017.4FPGA芯片：XC7K325T-2FFG676Flash芯片：w25q128jvsiq简言在使用vivado开发工具进行固化程序时需要注意在vivado自带的flash器件库中

逾越TAO·2024-02-06 08:48

Xilinx 黑金ZYNQ开发板AX7020，利用VIVADO进行FPGA程序烧录

参考黑金的AX7020开发板资料中的SDK实验篇PDF教程文件。（1）创建工程，步骤与SDK实验篇中的步骤一致；配置PS端时应该可以只选需要的加载方式，如QSPI或者SD，我目前是两种都勾选了，但是只用了QSPI方式。第一章，1.2.（1）-1.2.（11）00：00（2）通过“RunBlockAutomation”完成端口导出，连接FCLK_CLK0到M_AXI_GP0_ACLK，然后保存，创建

weixin_48793386·2024-02-06 08:18

FPGA学习记录-Vivado工程创建、仿真、编译

目录前言工程创建工程仿真引脚配置编译前言本系列文章作为对特权同学《深入浅出玩转FPGA》课程学习的记录，对课程内容进行总结，比记录遇到的问题与解决办法，以此见证个人FPGA学习历程。

zoeybbb·2024-02-06 08:17

基于FPGA的多功能数字时钟设计报告

作品基于intelCycloneIVEEP4CE10F17C8FPGA板卡，主要开发环境为QuartusⅡ，编程并实现了多功能温湿度电子钟。

马泽骞·2024-02-06 08:47

vivado在远程服务器上完成本地设备的程序烧写和调试(vivado远程调试)

vivado远程调试目录1概述2本地设置3远程服务器设置1概述本文用于描述FPGA开发过程中，使用远程服务器时，直接在远程服务器连接到本地设备进行程序的烧写和调试的过程。

风中月隐·2024-02-06 08:47

【Verilog HDL设计】基于FPGA的HDMI协议实现v0.1

1协议简介HDMI协议常见用的有v1.4v2.0v2.1等版本，后两个版本基于v1.4版本发展而来，要想深入学习HDMI协议，从v1.4版本开始更容易上手。关于HDMIv1.4的协议内容，网上已经有很多前辈作了详细介绍，例如博主“芒果木有籽”的这篇“HDMI1.4协议详解”就讲解的很细致。但毕竟在一篇或者几篇博文中想要把一个协议没有遗漏的展现出来是非常困难的。更详细的协议内容协议详见《High-D

蚂蚁cd·2024-02-06 08:16

基于FPGA的可调数字钟设计

在此特别感谢哔站up主甘第发布的FPGA企业实训课（基于FPGA的数字钟设计）教学视频，让一个FPGA小白开始了第一个FPGA设计开发流程。

以安_wjf·2024-02-06 08:45

在线逻辑分析仪的使用

待测设计（DesignUnderTest，DUT）就是用户逻辑，它和片内的在线逻辑分析仪都位于FPGA中。

m0_46521579·2024-02-06 08:14

在 Vivado 将程序烧写固化到 flash

通常对FPGA下载程序时，会采用JTAG口下载，完成好HDL设计，并且验证无误后，对设计文件进行综合，布局布线以及生成比特流文件，而FPGA开发板要想工作，需要将该文件烧写进FPGA芯片中。

Linest-5·2024-02-06 08:44

Vivado-基于下载器的程序加载与烧写

VIVADO->OpenHardwareManager"，如图所示：（3）采集卡上电，在菜单栏选择"Tools->AutoConnect"，如图所示：（4）下载器连接电脑与采集卡成功，如图所示：（5）右键点击FPGA

行走的路人啊·2024-02-06 08:13

xilinx FPGA在线调试方法总结（vivado+ila+vio）

本文主要介绍xilinxFPGA开发过程中常用的调试方法，包括ILA、VIO和TCL命令等等，详细介绍了如何使用。

jk_101·2024-02-06 08:13

Vivado开发FPGA使用流程、教程 verilog（建立工程、编译文件到最终烧录的全流程）

目录一、概述二、工程创建三、添加设计文件并编译四、线上仿真五、布局布线六、生成比特流文件七、烧录一、概述vivado开发FPGA流程分为创建工程、添加设计文件、编译、线上仿真、布局布线（添加约束文件）、

xingxing点灯·2024-02-06 08:11

【FPGA】Vivado 保姆级安装教程 | 从官网下载安装包开始到安装完毕 | 每步都有详细截图说明 | 支持无脑跟装

可跳转至Step5）Vivado介绍Step1：进入官网Step2：注册账号Step3：进入下载页面Step4：下载安装包Step5：安装Step6：等待软件安装完成安装完成Vivado介绍Vivado是FPGA

柠檬叶子C·2024-02-06 08:11

FPGA多功能数字时钟基于Quartus实现设计与仿真华南师范大学数电综设

专业：通信工程学号：__姓名：龚易乾___指导老师：电子与信息工程学院2023年2月有任何疑问可以联系邮箱：[email protected]项目仓库地址：https://github.com/CodeAlanqian/e-clockgithub仓库地址综合设计实验实验目的熟练掌握Quartus等EDA设计与仿真工具，掌握多路选择器、N进制计数器、显示译码电路、开关电路、按键等电路的设计和调试方法。加

CodeAlan·2024-02-06 08:41

[FPGA开发工具使用总结]VIVADO在线调试(1)-信号抓取工具的使用

约束文件2.4两种方法的优点与缺点3在线调试方法3.1器件扫描设置3.2触发条件设置3.3触发窗口设置3.4采样过程控制4常见问题4.1时钟域的选择4.2缺少LTX文件4.3ILA无时钟参考文档1简介在FPGA

蚂蚁cd·2024-02-06 08:41

FPGA编程入门：Quartus II 设计1位全加器

FPGA编程入门：QuartusII设计1位全加器一、半加器和1位全加器原理（一）半加器（二）1位全加器二、实验目的三、QuartusII设计半加器（一）新建工程（二）创建原理图（三）将设计项目设置成可调用的元件

一只特立独行的猪 ️·2024-02-06 07:06

【调试小诀窍】SD卡镜像启动过程中如何第一时间获取FPGA配置状态？以及如何定位FPGA配置失败原因？

如果用户参考Intel教程EmbeddedLinuxBeginnersGuide制作SD卡image，那么FPGA配置文件（.rbf）是在uboot阶段被加载。

Terasic友晶科技·2024-02-06 07:36

如何将SD卡众多文件打包成一个.img文件方便Windows的Windisk32工具一键烧写？

相信不少SOCFPGA用户在第一次设计SD卡image时都参考过Intel的经典教程EmbeddedLinuxBeginnerSGuide，教程里面演示制作SD卡image时，需要将SD卡手动分成3分区