FPGA技术开发

某智能科技研发公司任职资格体系搭建项目成功案例纪实

——建立多维度任职资格标准体系，降低管理成本【客户行业】信息技术行业【问题类型】任职资格体系【客户背景】某智能科技研发公司是一家专注于智能科技、计算机软件技术开发与应用等领域的民营企业，至今成立已有数十年
41099802·2023-11-10 10:59

某汽车制造公司员工培训体系搭建项目成功案例纪实

【问题类型】员工培训体系【客户背景】某汽车股份有限公司成立于2000年左右，位于南方某城市，公司主营业务为汽车底盘、齿轮箱、汽车零部件开发、制造、销售；汽车（包含小轿车）开发、制造、销售；汽车修理；新技术开发
41099802·2023-11-10 10:58

Java Web之第11章JSP开发模型

使用JSP技术开发Web应用程序，有两种开发模型可供选择，通常我们称为JSPModel1和JSPModel211.1JSP开发模型JSP的开发模型即JSPModel，在Web开发中，为了更方便地使用JSP
大马戏团里的一头猪·2023-11-10 09:37

通过FPGA实现RGB转HSV的图像处理功能

1.问题描述：2.部分程序：//Hcal_Hcal_H_u(.i_clk(~i_TxClk),.i_rst(i_rst),.i_LVAL(w_LVAL),.i_Vmax(w_Vmax),.i_Vmin(w_Vmin),.i_PA_R(w_PA_R),.i_PB_G(w_PB_G),.i_PC_B(w_PC_B),.o_H(o_H),.o_test1(),.o_test2(),.o_test3(w_
fpga和matlab·2023-11-10 07:37

【紫光同创国产FPGA教程】——【PGL22G第五章】序列检测器实验例程

需授权并注明出处适用于板卡型号：紫光同创PGL22G开发平台（盘古22K）一：盘古22K开发板（紫光同创PGL22G开发平台）简介盘古22K开发板是基于紫光同创Logos系列PGL22G芯片设计的一款FPGA
小眼睛FPGA·2023-11-10 07:04

【紫光同创国产FPGA教程】——PDS安装教程

本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处一：软件简介PangoDesignSuite是紫光同创基于多年FPGA开发软件技术攻关与工程实践经验而研发的一款拥有国产自主知识产权的大规模
小眼睛FPGA·2023-11-10 07:04

【紫光同创国产FPGA教程】【PGL50H第四章】串口收发实验例程

核心板由FPGA+2颗DDR3+Flash+电源及复位构成，承担FPGA的
小眼睛FPGA·2023-11-10 07:34

【紫光同创国产FPGA教程】【PGL50H第五章】HDMI 实验例程

核心板由FPGA+2颗DDR3+Flash+电源及复位构成，承担FPGA的
小眼睛FPGA·2023-11-10 07:34

【紫光同创国产FPGA教程】——【PGL22G第二章】键控流水灯实验例程

需授权并注明出处适用于板卡型号：紫光同创PGL22G开发平台（盘古22K）一：盘古22K开发板（紫光同创PGL22G开发平台）简介盘古22K开发板是基于紫光同创Logos系列PGL22G芯片设计的一款FPGA
小眼睛FPGA·2023-11-10 07:34

【紫光同创国产FPGA教程】——【PGL22G第四章】数字时钟实验例程

需授权并注明出处适用于板卡型号：紫光同创PGL22G开发平台（盘古22K）一：盘古22K开发板（紫光同创PGL22G开发平台）简介盘古22K开发板是基于紫光同创Logos系列PGL22G芯片设计的一款FPGA
小眼睛FPGA·2023-11-10 07:34

【紫光同创国产FPGA教程】【PGL50H第三章】I2C 读写实验例程

核心板由FPGA+2颗DDR3+Flash+电源及复位构成，承担FPGA的
小眼睛FPGA·2023-11-10 07:04

【紫光同创国产FPGA教程】【PGL50H第一章】LED 流水灯实验例程

核心板由FPGA+2颗DDR3+Flash+电源及复位构成，承担FPGA的
小眼睛FPGA·2023-11-10 07:03

基于FPGA的图像RGB转HSV实现,包含testbench和MATLAB辅助验证程序

目录1.算法运行效果图预览2.算法运行软件版本3.部分核心程序4.算法理论概述4.1.RGB与HSV色彩空间4.2.RGB到HSV转换原理5.算法完整程序工程1.算法运行效果图预览将FPGA的仿真结果导入到
简简单单做算法·2023-11-10 07:01

【紫光同创国产FPGA教程】——【PGL22G第九章】HDMI环路实验例程

需授权并注明出处适用于板卡型号：紫光同创PGL22G开发平台（盘古22K）一：盘古22K开发板（紫光同创PGL22G开发平台）简介盘古22K开发板是基于紫光同创Logos系列PGL22G芯片设计的一款FPGA
小眼睛FPGA·2023-11-10 07:31

短视频账号矩阵系统，短视频矩阵seo系统源码。

抖音智能营销获客开发系统，从技术逻辑出发利用php后台语言，技术开发的整套系统，整套系统有同城拓客--创建活动同步同能更新操作，官方企业号产品，短视频号下面的视频数据展示列表，粉丝数据展示，互动行为展示
+ylhd898978·2023-11-10 07:13

笔试|面试|FPGA知识点大全系列(4)

文章目录前言19.IC设计流程1)确定项目需求2)前端设计3)RTL实现4)功能验证5)逻辑综合+DFT6)形式验证7)静态时序分析8)后端设计20.对数字IC设计的理解总结往期精彩前言本文首发于微信公众号19.IC设计流程1)确定项目需求首先做一款芯片需要有市场，有了市场的需求我们就可以设计芯片的spec(规格说明)了。先由架构工程师设计架构，确定芯片的功能，然后用算法进行模拟仿真，最后得出一个
Dawn_yuan·2023-11-10 06:22

Java基础总结

还是用FPGA？Java基础总结原创2015年05月24日19:11:56483020-->1.基本类型1.在程序设计中经常用到一系列类型（基本类型），它们需要特殊对待。
qq_39744911·2023-11-10 04:39

fpga时序相关概念与理解

一、基本概念理解对于数字系统而言，建立时间（setuptime）和保持时间（holdtime）是数字电路时序的基础。数字电路系统的稳定性，基本取决于时序是否满足建立时间和保持时间。建立时间Tsu：触发器的时钟信号触发沿到来以前，数据要维持稳定不变的时间。如果D进入Tsu后仍然变化（如图1），就不满足建立时间，可能出现亚稳态。保持时间Th：触发器的时钟信号触发沿到来以后，数据要维持稳定不变的时间。如
little ur baby·2023-11-10 03:24

基于SSM的建筑装修图纸管理平台

末尾获取源码开发语言：JavaJava开发工具：JDK1.8后端框架：SSM前端：采用JSP技术开发数据库：MySQL5.7和Navicat管理工具结合服务器：Tomcat8.5开发软件：IDEA/Eclipse
曾几何时…·2023-11-10 02:52

基于SSM的图书管理借阅系统设计与实现

末尾获取源码开发语言：JavaJava开发工具：JDK1.8后端框架：SSM前端：采用JSP技术开发数据库：MySQL5.7和Navicat管理工具结合服务器：Tomcat8.5开发软件：IDEA/Eclipse
曾几何时…·2023-11-09 23:14

基于SSM的小区物业管理系统设计与实现

末尾获取源码开发语言：JavaJava开发工具：JDK1.8后端框架：SSM前端：采用JSP技术开发数据库：MySQL5.7和Navicat管理工具结合服务器：Tomcat8.5开发软件：IDEA/Eclipse
曾几何时…·2023-11-09 22:37

基于SSM的电动车上牌管理系统设计与实现

末尾获取源码开发语言：JavaJava开发工具：JDK1.8后端框架：SSM前端：采用JSP技术开发数据库：MySQL5.7和Navicat管理工具结合服务器：Tomcat8.5开发软件：IDEA/Eclipse
曾几何时…·2023-11-09 22:37

基于SSM的楼房销售系统设计与实现

末尾获取源码开发语言：JavaJava开发工具：JDK1.8后端框架：SSM前端：采用JSP技术开发数据库：MySQL5.7和Navicat管理工具结合服务器：Tomcat8.5开发软件：IDEA/Eclipse
曾几何时…·2023-11-09 22:36

基于SSM的汽车在线租赁管理系统

末尾获取源码开发语言：JavaJava开发工具：JDK1.8后端框架：SSM前端：采用JSP技术开发数据库：MySQL5.7和Navicat管理工具结合服务器：Tomcat8.5开发软件：IDEA/Eclipse
曾几何时…·2023-11-09 21:51

【喜讯】斯歌上榜：中国信通院《高质量数字化转型产品及服务全景图》

9月15号，上海斯歌旗下品牌“纳比云”凭借卓越的自研成果及社会影响力，在众多候选企业中脱颖而出，成功入选由中国信通院发布的2023《高质量数字化转型产品及服务全景图》（技术开发领域）。
K2_BPM·2023-11-09 20:23

AD9371+ZYNQ结构中JESD204B IP核的AXI_STREAM接口数据结构

以fpga端的rx为例：ZYNQjesd204b中rx的axi_stream接口的位宽n与配置的LANE数量L有关，n=32L，如下图所示（L为2）：去解析rx_tdate的数据时需要参考AD9371的
哈塞给，套离开套·2023-11-09 20:58

在linux下使用am335x的DMA

[本文首发于cnblogs，作者：byeyear，Email：[email protected]]这几天在弄am3358的DMA，简化应用环境如下：am3358的FSMC接了一片FPGA；FPGA上接ADC；am3358
yebanguhe·2023-11-09 20:22

基于SpringBoot的高校党务管理系统

学生功能页面3.党组织功能页面4.党员功能页面5.前台功能页面四、核心代码一、相关技术末尾获取源码开发语言：JavaJava开发工具：JDK1.8后端框架：SpringBoot前端：采用Vue和HTML技术开发数据库
曾几何时…·2023-11-09 19:32

TCP/IP协议栈设计—TCP设计实现小结

TCP/IP协议栈设计—TCP设计实现小结设计目的：在FPGA上采用纯Verilog描述的方式，实现可定制裁剪的TCPIP硬件协议栈，并加入超时重传、滑动窗口等优化算法，最终希望实现传输速率能超过200MHz
时间看得见·2023-11-09 17:05

拜耳再投4亿元提升在华处方药产能；阿斯利康进博会公布新冠疫苗最新进展 | 美通企业日报...

进博会上，拜耳与北京经济技术开发区签署合作意向书。拜耳今年在公共卫生防疫专区设置独立的展台，并呈现覆盖预防、诊断、缓解及治疗于一体的医疗解决方案和创新、高效、环保的综合农业解决方案。
美通社·2023-11-09 13:07

FPGA中实现PLL分频

可以通过创建原理图的方式来实现，具体流程可以参考我的另一篇文章（调用滤波器）。产生的原理图为：测试代码如下：`timescale1ns/1ps////Company://Engineer:////CreateDate:2021/08/1310:30:44//DesignName://ModuleName:tb_PLL//ProjectName://TargetDevices://ToolVersi
George_ray·2023-11-09 11:57

FPGA的学习：5分频的实现

首先先把偶分频的系统框图和时序图画出来。此次采用降频的原理，了解了原理之后，开始代码的编写。`timescale1ns/1nsmoduledivider_five(inputwiresys_clk,//系统时钟50Mhzinputwiresys_rst_n,//全局复位outputregclk_flag//指示系统时钟5分频后的脉冲标志信号);reg[2:0]cnt;//用于计数的寄存器//cnt
石小舟·2023-11-09 11:26

八分频FPGA设计

八分频FPGAVerilog设计顶层模块modulesiv(clk,pwm);inputclk;outputregpwm;reg[2:0]c;always@(posedgeclk)beginc<=c+1
Mr. Qu·2023-11-09 11:56

FPGA学习记录（1）＜使用FPGA实现5分频＞

目录一、电路中的亚稳态以及解决方式1、什么是建立时间与保持时间2、为什么需要建立时间与保持时间3、如何解决亚稳态以及方式亚稳态的传播二、系统最高时钟频率计算&流水线思想1、系统最高频率2、流水线思想三、Verilog语言实现一个频占比达50%的5分频1、n.v2、testbench.v3、仿真波形一、电路中的亚稳态以及解决方式1、什么是建立时间与保持时间建立时间：触发器在时钟上升沿到来之前，数据输
雨觞醉月·2023-11-09 11:54

通用奇数分频FPGA设计

奇数分频FPGA设计--完整Verilog程序为CSDN资源的clk_div3模块部分核心程序：仿真结果：小结：上述程序思路。
时间看得见·2023-11-09 11:22

【FPGA学习】时钟分频

概况：用一个频率块的时钟产生一个频率小的时钟实验目的：掌握任意就分频的写法原理：一般来说开发板上面只有一个晶振，即只有一种时钟频率，但是我们有时候需要用到不同频率的时钟，若想要更慢的时钟，则可以将该固定的是何种进行分频，若想要更快的时钟，则可以在这个固定的时钟上进行倍频。无论是分频还是倍频，我们都有两种方法，一种你是使用pll核，另外一种是手动用veriloghdl描述。（适用于整数比的分频），只
jkgkj·2023-11-09 11:19

5分频【FPGA】

所以数据对齐晶振。从第一个晶振开始：5分频：2.5晶振高电平，2.5晶振低电平clk1是3+2clk2是2+3需要clk2下降沿【拉低】clk1上升沿【拉高】clk_out=clk1&clk2;推荐5分频：
cfqq1989·2023-11-09 11:12

数字通信和fpga概述——杜勇版本学习笔记

1数字通信处理流程脉冲调制是每个数字通信系统中间必不可少的环节，通常是使用升余弦滚降滤波器来实现。超外差接收机原理是利用本地产生的振荡波与输入信号混频，将输入信号频率变换为某个预先确定的频率的方法。超外差原理最早是由E.H.阿姆斯特朗于1918年提出的。在射频部分，射频输入信号经预选、整流、放大，最后转换成10.7MHz第一中频。数字解调是数字通信系统中最核心的部分，主要涉及滤波器的设计，同步系统
暴龙战士~·2023-11-09 09:55

FPGA配置采集AR0135工业相机，提供2套工程源码和技术支持

目录1、前言免责声明2、AR0135工业相机简介3、我这里已有的FPGA图像处理解决方案4、设计思路框架AR0135配置和采集图像缓存视频输出5、vivado工程1–>Kintex7开发板工程6、vivado
9527华安·2023-11-09 09:25

FPGA高端项目：图像采集+GTX+UDP架构，高速接口以太网视频传输，提供2套工程源码加QT上位机源码和技术支持

目录1、前言免责声明本项目特点2、相关方案推荐我这里已有的GT高速接口解决方案我这里已有的以太网方案3、设计思路框架设计框图视频源选择OV5640摄像头配置及采集动态彩条视频数据组包GTX全网最细解读GTX基本结构GTX发送和接收处理流程GTX的参考时钟GTX发送接口GTX接收接口GTXIP核调用和使用数据对齐视频数据解包图像缓存UDP数据组包UDP协议栈UDP协议栈数据发送IP地址、端口号的修改
9527华安·2023-11-09 09:45

Verilog 学习第二节（设计一个以1s频率闪烁的LED灯）

设计一个以1s频率闪烁的LED灯（亮灭各500ms）思考步骤：fpga开发板上默认的时钟频率是50MHz，就是20ns闪烁一次，若要完成500ms闪烁一次的话就需要进行计数，500ms/20ns=25000000
Pluviophile_miao～·2023-11-09 09:56

音视频技术开发周刊 | 318

每周一期，纵览音视频技术领域的干货。新闻投稿：[email protected]。日程揭晓！速览深圳站大会专题议程详解LiveVideoStackCon2023音视频技术大会深圳站，保持着往届强大的讲师阵容以及高水准的演讲质量。两天的参会时间，您可以快速了解音视频大咖前瞻的思想、把握音视频技术发展的最新动向、深入学习技术内容和工程化方面的一手实践。现在，深圳站大会日程正式揭
LiveVideoStack_·2023-11-09 01:08

混沌算法的研究

FPGA教程目录MATLAB教程目录-----------------------------------------------------------------------混沌是决定论非线性系统中既普通存在又极其复杂的现象
fpga和matlab·2023-11-09 00:41

matlab矩形脉冲信号_通信数字信号处理基本知识

欢迎FPGA工程师加入官方微信技术群点击蓝字关注我们FPGA之家-中国最好最大的FPGA纯工程师社群1、符号能量问题请问各位大虾，像4QAM，16QAM，32QAM，64QAM调制每符号平均能量怎么求解
weixin_39943799·2023-11-08 20:52

研究生电类综合实验（A1）-NJUST

研究生电类综合实验（A1）-NJUST摘要一、实验器材1、FPGA2、DE2-115开发板2.1开发板资源2.2ControlPanel工具2.3DE2-115开发板3、A/D、D/A开发板二、实验内容
在梦里-119·2023-11-08 20:48

几款国产FPGA系列器件参数汇总

1.高云半导体FPGA器件型号逻辑查找表RAM资源I/O资源pll触发器资源嵌入式内核易失性价格晨熙系列GW2A_1820736868Kbits3844155520GW2A_55547202626Kbits6086410400GW2AR
老王学FPGA·2023-11-08 20:34

【紫光同创国产FPGA教程】【PGC1/2KG第七章】7.数字钟实验例程

版权归本公司所有，如需转载，需授权并注明出处适用于板卡型号：紫光同创PGC1/2KG开发平台（盘古1K/2K）一：盘古1K/2K开发板（紫光同创PGC2KG开发平台）简介盘古1/2K开发板是一套基于紫光FPGA
小眼睛FPGA·2023-11-08 20:27

【紫光同创国产FPGA教程】【PGC1/2KG第五章】序列检测器实验例程

版权归本公司所有，如需转载，需授权并注明出处适用于板卡型号：紫光同创PGC1/2KG开发平台（盘古1K/2K）一：盘古1K/2K开发板（紫光同创PGC2KG开发平台）简介盘古1/2K开发板是一套基于紫光FPGA
小眼睛FPGA·2023-11-08 20:57

紫光同创PGC1KG-LPG100 / PGC2KG-LPG100开发套件|盘古1K/2K开发套件

本原创文章由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处盘古1K/2K开发套件是基于紫光同创FPGA开发平台的开发套件，以紫光同创Compa系列PGC1KG-LPG100/
小眼睛FPGA·2023-11-08 20:57

【紫光同创国产FPGA教程】【PGC1/2KG第三章】键控彩灯实验例程

版权归本公司所有，如需转载，需授权并注明出处适用于板卡型号：紫光同创PGC1/2KG开发平台（盘古1K/2K）一：盘古1K/2K开发板（紫光同创PGC2KG开发平台）简介盘古1/2K开发板是一套基于紫光FPGA
小眼睛FPGA·2023-11-08 20:57
上一页 39 40 41 42 43 44 45 46 下一页
按字母分类： ABCDEFGHIJKLMNOPQRSTUVWXYZ其他