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【OpenHW12参赛手记】ZedBoard-自定义IP核实现+PS成功调用【详细步骤+流程介绍+源码】 转载...

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weixin_30639719·2023-12-04 19:51

测试wss是否连接企业微信成功

企业微信考勤机有时候无法连接，可以使用下面代码来测试下网络情况测试wss测试连接微信wss://openhw.work.weixin.qq.com:443连接functiontest(){varws=newWebSocket
zhaogaojian·2023-11-28 04:15

CPU系统级验证——验证环境——OpenHW core-v验证环境及文件分析

本文记录的相关源工程和文件为：core-vRISCV核功能验证工程：https://github.com/openhwgroup/core-v-verifcore-v验证策略：https://core-v-docs-verif-strat.readthedocs.io/en/latest/#core-v系列核cva6工程：https://github.com/openhwgroup/cva6cor
KGback·2023-11-15 08:28

优化基于FPGA的深度卷积神经网络的加速器设计

http://www.openhw.org/module/forum/forum.php?
Tiger-Li·2022-12-28 08:14

openHW2015开源硬件与嵌入式计算大赛经验总结

原文地址：openHW2015开源硬件与嵌入式计算大赛经验总结作者：周君浣——本文章版权归卓艳男所有，如需转载请注明出处。OpenHW2015决赛于2015年7月11日，星期六在北京邮电大学举行。
a412841321·2022-12-17 09:41

基于FPGA的VGA显示静态图片

之前学习了半年的图像处理，所以计划将自己学过的几个图像处理的基础算法，做过的设计记录下来，在OpenHW论坛上发表，计划是这样的，用VGA做显示，使用PC端上位机通过串口发送一幅图片数据到FPGA开发板
weixin_30532987·2020-09-16 21:49

FPGA与ASIC比较

转自http://www.openhw.org/module/forum/thread-658598-1-1.html身份证FPGA（Field－ProgrammableGateArray），即现场可编程门阵列
weixin_30430169·2020-09-10 18:32

卷积神经网络的硬件加速

【阿里集团卜居深度解析】卷积神经网络的硬件加速（一）http://www.openhw.org/module/forum/forum.php?
qq_28500255·2020-08-22 22:08

FPGA教程

《玩转IPcore》http://www.openhw.org/module/forum/thread-562491-1-1.html转载于:https://www.cnblogs.com/Si-Mao
baihu9067·2020-08-22 21:25

Verilog十大基本功4 (FPGA四大设计要点)

需求说明：IC设计基础内容：FPGA四大设计要点来自：时间的诗原文：http://www.openhw.org/article/15-03/20104221426490405.html?
Times_poem·2020-08-15 22:33

HLS优化总结

4.1arraypartition4.2arrayreshape5inline6interface部分内容总结自https://blog.csdn.net/weixin_41967965/article/details/82080230http://www.openhw.o
tiaozhanzhe1900·2020-08-15 11:44

ISE约束--UCF编辑的入门介绍

http://www.openhw.org/yq000cn/blog/12-07/185475_6dce2.html摘要：本文主要通过一个实例具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束，
sxlwzl·2020-08-11 04:15

【OpenHW参赛手记】AXI-Stream接口介绍

AXI4-Stream协议是一种用来连接需要交换数据的两个部件的标准接口，它可以用于连接一个产生数据的主机和一个接受数据的从机。当然它也可以用于连接多个主机和从机。该协议支持多种数据流使用相同共享总线集合，允许构建类似于路由、宽窄总线、窄宽总线等更为普遍的互联。AXI4-Stream接口的信号线定义如图1所示[1]。比较重要的信号线有：ACLK为时钟线，所有信号都在ACLK上升沿被采样；ARESE
卜居·2020-08-08 17:11

【OpenHW参赛手记】AXI-Stream接口开发详细流程

下面讲一个例子，来加深对上面介绍内容的理解。笔者使用的软件版本为ISE14.2。1.建立PlanAhead工程，一直到进入XPS，具体流程见官方文档CTT[1]。2.在XPS中，添加一个AXI-DMA模块，配置界面如图1所示。图1AXI-DMA模块配置其余参数默认。SG模块如果选上，那么后面软件控制会相对复杂一些。这里不选，采用Simple模式，实现较为简单的传输。3.选菜单Hardware->C
卜居·2020-08-08 11:12

Kevin_HeYongyuan Zynq Cache问题的解决方法

Kevin_HeYongyuanZynqCache问题的解决方法原文转自：http://www.openhw.org/module/forum/thread-546879-1-1.html在进行PS-PL
dongtingxun123·2020-08-07 13:31

Zynq7000术语详解

URL:http://www.openhw.org/bbs/article_1237_380029.html相信大家刚看到Zynq手册的时候，对着那么一大堆缩略语肯定是一头雾水，特转来一篇文章，为大家解惑摘要
公孙璃·2020-08-04 03:47

ubuntu 16.04环境下安装gnuradio+UHD

本篇主要参考文章如下：手把手教你搭建USRP在LinuxGNURadio下的开发环境**http://www.openhw.org/topic-1382**。
阿尔法go·2020-08-01 00:08

在ZYNQ-ZEDBOARD上搭建LINARO文件系统

主要的参考资料：何宾《XILINXZYNQ-7000嵌入式系统设计与实现》http://www.openhw.org/topic-14
sss10_leon·2020-07-14 23:18

防止信号被编译器优化

http://www.openhw.org/module/forum/thread-644643-1-1.htmlPlacetheVerilogconstraintimmediatelybeforethemoduleorinstantiation.SpecifytheVerilogconstraintasfollows
zhangduojia·2020-07-06 12:19

Zynq Cache问题的解决方法

http://www.openhw.org/module/forum/thread-546879-1-1.htmlhttp://blog.163.com/haibianfeng_yr/blog/static
weixin_30732825·2020-07-05 21:40

PYNQ 用Python运行FPGA

转自http://www.openhw.org/topic-1738PYNQ用Python运行FPGA日期：2017-11-02作者：佚名推荐文章Zynq-7000PL端HDMI的显示控制Zynq-7000PS
shengfang05·2020-07-05 11:31

项目收集一

OpenHW2012大赛项目项目学校捐赠板卡[机器人专题]电子导盲犬清华大学ZED+小车套件基于Zynq的伺服机器人设计重庆大学ZED+小车套件[机器人专题]家庭安防智能机器人湖南大学ZED+小车套件机器人专题
lu_zhongzhou·2020-07-04 22:58

Vivado中几种仿真模式比较

原文地址：http://www.openhw.org/topic-1535收藏，备忘！！
wu_yi_xiang·2020-06-29 21:59

为什么我觉得单片机开发比FPGA开发要难

最近跟同学一起做了xilinx的OPENHW比赛，用的是xilinx的zynq-7020开发板。项目是《基于zynq-7000的宽带适时自适应滤波器》。
龚黎明·2020-06-26 14:32

Verilog代码实例化的简单理解(以38译码器为例)

在openhw论坛中看到这样一句话：一个例化调用就相当于一个电路，你用if语句，有时候要综合出这个电路有时候又不要综合出这个电路了，这个不是让人家软件为难吗！
ty_xiumud·2020-06-21 06:18

最详细易懂的CRC-16校验原理（附源程序）

from:http://www.openhw.org/chudonganjin/blog/12-08/230184_515e6.html最详细易懂的CRC-16校验原理（附源程序）1、循环校验码（CRC
小小小栋·2017-10-10 15:14

Zynq-Linux移植学习笔记之七-网络驱动

Zynq-Linux移植学习笔记之七-网络驱动参考网址：http://www.openhw.org/module/forum/thread-657608-1-1.html这一篇讲一讲u-boot里面的网络驱动以及
a746742897·2017-06-06 18:00

卷积神经网络的硬件加速（一）

http://www.openhw.org/module/forum/forum.php?
Tiger-Li·2017-02-19 13:39

最详细易懂的CRC-16校验原理（附源程序）

from:http://www.openhw.org/chudonganjin/blog/12-08/230184_515e6.html最详细易懂的CRC-16校验原理（附源程序）1、循环校验码（CRC
ywb201314·2016-08-01 09:08

最活跃FPGA论坛推荐社区

最活跃FPGA论坛推荐社区http://forums.xilinx.com/XilinxUserCommunityForums(Xilinx用户交流社区)http://www.openhw.org/中国首个开放源码硬件社区
farbeyond·2016-02-21 11:00

【开发手记一】老生常谈：简简单单配置ZED板开发环境

说明：整理之前项目博客，此系列之前发表于与非网http://www.openhw.org/module/forum/thread-552476-1-1.html在拿到开发板和配套教材之前，我们小组都是依据大神电子懒兔子的与非网上博文了解
phlsheji·2016-02-17 09:00

Zedboardwebcam设计问题篇（五）opencv处理帧数据，函数代码实现

有过之前的那次碰壁之后，不敢在费时间编译OpenCV了，不过还是一直关注这个问题，openhw论坛中也有人遇到这个问题了，有的人解决了，不过我的情况还是比他的复杂。
·2015-11-13 07:58

（转帖）写verilog代码的一些经验和小结（Verilog）

原创地址：http://www.openhw.org/ares10/blog/08-03/146788_f57e9.html  下面是自己写verilog代码的一些经验和小结，和大家分享下。
·2015-10-31 09:09

Linux设备驱动编程之内存与I/O操作

文章转载自： http://dev.yesky.com/412/2639912.shtml 2006-10-27 13:35作者：宋宝华出处：天极开发责任编辑：方舟 http://www.openhw.org
·2015-10-28 08:09

制作ZedBoard上linux根文件系统（ramdisk）

在笔者所写上一篇博客【OpenHW12参赛手记】Zedboard-网络配置方法详解http://www.eefocus.com/jefby1990/blog/13-04/293499_5fa3a.html
linuxarmsummary·2015-04-03 09:00

ZYNQ 开发

ZED-Board从入门到精通系列（六）——Vivado+OpenRISC分类：OpenHW2012FPGA2014-01-2616:353596人阅读评论(2)收藏举报书接上文。
linuxarmsummary·2015-03-17 17:00

【开发手记五】核心帖二：实现ZED与8051单片机的通信

说明：整理之前项目博客，此系列之前发表于与非网http://www.openhw.org/module/forum/thread-552493-1-1.html除了ZED与数据库的网络通信外，ZED与8051
GeekLei·2014-08-29 19:00

【开发手记四】核心帖一：实现ZED的网络通信

说明：整理之前项目博客，此系列之前发表于与非网http://www.openhw.org/module/forum/thread-552482-1-1.html根据我们小组的设计方案，ZED采集了单片机端的数据后将数据传输者网络服务器
GeekLei·2014-08-29 19:00

【开发手记三】一步一坑：UART和GPIO协同控制LED

说明：整理之前项目博客，此系列之前发表于与非网http://www.openhw.org/module/forum/thread-552480-1-1.html老师说先实现串口通信，东找西找找不到完整的教程
geeklei·2014-08-29 19:28

【开发手记三】一步一坑：UART和GPIO协同控制LED

说明：整理之前项目博客，此系列之前发表于与非网http://www.openhw.org/module/forum/thread-552480-1-1.html老师说先实现串口通信，东找西找找不到完整的教程
GeekLei·2014-08-29 19:00

【开发手记一】老生常谈：简简单单配置ZED板开发环境

说明：整理之前项目博客，此系列之前发表于与非网http://www.openhw.org/module/forum/thread-552476-1-1.html在拿到开发板和配套教材之前，我们小组都是根据大神电子懒兔子的与非网上博文了解
GeekLei·2014-08-29 18:00

【开发手记二】：各有千秋：搭建Linaro Ubuntu与搭建嵌入式Linux系统

说明：整理之前项目博客，此系列之前发表于与非网http://www.openhw.org/module/forum/thread-552479-1-1.html没拿到教材之前，一头扎进了各种文档教程中，
GeekLei·2014-08-17 15:00

深度解析：全志A20双核处理器倍受国内外开源

作为领先的移动处理器供应商，全志科技单双四核处理器不仅被广泛应用于平板电脑、智能播放盒和安防等领域，还倍受OpenHW/CNX-Software等国内外开源社区的青睐，近期更是有多块基于A20的开源开发板相继面世
bananapi·2014-03-29 09:00

最详细易懂的CRC-16校验原理（附源程序）

from:http://www.openhw.org/chudonganjin/blog/12-08/230184_515e6.html    最详细易懂的CRC-16校验原理（
·2014-02-21 15:00

ocr

http://www.openhw.org/winter1988/blog/13-03/292209_03d5b.htmlhttp://ykf.iteye.com/blog/212431http://www.cnblogs.com
塔塔米·2014-01-02 00:00

ZED-Board从入门到精通（零）：写在前面

去年10月份有幸报名参加了OpenHW2012开源硬件与嵌入式设计大赛，今年2月底顺利得到一块ZED-Board，从此步入了ZYNQAll-Programmable的世界。
kkk584520·2013-07-28 18:00

【OpenHW参赛手记】AXI-Stream接口开发详细流程

 下面讲一个例子，来加深对上面介绍内容的理解。笔者使用的软件版本为ISE14.2。1.建立PlanAhead工程，一直到进入XPS，具体流程见官方文档CTT[1]。2.在XPS中，添加一个AXI-DMA模块，配置界面如图1所示。图1AXI-DMA模块配置其余参数默认。SG模块如果选上，那么后面软件控制会相对复杂一些。这里不选，采用Simple模式，实现较为简单的传输。3.选菜单Hardware->
kkk584520·2013-07-10 13:00

【OpenHW参赛手记】AXI-Stream接口介绍

AXI4-Stream协议是一种用来连接需要交换数据的两个部件的标准接口，它可以用于连接一个产生数据的主机和一个接受数据的从机。当然它也可以用于连接多个主机和从机。该协议支持多种数据流使用相同共享总线集合，允许构建类似于路由、宽窄总线、窄宽总线等更为普遍的互联。AXI4-Stream接口的信号线定义如图1所示[1]。比较重要的信号线有：ACLK为时钟线，所有信号都在ACLK上升沿被采样；ARESE
kkk584520·2013-07-10 13:00

【OpenHW参赛手记】System Generator 与XPS连接的方法

由于项目需要用到DSP算法实现，考虑用SystemGenerator辅助设计算法，但在参赛赠送的书里没有相关知识，需要自己动手摸索。还好在MatlabSimulink内包含库XilinxBlocksets里右键发现了帮助文档，进入之后了解了怎么用Xilinx器件来完成算法设计，并生成网表。最重要的器件应该是Gatewayin和gatewayout，将matlab内的模块与Xilinx模块隔离，实现
kkk584520·2013-07-10 13:00

OPENHW大赛，跟同学讨论后的备忘笔记

xilinxzynq-7000开发《宽带实时自适应滤波器》，主要包含：GAL-NLMS算法，linux操作系统和QT图形界面。1，ramdisk不用也可以启动操作系统。可以将ramfs作为根文件系统，也可以将SD卡的ext4分区作为根文件系统。具体是哪一个，涉及到编译设备树的时候修改启动参数。不过，必须有一个作为根文件系统。2，以ramfs作为根文件系统的时候，SD卡的ext4分区会在系统启动之后
stephenkung1·2013-06-21 16:00
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