★FPGA项目经验

国产FPGA(AG32VF407 AGRV2K)LED程序控制D3闪烁

视频讲解[AG32VF407]国产MCU+FPGALED程序控制D3闪烁及演示实验过程本次测试用的源文件为E:\tech\AGM-AG32VF\sdk-release\AgRV_pio\platforms
LitchiCheng·2024-01-28 13:41

【FPGA】7系列 FPGA时钟资源及时钟IP核配置 Xilinx

7系列FPGA时钟资源及时钟IP核配置Xilinx7系列时钟资源1.分类全局时钟，区域时钟2.7系列时钟结构ClockBackbone：全局时钟线将芯片分成左右两个时钟区域；HorizontalCenter
原地打转的瑞哥·2024-01-28 05:23

FPGA 时钟资源

一：时钟分类A.外部时钟外部时钟是指时钟信号的来源是在FPGA芯片的外部。通常来说，外部时钟源对FPGA设计来说是必需的，因为一般FPGA芯片内部没有能够产生供内部逻辑使用的时钟信号的选频和激励电路。
燎原星火*·2024-01-28 05:21

使用 Fiddler+Linux 日志 + 数据库，搞懂3个问题，强势回怼开发！

定位分析问题的能力是测试不可或缺的，而且这个能力需要项目经验积累以及需要丰富的知识面才能达到的。企业需要这样的人才，因为他们需要会解决问题的人，而不仅仅是发现问题的人！
咖啡 加剁椒·2024-01-27 21:44

FPGA学习笔记——跨时钟域（CDC）设计之单bit信号同步

FPGA学习笔记——跨时钟域（CDC）设计  跨时钟域（ClockDomainCrossing，CDC）是指设计中存在着两个或两个以上异步时钟域，跨时钟域设计问题目前是逻辑设计者经常面临的问题，解决这类问题的方法被称为
你我山巅自相逢*·2024-01-27 15:33

FPGA中跨时钟域传数据——（1）单bit脉冲

FPGA中跨时钟域传数据——（1）单bit脉冲亚稳态模型由快时钟传到慢时钟由慢时钟传到快时钟亚稳态模型必须在建立时间和保持时间内，数据不变化，否则会产生亚稳态。
云影点灯大师·2024-01-27 15:32

【数字设计】经纬恒润_2023届_笔试面试题目分享

【数字IC精品文章收录】学习路线·基础知识·总线·脚本语言·芯片求职·EDA工具·低功耗设计Verilog·STA·设计·验证·FPGA·架构·AMBA·书籍【数字设计】经纬恒润_2023届_笔试面试题目分享一
张江打工人·2024-01-27 14:08

什么是 FPGA（现场可编程门阵列）？

现场可编程门阵列(FPGA)是一种半导体器件，由与可编程互连相结合的可配置逻辑块(CLB)网格构成。制造完成后，FPGA可以重新编程以满足特定功能或应用需求。
疯狂的泰码君·2024-01-27 14:36

为什么 FPGA 比 CPU 和 GPU 快？

FPGA、GPU与CPU——AI应用的硬件选择现场可编程门阵列(FPGA)为人工智能(AI)应用带来许多优势。图形处理单元(GPU)和传统中央处理单元(CPU)相比如何？
疯狂的泰码君·2024-01-27 14:32

联合 Maxlinear 迈凌 与 Elitestek 易灵思 - WPI 世平推出基于 FPGA 芯片的好用高效电源解决方案

近期WPI世平公司联合Maxlinear迈凌电源产品搭配Elitestek易灵思FPGA共同合作推出基于FPGA芯片的好用高效电源解决方案。
WPG大大通·2024-01-27 13:52

面试官亲述｜如何优雅地介绍自己的项目经历?

更何况，你做的项目是以月为单位算的，而面试官最多用30分钟来从你的简历上了解你的项目经验，所以你对项目的熟悉程度要远远超过面试官，所以你一点也不用紧张。
就要学Java·2024-01-27 12:55

上位机图像处理和嵌入式模块部署（极致成本下的图像处理）

联系信箱：[email protected]】目前，大家都习惯了特定的图像处理方式，要么是windows上位机来处理，要么是armsoc来进行处理，要么是fpga或者是nvidiagpu来对图像进行处理
嵌入式-老费·2024-01-27 09:54

【机组】基于FPGA的32位算术逻辑运算单元的设计（EP2C5扩充选配类）

个人主页：SarapinesProgrammer系列专栏：《机组|模块单元实验》⏰诗赋清音：云生高巅梦远游，星光点缀碧海愁。山川深邃情难晤，剑气凌云志自修。目录一、实验目的二、实验要求三、实验说明四、实验步骤实验一不带进位位逻辑或运算实验实验二不带进位位加法运算实验实验三带进位的加法运算实验实验四数据输入通用寄存器实验五寄存器内容无进位位左移实验实验六寄存器内容无进位位右移实验实验七32位ALU实
Sarapines Programmer·2024-01-27 09:48

xilinx FIFO使用总结

XilinxFIFO使用总结FIFO是我们在FPGA开发中经常用到的模块，在数据缓存和跨时钟域同步等都会有涉及。在实际工程使用前，我们需要熟悉掌握FIFOIP的配置过程及时序特点。
wuzhirui志锐·2024-01-27 03:58

订货项目表设计思路

老板提出这个需求后便让我自由发挥,所以我首先想到的就是参照电商项目设计,但是本身没有电商项目经验,便使用万能的搜索引擎.我首先想到订货项目表应该分为两大块,商品模块,订单模块.因为之前已经有用户模块了,
JAVA弑云·2024-01-27 00:50

（野火征途 Altera EP4CE10）硬件说明

本着不浪费的想法，且通过记笔记来监督自己.FPGAFPGA是一种可以重构电路的芯片，是一种硬件可重构的体系结构。通过编程，用户可以随时改变它的应用场景，它可以模拟CPU、GPU等硬件的各种并行运算。
一壶浊酒..·2024-01-26 23:01

从零到一：我的软件测试开发工程师之路

没有工作经验，也没有那些招聘岗位中要求的项目经验。想要找到一份自己喜欢又高薪的工作，确实有一定的难度。我本身对测试有一些基础的了解，对测试工作也比较有兴趣。
软件测试大空翼·2024-01-26 18:13

Xilinx 7系列FPGA Multiboot介绍

https://zhuanlan.zhihu.com/p/46239005在远程更新的时候，有时候需要双镜像来保护设计的稳定性。在进行更新设计的时候，只更新一个镜像，另一个镜像在部署之前就测试过没问题并不再更新。当更新出错时，通过不被更新的镜像进行一些操作，可以将更新失败的数据重新写入Flash。这样即使更新出错，也能保证设计至少可以被远程恢复。Xilinx的双镜像方案成为Multiboot。本文
非鱼知乐·2024-01-26 18:10

在爱尚实训能学好技术的原因

有的同学科班出身——计算机专业毕业，找工作的时候，发现好的企业都要有实习经验或者实际项目经验，自己这方面欠缺，所以为了提高技能学习，选择的多是java，算法这类的课程。之后都能达成进名企大厂的目标。
aishangxu·2024-01-26 17:07

vscode开发FPGA(1)---TEROS_HDL插件报错

一、TerosHDL:modelsim(vlog-66)报错Error:(vlog-66)Executionofvlib.exefailed解决办法：1.新建modelsim工程，并随意编译一个.v文件，将产生的work目录复制到modelsim安装路径下。2.再将vscode设置verilog>linting>modelsim>work的路径指定到此处。二、TerosHDL:modelsim(v
zidan1412·2024-01-26 12:31

AG32VF407 AGRV2K 开发环境搭建及Jlink烧录测试

视频讲解[AG32VF407]国产MCU+FPGAvscode+platformio环境搭建及Jlink烧录测试环境搭建及测试参考《AG32开发环境搭建.pdf》《AG32在VSCode下的使用入门_20230423
LitchiCheng·2024-01-26 12:59

AG32VF407 AGRV2K 串口printf调试输出

视频讲解[AG32VF407]国产MCU+FPGA串口printf调试输出及演示原理图测试代码新建一个platformio工程，复制如下文件到测试工程目录下E:\tech\AGM-AG32VF\sdk-release
LitchiCheng·2024-01-26 12:23

（12）Zynq CAN控制器介绍

1.1ZynqCAN控制器介绍1.1.1本节目录1）本节目录；2）本节引言；3）FPGA简介；4）ZynqCAN控制器介绍；5）结束语。1.1.2本节引言“不积跬步，无以至千里；不积小流，无以成江海。
宁静致远dream·2024-01-26 11:55

【FPGA Verilog开发实战指南】初识Verilog HDL-基础语法

这里写目录标题VerilogHDL简介与VHDL比较VerilogHDL基础语法逻辑值关键字moduleendmodule模块名输入信号输出信号既做输入也做输出线网型变量wire寄存器型变量reg参数parameter参数localparam常量赋值方式阻塞赋值非阻塞赋值always语句assign语句算数运算符归元运算符、按位运算符逻辑运算符关系运算符移位运算符位拼接运算符条件运算符优先级if-
醉酒柴柴·2024-01-26 09:31

FPGA高端项目：Xilinx Artix7系列FPGA多路视频拼接 工程解决方案 提供4套工程源码和技术支持

目录1、前言版本更新说明给读者的一封信FPGA就业高端项目培训计划免责声明2、相关方案推荐我已有的FPGA视频拼接叠加融合方案本方案在XilinxKintex7系列FPGA上的应用3、设计思路框架视频源选择
9527华安·2024-01-26 07:17

FPGA高端项目：Xilinx Zynq7020系列FPGA多路视频拼接 工程解决方案 提供6套工程源码和技术支持

目录1、前言版本更新说明给读者的一封信FPGA就业高端项目培训计划免责声明2、相关方案推荐我已有的FPGA视频拼接叠加融合方案本方案在XilinxKintex7系列FPGA上的应用本方案在XilinxArtix7
9527华安·2024-01-26 07:42

没有自动化测试项目经验，3个项目帮你走入软测职场！

学习自动化测试最难的是没有合适的项目练习。测试本身既要讲究科学，又有艺术成分，单单学几个API的调用很难应付工作中具体的问题。你得知道什么场景下需要添加显性等待，什么时候元素定位需要写得更加优雅，为什么需要断言这个元素，而不是另一个。你得有合适的页面控件才能练习某种操作。现在网上关于练习自动化的文章有很多，但是可以供学习使用的练习项目却非常稀缺。有的项目操作比较简单，无法达到练习各种操作的效果。有
测试店小二·2024-01-26 04:25

vivado 抓取信号：mark debug 和 ILA

目录前言一、通过添加markdebug1、进行综合2、抓取信号3、保存4、查看信号二、通过ILAIP核1.在Vivado的IP栏里添加ILA2.在需要用到的模块里例化ILA三、对比总结前言在对FPGA编程时
有点傻的小可爱·2024-01-26 03:49

Zynq项目中使用ILA（内置逻辑分析仪）分析信号

HowtoputanILAintoaZynqdeviceexample.AnILAisreallyusefulwhenyouwanttoseewhatthesignalsaredoinginsidetheFPGAsomaybeyoursimulationworksbutyoursynthesisdoesn'tandwhenyo
圆喵喵Won·2024-01-26 00:12

【初学者】FPGA中时钟和时序的概念（未完）

视频：FPGAClockandtimingconceptsexplainedsimplyforbeginnersusingtwoanalogies!
圆喵喵Won·2024-01-26 00:42

Zynq学习笔记：00 Vivado block diagram

v=UZ3FnZNlcWk1.新建工程，创建块设计并命名ZynqSoC由PS(ProcessingSystem)和PL(ProgrammableLogic)组成，PL相当于FPGA，PS相当于CPU。
圆喵喵Won·2024-01-26 00:41

硬件知识积累 电脑设备软关机与硬关机的区别

软关机的操作：比如使用CPU的关机程序，或者使用FPGA断掉一些主要的电源。（注意程序这个词！！！）2.我搜索文心一言的结果软关机和硬关机在操作方式
_She001·2024-01-25 22:42

前端面试篇，应届生面试时被问项目经验不用慌，按这个步骤回答成功率高达95%

一、html51、html常见面试题2、艺术喵2年前端面试心路历程（字节跳动、YY、虎牙、BIGO）|掘金技术征文3.前端100问：能搞懂80%的请把简历给我4、前端优化二、css1.CSS基础面试题2.如何居中div？3.CSS3新特性4.清除浮动5.media媒体查询6.讲一讲Flex布局，以及常用的属性？7.BFC8.pxrememvhvw之间的区别到底是啥？9.0.5px的线10.12px
沐子李青·2024-01-25 22:32

BGP路由反射-数据中心IDC项目经验

一、背景描述R1,R2,R3在AS200区域内，R1和R2,R1和R3建立OSPF，宣告接口互联.AS200区域内，R1和R2建立IBGP,R1和R3建立IBGPR2和R4建立EBGP,R3和R5建立EBGP。网络拓扑：二、故障现象R1和R2可以收到来自AS100区域R4的EBGP路由，R3上面看没有BGP路由，原因是什么？三、原因分析从R1设备上看BGP路由，可以看到来自R4通过EBGP的邻居R
OpenClouds·2024-01-25 14:38

一款相对比较强大的国产ARM单片机HC32F4A0

用久了之后就更喜欢用HC32F4A0，功能强大，外设使用灵活，用点向FPGA靠拢的感觉。我们公司用它来做全国产的伺服驱动器，对F4A0表现出的性能很满意。
紫气东来d·2024-01-25 08:37

fpga外置flash程序烧录流程

Fpga外置FLASH程序烧录流程：step1：打开vivado2019.2软件，找到hardwaremanager选项，进入该功能界面；Step2：确定连接状态，当JTAG正确连接到板卡的调试插针后，
笨笨的猪头三·2024-01-25 07:56

FPGA硬件架构

1.XilinxFPGA是异构计算平台（所谓异构，就是有很多不同的部分组成）：CLB,BRAM,DSP
燎原星火*·2024-01-25 07:22

FPGA硬件架构——具体型号是xc7k325tffg676-2为例

,2.1FPGA的Bank分为HPBank和HRBank，二者对电压的要求范围不同，HR支持更大的电压范围。一个只能同时接一组电压。
燎原星火*·2024-01-25 07:17

程序员面试技巧大揭秘：让你在众多竞争者中脱颖而出

程序员在面试过程中，除了展示自己的技术能力和项目经验，还需要注意一些面试技巧，以提高自己的面试表现和获得更好的工作机会。
wd90119·2024-01-25 06:15

ZYNQ-7020 集成了运行NI Linux Real‑Time的实时处理器,支持FPGA二次开发

模拟和数字I/O，667MHz双核CPU，512MBDRAM，512MB存储容量，Zynq-7020FPGACompactRIOSingle-Board控制器sbRIO‑9637是一款嵌入式控制器，在单块印刷电路板
深圳信迈科技DSP+ARM+FPGA·2024-01-25 01:07

LabVIEW之cRIO初探一

CompactRIO系统拥有坚固的硬件架构，其中包括：I/O模块、带有可重新配置的现场可编程门阵列（FPGA）的机箱、实
宣泠之·2024-01-24 23:09

NES（FC） FPGA游戏卡开发笔记（3）---- AGM AG32VF407开发环境的使用

AG32VF407是内带2KFPGA逻辑单元的MCU芯片。虽然目前不考虑这款FPGA芯片，因为是开发笔记，就记录一下我的学习使用过程。使用这个IDE就是想了解一下这块MCU到底如何使用的。
dire_777·2024-01-24 13:31

AGM AGRV2KQ32 超小封装FPGA---硬件设计要点

AGMAGRV2KQ32超小封装FPGA—硬件设计要点以下是AGRV2KQ32的引脚定义1、芯片的单电源3.3V供电，不需要1.2V；VDDA33和VDD33都接到3.3V电源。
HIZYUAN·2024-01-24 13:00

AGRV2K ——国产小封装FPGA与SOC的优选器件

AGRV2K与安路的小封装FPGA的逻辑资源相当，如AnlogicEF2L25AG42可以完全替代，成本低30%。并且AGRV2K还内置MCU，相当于买C
HIZYUAN·2024-01-24 13:00

AGM AG32 MCU与AGRV2K的应用

AGM从2021年开始推广MCU产品，目前AG32MCU，pin对pinSTM32MCU,另内置2KFPGA逻辑，可单独使用MCU或者FPGA功能，也可MCU+FPGA功能同时使用）。
HIZYUAN·2024-01-24 13:30

AGM CPLD AGRV2K 应用指南（一）

海振远科技是上海遨格芯微电子有限公司(AGM)的授权代理商和重要的合作伙伴，AGM授权海振远科技生产和推广AGMFPGA开发板和脱机烧录器，可以为客户提供快速的本地化服务和支持。
HIZYUAN·2024-01-24 13:29

AG32VF407 AGRV2K 开箱及STM32F407评估版对比

开箱视频[AG32VF407]国产MCU+FPGA开箱开箱清单：AG32VF407开发板x1USB转TypeC数据线x1名片x1杜邦线一把跳线帽x3从正面看和STM32F407的评估版基本一致（尺寸，布局
LitchiCheng·2024-01-24 13:28

激光雷达行业梳理2-产业链、公司、未来展望

其中上游即激光发射、激光接收、扫描系统和信息处理四大部分，主要包括激光器、探测器、扫描镜、FPGA芯片、模拟芯片，以及光学部件生产和加工商，是激光产业的基石，准入门槛较高。
奔袭的算法工程师·2024-01-24 11:15

数字信号处理-04- FPGA常用运算模块-除法器

写在前面本文是本系列的第四篇，本文主要介绍FPGA常用运算模块-除法器，xilinx提供了相关的IP以便于用户进行开发使用。
Vuko-wxh·2024-01-24 07:13

Intel Atom + Kintex-7 70T FPGA，8插槽CompactRIO控制器

1.60GHz四核CPU，4GBDRAM，4GB存储，-40°C至70°C，Kintex-770TFPGA，8插槽CompactRIO控制器cRIO-9047是一款坚固耐用、高性能、可自定义的嵌入式控制器
深圳信迈科技DSP+ARM+FPGA·2024-01-24 07:06
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