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Verilog语法——2.模块例化、运算符

参考资料【明德扬_verilog零基础入门语法HDL仿真快速掌握-手把手教你写FPGA/ASIC代码设计流程中的应用】2模块例化、运算符2.1模块例化2.1.1什么是模块例化例化，即将项目不断拆分成次级功能模块
鸥梨菌Honevid·2024-01-13 22:19

Verilog语法——4.Verilog工程模板、相应规范再强调

参考资料【明德扬_verilog零基础入门语法HDL仿真快速掌握-手把手教你写FPGA/ASIC代码设计流程中的应用】4.Verilog工程模板、相应规范4.1Verilog工程模板4.1.1设计模块模板
鸥梨菌Honevid·2024-01-13 22:19

Verilog语法——5.测试文件

参考资料【明德扬_verilog零基础入门语法HDL仿真快速掌握-手把手教你写FPGA/ASIC代码设计流程中的应用】5.测试文件5.1认识测试文件（testbench）testbench是一种验证的手段
鸥梨菌Honevid·2024-01-13 22:19

Verilog语法——3.模块设计实战

参考资料【明德扬_verilog零基础入门语法HDL仿真快速掌握-手把手教你写FPGA/ASIC代码设计流程中的应用】3模块设计实战3.1简单模块设计3.1.1需要实现的简单模块示例3.1.2简单模块实现代码写法一
鸥梨菌Honevid·2024-01-13 22:15

【XILINX】各系列FPGA的高速收发器速度及特点

概述xilinx收发器产品涵盖了当今高速协议的全部范围。GTH和GTY收发器提供要求严苛的光学互连所需的低抖动，并具有世界一流的自适应均衡功能以及困难的背板操作所需的PCS功能。Versal™ACAPGTY(32.75Gb/s)：针对延迟和功耗进行了优化VersalACAPGTM(58Gb/s)：针对最新的铜缆、背板和光纤接口进行了调整，支持PAM4和NRZVersalACAPGTM(112Gb/
神仙约架·2024-01-13 19:54

车规级芯片之 MCU、MPU、DSP、FPGA、SOC

1.概述随着处理器技术的不断发展，CPU(CentralProcessingUnit)的发展逐渐出现三种分支，分别是MCU(MicroControllerUnit，微控制器单元)和MPU（MicroProcessorUnit，微处理器单元）和DSP(DigitalSignalProcessing/Processor)数字信号处理器。MCU在应用中比较常见的就是ST的芯片，比如STM32，就是通常所
scott198512·2024-01-13 12:34

基于ZYNQ的千兆网项目(3)

基于ZYNQ的UDP实现项目简述UDP简述PL端设计PS端设计下板测试总结项目简述前面的文章讲解了TCP客户机与主机在ZYNQ上面的实现，其实说白了就是调用现成的API函数，这点与FPGA的设计其安全不同
朽月·2024-01-13 11:26

FPGA高端项目：纯verilog的 25G-UDP 高速协议栈，提供工程源码和技术支持

目录1、前言免责声明2、相关方案推荐我这里已有的以太网方案本协议栈的1G-UDP版本本协议栈的10G-UDP版本1G千兆网TCP-->服务器方案1G千兆网TCP-->客户端方案10G万兆网TCP-->服务器+客户端方案3、该UDP协议栈性能4、详细设计方案设计架构框图网络调试助手GT资源使用GTY--10GBASE-R*协议使用1G/2.5GEthernetPCS/PMAorSGMII使用25G-
9527华安·2024-01-13 11:55

FPGA 高端项目：基于 SGMII 接口的 UDP 协议栈，提供2套工程源码和技术支持

目录1、前言免责声明2、相关方案推荐我这里已有的以太网方案本协议栈的1G-UDP版本本协议栈的10G-UDP版本本协议栈的25G-UDP版本1G千兆网TCP-->服务器方案1G千兆网TCP-->客户端方案10G万兆网TCP-->服务器+客户端方案3、该UDP协议栈性能4、详细设计方案设计架构框图网络调试助手网络PHY1G/2.5GEthernetPCS/PMAorSGMII使用MAC层AXI4-S
9527华安·2024-01-13 11:21

FPGA难学在哪里，要如何学习？

对数字电路和逻辑设计有一定基础的话，入门FPGA可能相对容易一些。
宸极FPGA_IC·2024-01-13 10:58

服务员呼叫器Verilog代码远程云端平台Quartus

名称：服务员呼叫器Verilog代码远程云端平台Quartus软件：Quartus语言：Verilog代码功能：1.设计内容和要求(包括设计内容、主要指标与技术参数)设计内容:基于FPGA的服务员呼叫器的设计
FPGA代码库·2024-01-13 04:28

vivado交通灯设计verilog代码ego1板红绿灯时间可修改

FPGA代码Verilog/VHDL代码资源下载：www.hdlcode.com本代码已
FPGA代码库·2024-01-13 04:57

1、使用AX301开发板实现流水灯

该程序实现的效果是，下载到FPGA开发板后，LED0到LED3以此点亮，KEY4作为复位按钮，若按下则复位（异步复位），四个LED灯先同时点亮，然后再从LED0开始逐次点亮。
Fainyounger·2024-01-13 04:27

竞赛抢答器4路抢答器verilog，仿真视频、代码、AX301开发板

本代码已在AX301开发板验证，开发板资料：AX301开发手册.pdfFPGA代码资源下载网：hdlcode.
FPGA代码库·2024-01-13 04:27

编译开源软件vtr-verilog-to-routing遇到的一点问题

vtr-verilog-to-routing介绍Verilog-to-Routing（VTR）项目是一个全球性的合作项目，旨在提供一个开源框架，用于进行FPGA架构和CAD研究和开发。
从此不归路·2024-01-13 02:57

阿里云 云服务器ECS类产品汇总，各云产品的产品简介及适用场景介绍

阿里云云服务器ECS类产品并不是只有云服务器和轻量应用服务器两种产品，还包括弹性裸金属服务器、GPU云服务器、专有宿主机、FPGA云服务器、VMware服务等产品和服务均属于云服务器ECS类云产品，本文为大家介绍一下哪些云产品属于云服务器
阿里云最新优惠和活动汇总·2024-01-13 01:57

3D scanner with DLPC3478

109fb20ee1f39e5212cd7a443a0286c5因数：分别率波长pattern速度DMD与DLPC匹配3Dscanner是结构光的概念走的Internalpattern,是DLPC内部提供图像给DMDExternalPattern,外部FPGA
Kent Gu·2024-01-12 19:07

Fpga开发笔记（一）：高云FPGA芯片介绍，入手开发板套件、核心板和底板介绍

article/details/135551179红胖子网络科技博文大全：开发技术集合（包含Qt实用技术、树莓派、三维、OpenCV、OpenGL、ffmpeg、OSG、单片机、软硬结合等等）持续更新中…FPGA
长沙红胖子Qt软件开发·2024-01-12 16:52

FPGA UDP协议栈：基于88E1111，支持RGMII、GMII、SGMII三种模式，提供3套工程源码和技术支持

目录1、前言免责声明2、相关方案推荐我这里已有的以太网方案本协议栈的1G-UDP版本本协议栈的10G-UDP版本本协议栈的25G-UDP版本1G千兆网TCP-->服务器方案1G千兆网TCP-->客户端方案10G万兆网TCP-->服务器+客户端方案3、该UDP协议栈性能4、详细设计方案设计架构框图网络调试助手网络PHYIDELAYE源语1G/2.5GEthernetPCS/PMAorSGMII使用M
9527华安·2024-01-12 15:31

Microsemi Libero系列教程（全网首发）

MicrosemiSmartFusion系列FPGA简介SmartFusion系列ARM部分开发教程：SmartFusion从FPGA到ARM系列教程MicrosemiFPGA开发工具安装包所有版本官方下载链接系列教程
whik1194·2024-01-12 11:35

7 Series FPGAs Transceivers Wizard(3.6) ip核接收数据正确性判断

详见7SeriesFPGAsTransceiversWizard(3.6)datasheetP321.
yundanfengqing_nuc·2024-01-12 09:20

zynq7010/zynq7020系列FPGA的输入输出延时、建立保持时间（setup/hold）

zynq7010/zynq7020系列FPGA的输入输出延时、建立保持时间（setup/hold）——zynq7000系列的建立保持时间需要从其开关特性手册中查询，本文参考了ds187手册中的相关内容，
大功率灯泡·2024-01-12 09:19

关于基于Lattice Crosslink-NX系列FPGA用于图像采集、桥接和处理的应用总结分享

作者：Hello，PandaLatticeCrosslink-NX系列FPGA的定位仍然还是主要面向接口桥接类的应用，虽然它的逻辑已经到了39K的规模，但其处理能力仍然偏弱，特别是存在以下几个很大的短板
_Hello_Panda_·2024-01-12 09:47

Zynq 电源

PS系统部分的电源和PL逻辑部分的电源都有上电顺序，不正常的上电顺序可能会导致ARM系统和FPGA系统无法正常工作。PS部分的电源有VCCPINT、VCCPAUX、VCCPLL和PSVCCO。
乾 乾·2024-01-12 09:16

008-关于FPGA/ZYNQ直接处理图像传感器数据输出的若干笔记（裸板采集思路）

文章目录前言一、图像传感器厂商二、图像传感器的参数解析三、图像传感器中的全局曝光和卷帘曝光四、处理传感器图像数据流程1.研究当前图像传感器输出格式2.FPGA处理图像数据总结前言最近也是未来需要考虑做的一件事情是
技术小董·2024-01-12 09:15

在Vivado下利用Tcl实现IP的高效管理

一种是创建FPGA工程之后，在当前工程中选中IPCatalog，生成所需IP，这时相应的IP会被自动添加到当前工程中；另一种是利用ManageIP，创建独立的IP工程，缺省情况下，IP工程的名字为magaged_ip
斐非韭·2024-01-12 09:15

aigc修复美颜学习笔记

目录GFPGAN进行图像人脸修复美颜修复畸形手势GFPGAN进行图像人脸修复原文：本地使用GFPGAN进行图像人脸修复_人相修复处理网页csdn-CSDN博客人脸修复1.下载项目和权重文件2.部署环境3
AI视觉网奇·2024-01-12 00:00

合工大苍穹战队视觉组培训Day5——机器学习，图像识别项目

现在手里做了三个项目不过大多差不多，一个是FPGA的图像增强，主要是做去雾处理；一个做视觉引导机械臂；一个是FPGA的神经网络搭建。
工大电科小趴菜·2024-01-11 21:40

FPGA图形化前仿真

引言上文提到电路连接如下：期望结果如下：一.创建wrapper文件1.创建HDLwrapper；2.要是该文件不是顶层（setastop），则需要把文件置于顶层二.综合1.综合的目的主要是排除语法的错误；2.内存使用和性能进行了优化等等三.写前仿真激励文件四.测试文件`timescale1ns/1ps////Company://Engineer:////CreateDate:2024/01/111
我来挖坑啦·2024-01-11 19:19

智能芯片与系统基础知识（AI芯片）

权重–突触，偏置–阈值，激活函数–神经元2.AI芯片的种类有哪些CPUGPUFPGAASIC
youngbarry·2024-01-11 16:32

在FPGA上搭建Cortex-m3软核

在FPGA上搭建Cortex-m3软核前言说是在fpga上搭建，其实还是比较偷懒了，在Vivado上进行搭建，比较方便。
黄铠杰echo·2024-01-11 16:32

FPGA的电平标准

FPGA的电平标准标准介绍标准介绍TTL：三极管单端输出（FPGA板子上的IO电平标准）几十MHZCMOS：MOS管单独输出，功耗低，翻转快（<150MHZ）LVDS：低压差分信号LVPECL:高速差分
云影点灯大师·2024-01-11 13:51

Triumphcore FPGA调测试记录

FPGA采用XilinxpynqZ2开发板。
KGback·2024-01-11 13:50

ASIC与FPGA哪个前景好？FPGA有必要转ASIC吗？

ASIC和FPGA选哪个好？两者的流程有什么区别？FPGA有必要转ASIC设计吗？
宸极FPGA_IC·2024-01-11 11:26

FPGA开发项目限时免费！

在科技飞速发展的今日，FPGA（现场可编程门阵列）技术作为核心的支撑力量，在多个领域扮演着不可或缺的角色。而作为科技先锋的您，是时候把握时代机遇，成为这个高速成长领域的翘楚了！
宸极FPGA_IC·2024-01-11 11:56

fpga的设计流程【科普】

一般来说，完整的FPGA设计流程包括电路设计与输入、功能仿真、综合优化、综合后仿真、布局布线、布局布线后仿真、板级验证与加载配置调试等主要步骤。
宸极FPGA_IC·2024-01-11 11:56

国产FPGA厂商有哪些？

FPGA，万能芯片！以其强大的并行计算能力、功能灵活可定制等优点，被广泛应用于通信、医疗、电力、军工等高速、大数据的领域，以及IC和ASIC设计原型验证系统等。
宸极FPGA_IC·2024-01-11 11:56

fpga目前就业形势咋样?

FPGA今年各厂给本科生的薪资大概是15-30K，研究生是20-40K，平均薪资在25k左右，当然具体薪资还要看去哪个公司，哪个城市，以及个人的学校、专业、能力水平、及包括面试时的表现，运气等，这些都会导致开出的薪资差比较大
宸极FPGA_IC·2024-01-11 11:24

EBAZ4205矿渣板zynq无法加载固件

1.故障现象：板子上电后无法加载固件，FPGAconfig_done指示灯不亮，JTAG可以扫描到PL和PS。
bifudoph·2024-01-11 10:11

矿渣板EBAZ4205上电后能够启动固件，JTAG无法扫描到PL和PS

1.故障现象板子上电后，fpga的configdone灯点亮，固件可以正常启动。但是使用JTAG无法在VIVADO中扫描到ZYNQ的PL和PS。
bifudoph·2024-01-11 10:11

FPGA设计Verilog基础之数据类型的作用和特点、常量和变量的代码示例详解

注意：后续技术分享，第一时间更新，以及更多更及时的技术资讯和学习技术资料，将在公众号CTOPlus发布，请关注公众号：CTOPlus在Verilog中，有多种数据类型可供使用，包括位向量类型、整数类型、实数类型、布尔型、时间类型和字符串类型等。下面详细介绍Verilog的所有数据类型、常量和变量的定义和使用方法。整型和实型用于表示数字，布尔型用于表示逻辑值。向量型用于表示多位数据，例如：reg[7
SteveRocket·2024-01-11 08:30

pcie应用记录 - pcie中断

项目场景：（1）fpga与国产龙芯3A3000cpu主板通过pcie总线进行通信；（2）主板采用rework国产实时嵌入式操作系统，fpga部分为xlinxa7系列及xilinx7xpcieip核；（3
zzyde2021·2024-01-11 08:30

pynq？启动！ pynq开发板连接宿主机+初始配置

前言：pynq架构介绍“用FPGA写了个外挂，被暴雪认定是非法第三方程序用的PYNQ+STM32，PYNQ负责从HDMI截图并用OpenCV算法找到目标，并把坐标发给STM32。
物质波波波·2024-01-11 08:29

基于FPGA的aes-128工程文件

前篇的aes-128实现文章的top层文件存在一点小BUG，下面的工程是优化后，而且包含了modelsim仿真文件，直接在modelsim上do该目录tb文件下的time_aes_top.do，即可仿真。下载链接：https://download.csdn.net/download/wyong0306/88398164
wyong0306·2024-01-11 08:28

基于intel(altera)FPGA OV5640摄像头 图像采集系统（完整代码）

此项目一共分为摄像头配置模块，图像采集模块，异步FIFO控制模块，SDRAM控制模块，SDRAM端口模块，VGA显示模块。摄像头配置模块直接采用IIC接口对摄像头进行配置：模块分化：IIC端口模块，IIC控制模块，和LUT查找表模块；配置图像像素输出为1280*720摄像头配置参数//涉嫌头参数配置-LUT模块modulelut_da(inputclk,inputrst_n,inputredy,/
wyong0306·2024-01-11 08:58

基于FPGA的密码锁

1.设计原理及要求基于FPGA实现的数字密码锁设计中，主要包括4大部分：FPGA器件、密码存储、译码电路、报警电路。
夜幕下的灯火·2024-01-11 08:56

一种OFDM调制解调器的FPGA实现

正交频分复用(OFDM)技术由于可以在提高数据传输速率的同时有效地对抗符号间干扰(ISI)，被广泛认为是高速数字传输的首选调制技术。目前OFDM已是欧洲数字音频／视频广播(DAB／DVB)、IEEE802．1la无线局域网(WLAN)的核心调制技术，而且有望成为3Gbeyond/4G的关键技术。在OFDM逐渐成熟的今天，如何降低通信系统的成本，使之能广泛的应用于数据传输系统当中，也成为OFDM研究
xl@666·2024-01-11 08:55

基于 Xilinx UltraScale 系列 PCIe 3.0 硬核的 NVMe IP 核

产品特点1.纯FPGA逻辑实现，物理层使用XilinxUltraScale系列PCIe核，基于自研高性能存储板卡（KU060芯片、**PCIe3.0X4接口**、三星970PCIeSSD）开发并充分验证
三角芯科技·2024-01-11 08:51

第一章、正交频分复用系统的基本原理-基于XILINX FPGA的OFDM通信系统基带设计

在信息时代的今天,通信技术在各种信息技术中起着支撑作用。人类社会对通信的需求越来越高,希望能够更加方便快捷地获取信息和进行沟通。因此,世界各国都在致力于现代通信技术的研究与开发和现代通信网的建设。而无线通信以其独特的便利性更是得到了人们的格外青睐。特别是在过去的十余年时间里,在数字信号处理、射频电路制造技术和半导体技术的推动下,无线通信获得了巨大的发展,便携移动设备变得更小、更便宜、更可靠。毫无疑
BinaryStarXin·2024-01-11 08:49

xilinx FPGA 乘法器ip核（multipler）的使用（VHDL&Vivado）

一、创建除法ip核可以选择两个变量数相乘，也可以选择一个变量输入数据和一个常数相乘可以选择mult（dsp资源）或者lut（fpga资源）可以选择速度优先或者面积优先可以自己选择输出位宽还有时钟使能和复位功能二
坚持每天写程序·2024-01-11 08:49
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