紫光同创FPGA开发笔记

夏天与孩子一起在陶艺中留下难忘的时光吧。

在玩乐中渗入教育——与孩子去一个美好的地方，共同创造作品，虽然笨拙但珍贵，更凝聚了那段
李茜茜·2024-01-03 01:10

【转】为什么FPGA难学？是因为你还没搞清背后的根源

经常看到有初学者的提问，本人零基础，想学FPGA，求有经验的人说说，我应该从哪入手，应该看什么教程，应该用什么学习板和开发板，看什么书等，希望有经验的好心人能够给我一些引导。FPGA到底怎么学呢？
刻一·2024-01-02 22:08

FPGA——三段式状态机(1)

状态机全称是有限状态机（FiniteStateMachine、FSM），是表示有限个状态以及在这些状态之间的转移和动作等行为的数学模型。状态机可根据控制信号完成预定的状态转换，由组合逻辑电路和寄存器组成，可由状态转换表或状态转换图描述。输出只和当前状态有关而与输入无关成为Moore型状态机，输出和当前状态、输入都有关称为Mealy型状态机。1、状态机标准好的状态机的标准很多，最重要的几个方面如下：
发光中请勿扰·2024-01-02 19:44

FPGA 状态机(FSM)的三段式推荐写法

用一段式建模FSM的寄存器输出的时候，必须要综合考虑现态在何种状态转移条件下会进入哪些次态，然后在每个现态的case分支下分别描述每个次态的输出，这显然不符合思维习惯；而三段式建模描述FSM的状态机输出时，只需指定case敏感表为次态寄存器，然后直接在每个次态的case分支中描述该状态的输出即可，根本不用考虑状态转移条件。本例的FSM很简单，如果设计的FSM相对复杂，三段式的描述优势就会凸显出来。
neufeifatonju·2024-01-02 19:44

FPGA系统性学习笔记连载_Day16【状态机：一段式、二段式、三段式】 【原理及verilog仿真】篇

一、状态机再次给出状态机的示意图：1.1、摩尔型，输出只与状态寄存器的输出状态有关1.2、米粒型，输出不仅与状态寄存器的输出状态有关，还与组合逻辑的输入有关二、一段式、二段式、三段式区别根据状态机的结构，状态机描述方式可分为：一段式、二段式、三段式1.1、一段式整个状态机写到一个always模块里面。在该模块中既描述状态转移，又描述状态的输入和输出。1.2、二段式用两个always模块来描述状态机
ONEFPGA·2024-01-02 19:43

【二段式状态机】 fsm 输出打一拍写法

https://blog.csdn.net/ONEFPGA/article/details/125297745fsm2processmoduleauto_sell(inputclk,inputrst_n
黄埔数据分析·2024-01-02 19:43

HPM6750开发笔记《GPIO例程深度解析》

目录创建工程：代码分析：1.头文件包含：2.宏定义：3.中断服务程序（ISR）：清除中断标志：处理LED状态切换：处理用户按键状态：处理其他情况：4.voidtest_gpio_input_interrupt(void):打印提示信息：初始化LEDGPIO：配置GPIO引脚为输入模式：配置中断触发类型：启用GPIO中断：设置中断优先级：进入低功耗模式：5.voidtest_gpio_toggle_
Vizio＜·2024-01-02 19:11

谢庄吟唱怀乡曲，字里行间溢深情｜云游汉魏六朝诗苑(25)

历仕宋文帝、宋孝武帝、宋明帝三朝，官至中书令，加金紫光禄大夫，世称“谢光禄”。诗作遗存传世不多，笔调清雅凝炼。山水人家怀园引鸿飞从万里，飞飞河岱起。辛勤越霜雾，联翩溯江泛。
三峡孬张·2024-01-02 16:25

2024上海国际月子健康博览会暨会议：开启宝宝健康新时代

时间：2024年8月7-9日地点：上海新国际博览中心（龙阳路2345号）主办单位：月子健康博览会组委会上海信世展览服务有限公司支持单位：中科院上海营养与健康研究所江南大学食品安全与营养协同创新中心上海保健品协会上海市食品协会上海医药商业行业协会上海市食品安全工作联合会阿里健康同期展会
yule0206·2024-01-02 16:24

运个货喜获君联资本领投「亿元A轮融资」

8月12日，我们很荣幸来宣布获得了由「君联资本」领投的亿元A轮融资，本轮投资者包括了现有的投资人真格基金以及同创伟业，这也是我们这一年来获得的第4笔融资。
运个货·2024-01-02 13:02

FPGA1—ROM存储经千兆以太网口到Qt上位机显示2022-10-23

1.场景：将存储在FPGA片上BlockRAM中的图片数据通过网口传输到上位机显示，目标是FPGA通过网口发送图片，其大小为1920*1200，位深为8bit，30fps,上位机可以实时显示即可。
晓晓暮雨潇潇·2024-01-02 13:49

C1--Vivado配置VS Code文本编辑器环境2022-07-21

文本编辑器有很多选择，例如Notepad、SublimeText、VSCode等，选择一款适合自己的编辑器，有助于养成自己的代码风格并为FPGA开发提供极大方便。
晓晓暮雨潇潇·2024-01-02 13:48

E10—10G subsystem Ethernet IP实现万兆以太网上下位机通信

1.简介当前多数PC集成的网卡多数是千兆以太网卡，因此通过介质实现PC与FPGA的通信需要使用专用的转接卡，转接卡就是将光介质进来的数据通过PCIE接口传递给CPU，以此实现通信。
晓晓暮雨潇潇·2024-01-02 13:46

中科亿海微UART协议

FPGA（现场可编程门阵列）作为一种灵活可编程的硬件平台，为实现高度定制化的UART通信提供了强大的功能。本文旨在介绍FPGA中UART协议的实现原理和技术细节。
小五头·2024-01-02 09:48

离开与重逢

而是有一些内心深处的我们无法言说的事情或是信守它重过了眼前的这份情感，我们都没有办法，只好等，等到有一天这情感加温发热爆发了，那一刻，它，终于压过了一切，让我们奋不顾身，甚至撕碎了自己从前的那份坚守，是为了让我们共同创立一个新的信念
铁扇喝茶·2024-01-02 07:47

书籍分享 | 分享一本FPGA开发学习书籍

《基于FPGA的数字图像处理原理及应用》是一本专注于数字图像处理领域的经典著作。
SteveRocket·2024-01-02 06:19

移动FPGA使用Verilog图像处理verilator模拟和ice40执行

该项目围绕一个中央图像处理模块image_processing.v展开，该模块可以包含在使用verilator的模拟环境中，也可以包含在ice40Ultraplusfpga的top.v中。
亚图跨际·2024-01-02 00:50

Verilog视频信号图形显示 FPGA(iCE40)

您需要一块带视频输出的FPGA板。我们将在640x480下工作，几乎任何视频输出都可以在此像素工作。它有助于轻松地对FPGA板进行编程并相当熟悉Verilog。
亚图跨际·2024-01-02 00:17

正点原子FPGA学习笔记1——搭建一个时钟IP核，基于达芬奇开发板 A7

目录实验要求:1.电荷泵锁相环(CPPLL)，重要名词：PFD、CP、LF、VCO2.AXI4-Lite协议、DRP接口——动态调整输出时钟频率的作用3.查看时钟输出实验要求:正点原子，利用时钟IP核，得到4个时钟输出：1.电荷泵锁相环(CPPLL)，重要名词：PFD、CP、LF、VCO学习文章地址：http://t.csdn.cn/SYGIr2.AXI4-Lite协议、DRP接口——动态调整输出
Sean--Lu·2024-01-01 23:52

数字逻辑与计算机设计实验 FPGA数字钟(Verilog)

改自wolai笔记FPGA数字钟(Verilog)项目源代码已上传至github：houhuawei23/DDCA_2022目录实验9FPGA数字钟实验分析：实现思路：硬件支持：硬件描述语言代码编写：1
华仔142·2024-01-01 23:52

FPGA项目（13）——基于FPGA的电梯控制系统

随着EDA技术的发展，FPGA已广泛应用于各项电子设计中，本设计即利用FPGA来实现对电梯控制系统的设计。
嵌入式小李·2024-01-01 23:22

fpga加载程序慢_FPGA设计经验谈 —— 10年FPGA开发经验的工程师肺腑之言

FPGA设计经验谈——10年FPGA开发经验的工程师肺腑之言2014年08月08日作者：friends从大学时代第一次接触FPGA至今已有10多年的时间。
张腾岳·2024-01-01 23:22

基于Basys3设计的FPGA多功能电子琴

基于Basys3设计的多功能电子琴——复旦大学《数字逻辑基础(H)》2022年秋设计报告文章目录基于Basys3设计的多功能电子琴——复旦大学《数字逻辑基础(H)》2022年秋设计报告一，项目简介1.1项目描述1.2项目背景1.3独立设计声明二，硬件设计思路2.1Basys3开发板2.1.1琴键分配——参考古筝2.1.2模式选择开关2.1.3总体分配图2.2VGA2.3蜂鸣器三，代码编写思路3.1
冯之烨·2024-01-01 23:51

FPGA/数字IC手撕代码8——秒表计数器

深度学习/机器视觉/数字IC/FPGA/算法手撕代码目录总汇目录秒表计数器1.程序2.测试3.仿真结果4.分析
fpga和matlab·2024-01-01 23:21

FPGA项目（14）——基于FPGA的数字秒表设计

1.功能设计设计内容及要求:1.秒表最大计时范围为99分59.99秒2.6位数码管显示，分辨率为0.01秒3.具有清零、启动计时、暂停及继续计时等功能4.控制操作按键不超过二个。2.设计思路所采用的时钟为50M，先对时钟进行分频，得到100HZ频率的信号，然后在该信号的驱动下，对秒表的各个单位进行累加分频的代码为：modulefenpin(inputclk_in,//输入的时钟50Minputrs
嵌入式小李·2024-01-01 23:19

Cocos2d-x 开发笔记

1.判断操作系统平台类型根据Cocos2d-x源码可以获得所支持的平台类型C++cocos2d\platform\CCPlatformConfig.h#ifndef__CC_PLATFORM_CONFIG_H_#define__CC_PLATFORM_CONFIG_H_/**Configofcocos2d-xprojectpertargetplatform*////////////////////
JunChow520·2024-01-01 23:29

【2023年终总结】 | 时光之舟：乘载着回忆与希望穿越2023，抵达2024

文章目录1回忆2希望1回忆2023年对我来说是非常梦幻的一年，我在2023年初的时候确认去做AI方向，在这之前我尝试了前端开发，移动App开发，云FPGA等方向，但是感觉自己都不是很喜欢，然后就开始尝试新的方向
Qodi·2024-01-01 19:01

LMX2571 芯片配置Verliog SPI驱动

前言本实验使用ZYNQ的PL(FPGA)对LMX2571芯片进行配置，以下连接为相关的原理和软件使用资料。
伊丽莎白鹅·2024-01-01 17:09

Intel金融加速卡计算库及FPGA期权定价应用

作者：喻伟东方证券FPGA加速应用负责人/黄琦IntelFPGA金融加速产品经理联系邮箱：[email protected]/个人微信号：yuwei_1119近年来，在互联网、大数据、人工智能和云计算为代表的现代科技迅猛发展下
yuwei1119·2024-01-01 17:52

FPGA时序分析与约束（0）——目录与传送门

一、简介关于时序分析和约束的学习似乎是学习FPGA的一道分水岭，似乎只有理解了时序约束才能算是真正入门了FPGA，对于FPGA从业者或者未来想要从事FPGA开发的工程师来说，时序约束可以说是一道躲不过去的坎
apple_ttt·2024-01-01 13:23

常见时钟约束（源同步）

FPGA和外部芯片的同步通信接口，根据时钟来源可以分为系统同步接口和源同步接口。FPGA与外部芯片之间的通信时钟都由外部同一时钟源（系统时钟）产生时，称为系统同步接口。
be to FPGAer·2024-01-01 12:17

基于FPGA的时钟（简易版）

实现功能：1.上电后从00-00-00开始计时；2.通过串口可以改变时钟，同时以修改后的数值为基础继续计时；欢迎大家一起探讨！！！//-----------------------------------------------------------------------------//Copyright(c)2022-2023Allrightsreserved//--------------
be to FPGAer·2024-01-01 12:17

莫林讲团体治疗中的十四个原则 （整理不当的地方请各位同行批评指正）

我们是跟她一起共同创造、共同建构这样一种关系。我会把我自己尽可能完整的放到和来访者的这个
九思猫·2024-01-01 05:34

Tri Mode Ethernet MAC的配置及使用

以太网技术是当今被广泛应用的网络技术之一，XilinxFPGA提供了可参数化、灵活配置的千兆以太网IPCore解决方案，可以实现以太网链路层和物理层的快速接入。
卖红薯的小孩·2024-01-01 02:47

FPGA平台以太网学习：涉及1G/2.5G Ethernet 和Tri Mode Ethernet MAC两个IP核的学习记录（二）——IP学习使用

文章目录一、传输速率二、网口标准选择三、核功能选择四、共享逻辑五、总结（重点）  学习不能稀里糊涂，要学会多思考，发散式学习以及总结：  FPGA作为一种器件，只是实现目的的一种方法，过度追求实现的技术细节
FPGA_青年·2024-01-01 02:44

FPGA平台以太网学习：涉及1G/2.5G Ethernet 和Tri Mode Ethernet MAC两个IP核的学习记录（三）——接口与框架

文章目录一、IP核接口介绍二、框架搭建学习不能稀里糊涂，要学会多思考，发散式学习以及总结：  FPGA作为一种器件，只是实现目的的一种方法，过度追求实现的技术细节(用hdl还是hls，用啥芯片，用啥接口
FPGA_青年·2024-01-01 02:44

FPGA平台以太网学习：涉及1G/2.5G Ethernet 和Tri Mode Ethernet MAC两个IP核的学习记录（四）——实例仿真分析

文章目录一、时钟二、复位三、配置（回环测试还是外接）四、状态（链路状态）五、数据、使能  学习不能稀里糊涂，要学会多思考，发散式学习以及总结：  FPGA作为一种器件，只是实现目的的一种方法，过度追求实现的技术细节
FPGA_青年·2024-01-01 02:44

FPGA平台以太网学习：MAC与PHY间通信

文章目录一、物理层PHY介绍二、SGMI在以太网中的应用三、以太网中使用GT高速接口一、物理层PHY介绍1、PHY（物理层）：  MII/GMI/RMII/RGMII/SGMIII（介质独立接口子层），PLS/PCS（物理编码子层），PMA（物理介质连接子层），PMD（物理介质相关子层），AN（自动协商），MDI（媒介相关接口）。2、PLS/PCS（物理编码子层）：  (PLS)对MAC给的信息进
FPGA_青年·2024-01-01 02:14

FPGA——HC-05蓝牙串口实验

HC-05蓝牙模块买来的模块背面就长这样子，总共有六个引脚，实际只用四个脚（RXD、TXD、GND和VCC）就可以进行数据的收发，以默认的9600bps的波特率，由于目前项目对速度要求不高，因此也没有深入研究AT指令等。关于蓝牙模块的协议其实就是一个串口协议，在蓝牙配对成功后，就相当于以无线的方式进行串口通信。关于串口协议可参考我之前的一篇博客：串口回环蓝牙串口实验做这个实验的目的就是更好地理解蓝
Spider X·2024-01-01 02:13

ZYNQ使用Tri Mode Ethernet MAC千兆网光通信

一，原理SFP接口的FPGA开发板可以通过安装SFP转RJ45模块或者直接通过光纤进行以太网通信。
寒听雪落·2024-01-01 02:12

基于低功耗蓝牙和微信小程序的门禁系统(FPGA课设设计)

基于低功耗蓝牙和微信小程序的门禁系统(FPGA课设设计)文章目录基于低功耗蓝牙和微信小程序的门禁系统(FPGA课设设计)一、低功耗蓝牙(BLE)的配置和与FPGA通信代码1.1低功耗蓝牙的介绍及配置1.2
A DOG BY MY SIDE·2024-01-01 02:11

FPGA--ZCU106通过SFP+/SGMII模块传输数据-第一讲（全网唯一）

1引言距离上次文章已经过去了一个半月，但并没有停止研究fpga的脚步，今天给大家带来的是基于ZCU106开发板的通过SFP+/SGMII口通过光纤或网线与PC机传输数据的内容，本系列教程计划写三篇，如有不对之处还请海涵
发光的沙子·2024-01-01 02:10

8—基于FPGA(ZYNQ-Z2)的多功能小车—软件设计—寻迹模块、寻光模块、跟随模块

目录1.寻迹模块2.寻光模块3.跟随模块1.寻迹模块寻迹模块的实现需要两个TCRT5000传感器。简单地说，检测到黑线输出低电平，检测到白线输出高电平。因此两个TCRT5000放在黑色地面的白线循迹线左右，左边检测到白线左转，右边检测到白线右转，都是黑的前进，都是白线停止。算法比较容易实现。OUT信号输出，黑色为0，白色为1VCC5V供电GND接地代码如下：//寻迹模式elseif(data==8
贡橙小白鼠·2024-01-01 02:38

9—基于FPGA(ZYNQ-Z2)的多功能小车—拓展功能—OpenMV的色块识别

由于之前的红外遥控已经外接了Arduino，因此我依然借助Arduino对红绿蓝进行编码，使用两个IO实现信息传递，在FPGA上进行译码，最后根据对应的信息实现数码管显示。流程如下:2
贡橙小白鼠·2024-01-01 02:38

1—基于FPGA(ZYNQ-Z2)的多功能小车—硬件设计—电源模块

目录1.稳压模块设计1.1LM317可调稳压1.2LM2596-5V1.3AMS1117-3.3V2外围电路设计3.电源模块原理图1.稳压模块设计我们的小车使用7.4V的锂电池供电，无法直接为各模块和FPGA
贡橙小白鼠·2024-01-01 02:08

2—基于FPGA(ZYNQ-Z2)的多功能小车—硬件设计—电机驱动模块(TB6612FNG)

目录1.驱动电路2.TB6612FNG介绍3.电路原理图1.驱动电路FPGA的引脚电流都比较小，一般为几十微安，但是驱动电机的电流远大于此。因此需要一个电机驱动模块来作为桥梁，连接FPGA与电机。
贡橙小白鼠·2024-01-01 02:08

4—基于FPGA(ZYNQ-Z2)的多功能小车—软件设计—电机驱动模块

我使用的FPGA是Xilinx的PYNQ-7020（ZYNQ-Z2），在Vivado2018.3平台使用Verilog进行编程。
贡橙小白鼠·2024-01-01 02:08

10—基于FPGA(ZYNQ-Z2)的多功能小车—软件设计—顶层代码

在之前的文章中具体控制代码已经全部进行了分析与解释，顶层模块进行模块的输入输出的定义、内部变量的定义、模块的实例化与蓝牙信号的判断。代码如下：moduletop_modlue(inputclk,//系统时钟inputreset,//复位按键inputrx,//蓝牙接收inputwire[3:0]signal,//红外信号inputwireEcho,//超声波接收input[3:0]track,//
贡橙小白鼠·2024-01-01 02:08

0—基于FPGA(ZYNQ-Z2)的多功能小车

目录1.题目2.题目分析：3.器件使用4.工程文件5.传送门1.题目基于FPGA的多功能小车1、基本要求设计一个多功能的智能小车，通过多传感器的数据融合可以实现智能小车的红外避障、循迹、寻光、红外遥控、
贡橙小白鼠·2024-01-01 02:37

Verilog跑马灯 nexy4ddr

基于小梅哥b站FPGA视频要求：八个Led灯每隔0.05s循环闪烁verilog设计：moduleled_run(inputclk,//时钟100MHZ1/100000000=10nsinputrst_n
夏澄啊·2024-01-01 02:07
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