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视频图像
处理 FFmepg OpenGLES OpenCV开发详细内容
1音视频开发基础2AndroidOpenGLES开发基础3AndroidFFmpegOpenGLES音视频播放器核心开发4AndroidFFmpegH.264AAC封装mp45AndroidOpenCV机器学习人脸标定SDK开发实战6AndroidOpenCV开发实践7Android短视频AppFFmpegOpenGLESOpenCV人脸特效渲染引擎开发实战
chenchao_shenzhen
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2023-07-17 17:46
android
解析使用
FPGA
逻辑实现FIR滤波器的几种架构
二、运用
FPGA
实现FRI滤波器的几种结构2.1串行结构
希言自然也
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2023-07-17 16:47
信号处理原理
#
数字滤波器
FPGA
fpga开发
[
FPGA
入门笔记]（二）：LED呼吸灯实验
1、简介今天购买了AXLINXAX7020的开发板，从今天开始每一个例程都要做文档记录，为自己加油。本实验，基于ALINXAX7020开发板，芯片为xc7z020clg400-2。项目介绍：呼吸灯，就是想人们呼吸频率的一种led灯亮灭的一种表现形式。过程是慢慢变亮，然后变亮以后又慢慢变灭的一种过程。很多初学者会认为硬件逻辑语言怎么能控制电流的高低呢，让灯有多亮就调多亮，所以觉得不好实现，其实不用担
请叫我贾小瑞
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2023-07-17 16:43
FPGA入门笔记
fpga
芯片
注册Opencores无法点击submit办法解决（终极办法，巨有用）
对于很多
fpga
初学者而言，需要一个很好的开源网站去学习，其中opencores作为最大的开源网站，里面包括了很多开源资源共初学者学习，为了能够很好的解决opencores没办法注册的问题，现将我的解决办法分享下来
小阿成冲冲冲
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2023-07-17 16:11
fpga开发
硬件工程
使用Verilog实现
FPGA
双列电梯控制系统
设计目的及要求实现2个8层电梯升降控制设计，该设计模拟完成8层楼的载客服务，同时示电梯运行情况和电梯外请求信息，具体要求如下：1)
weixin_34122810
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2023-07-17 16:10
基于
FPGA
的数字时钟的设计课设（HUAT）
目录前言一、数字时钟课设目标二、部分代码1.clock.v代码的编写2.完整代码3.仿真代码总结前言学校黄老师的
FPGA
的设计课设，最后的课设为数字时钟，实现分时的计数功能，带有整点报时，按键调节的功能
Mɪɴᴅ¹³¹⁴.624
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2023-07-17 16:37
fpga
fpga开发
FPGA
通过数码管实现电子时钟
文章目录前言一、原理1、共阴极数码管or共阳极数码管2、共阴极与共阳极的真值表二、系统设计1、总体框图：2、模块调用3、模块原理图三、源码1、计数模块2、数码管驱动模块3、顶层模块四、运行效果五、总结六、参考资料前言环境：1、Quartus18.12、vscode3、板子型号：EP4CE6F17C8N一、原理视觉暂留原理：人眼在观察景物时，光信号传入大脑神经，需经过一段短暂的时间，光的作用结束后，
混子王江江
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2023-07-17 16:07
FPGA
fpga开发
FPGA
编程，verilog实现简易电梯控制系统，某大学数电实验课设
开发环境：Vivado2020.1使用编程语言：Verilog开发板芯片：xc7a35tftg256-1（具体开发板型号未知，不同版本的开发板可能某些元件的引脚电平会不同，可能需要根据自己手上的开发板版本做一些修改）项目基本介绍：1、实现2层楼的简易电梯控制系统。2、电梯有4个按键。1楼外只有向上按键（KEY0）2楼外只有向下按键（KEY1）电梯内还有2个按键分别为：1楼按键(KEY2)2楼按键(
啥都想学啥都学不好
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2023-07-17 16:07
fpga开发
项目三 电梯控制器设计（
FPGA
综合应用设计）
(一个很简陋的电梯控制器设计，但是应该可以过关了吧？️)项目三电梯控制器设计实验目的实验内容实验方法及原理介绍下面给出完整的代码实现：scan_led_hex_disp模板:debounce_button模板:Elevator模板：引脚分配文件：上板实验效果：实验目的通过实验，巩固有限状态机设计方法，并设计实现一个电梯控制器。实验内容利用BASYS开发板资源设计一个5层楼的电梯控制器系统，并能在
罗娜mei
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2023-07-17 16:07
vivado实验
fpga开发
单片机
嵌入式硬件
FPGA
数字钟设计
一、使用说明与整体思路概述1、使用说明：本设计模拟手机时钟实现四个功能，分别为时间显示、秒表、闹钟、计时器。以BUT1~BUT4分别选择这四个功能，四个功能互不冲突，在时间显示时可以继续进行秒表和计时器的工作。实现的各自功能如下：时间显示：以1HZ频率显示时间，按下BUT5实现设置时间，在设置时间的条件下，按下BUT6实现对哪个位进行修改操作，设置的位闪烁示意正在设置该位，按BUT6可以将位循环左
F l e
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2023-07-17 16:36
电子电路
FPGA
电梯控制系统
通信本科，专业综合课程设计题目，基于
FPGA
的电梯控制系统。硬件平台：
FPGA
黑金开发平台AX4010。
浅忆Ly
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2023-07-17 16:06
笔记
fpga
“
FPGA
频率计“ -- 用VHDL编程实现数字频率计
“
FPGA
频率计”–用VHDL编程实现数字频率计本文介绍一种基于
FPGA
的数字频率计开发方法，使用VHDL编程实现。
ruoit
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2023-07-17 16:35
fpga开发
matlab
CASE_04 基于
FPGA
的电梯控制器
该系类博客序言和资源简介可浏览该博客：PREFACE
FPGA
经典案例序言快速了解该系列博客的内容与可用资源。
比特电子工作室
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2023-07-17 16:05
fpga
verilog
vhdl
CORDIC算法
FPGA
的实现
基于CORDIC算法
FPGA
的实现CORDIC算法原理利用简单的移位就实现，主要用于三角函数、双曲线、指数、对数的计算，在以二进制操作为基础的
FPGA
硬件中就显得尤为重要。
学技术得猴
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2023-07-17 16:05
算法
matlab
开发语言
fpga开发
基带工程
FPGA
—简易频率计（附代码）
3.2.1模块框图3.2.2波形图绘制3.2.3RTL代码3.3顶层模块3.4仿真验证3.5上板验证4.总结1.内容概要频率测量在电子设计领域和测量领域经常被使用，本文讲解等精度测量法的原理和实现方法，使用
FPGA
咖啡0糖
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2023-07-17 16:34
FPGA_Xilinx
Spartan6基础入门
fpga开发
基于
FPGA
的数字电子钟的设计与实现
系统顶层模块设计系统功能基本功能：实现秒、分钟、小时、星期的计数，分频，时分秒检测时钟选择，实现8位数码管显示计数结果。拓展功能：“6，9”补全，时钟暂停，时钟清零，时钟加杠，星期，整点报时，秒表的计时、暂停和清零，手动校时，切换模块，按键消抖。设计思路本项目大致分为八个模块，分别为计时模块，秒表模块，分频模块，频率选择模块，动态显示模块，位选模块，消抖模块，多种计数器模块等。设计思路如下：图1数
Gardener_1
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2023-07-17 16:34
fpga开发
Logisim 头歌 16位海明编码电路设计 图解及代码（计算机组成原理）
目录图解：代码题解（免费）：实验目的帮助学生掌握海明码设计原理与检错纠错性能，能独立设计实现汉字GB2312编码的海明校验编码体系，并最终在实验环境中利用硬件电路实现对应的
编解码
电路。
醉蕤
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2023-07-17 16:03
计算机组成原理
html
简易电梯控制系统设计（两层楼）（
（电子科技大学数字系统实验二结课验收项目
fpga
板veriolg语言））第一次写，实属小白，写的不好请见谅。
小易kk
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2023-07-17 16:33
verilog
fpga
fpga
课设-多功能信号发生器
1.2
FPGA
简介
FPGA
（Field－ProgrammableGateArray），即现场可编程门阵列
lenient__bear
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2023-07-17 16:33
fpga开发
计算机组成原理实验(已通关)-华中科技大学头歌Educoder(Logisim)
第1关汉字国标码转区位码实验第2关汉字机内码获取实验第3关偶校验编码设计第4关偶校验解码电路设计第5关16位海明编码电路设计第6关16位海明解码电路设计第7关海明编码流水传输实验第8关16位CRC并行
编解码
电路设计第
紫荆鱼
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2023-07-17 16:02
计算机组成原理实验
华中科技大学
educoder
logisim
FPGA
学习网站、开源网站和论坛网站汇总
分享
FPGA
常用的一些学习网站、开源网站和论坛网站，方便大家找资料，查问题。
jk_101
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2023-07-17 16:01
FPGA
fpga开发
学习
好的VHDL网站
http://www.
fpga
.com.cn/hdl/vhdl_example.htm，上面有很多实例，这样可以对CPU的工作有个更加清楚的认识
idoit0204
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2023-07-17 16:00
工作
数字频率计设计
FPGA
教程目录MATLAB教程目录-----------------------------------------------------------------------设计任务与要求1、设计任务设计并实现一个数字频率计
fpga和matlab
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2023-07-17 16:59
FPGA
板块19:信号发生器
数字频率计
32个关于
FPGA
的学习网站
语言类学习网站1、HDLbits网站地址：https://hdlbits.01xz.net/wiki/Main_Page在线作答、编译的学习Verilog的网站，题目很多，内容丰富。非常适合Verilog初学者！！！2、牛客网网站地址：https://www.nowcoder.com/exam/oj?page=1&tab=Verilog%E7%AF%87&topicId=311类似LeetCode
孤独的单刀
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2023-07-17 16:27
FPGA设计与调试
fpga开发
华中科技大学计算机组成原理-计算机数据表示实验（全部通关）
第1关汉字国标码转区位码实验第2关汉字机内码获取实验第3关偶校验编码设计第4关偶校验解码电路设计第5关16位海明编码电路设计第6关16位海明解码电路设计第7关海明编码流水传输实验第8关16位CRC并行
编解码
电路设计第
紫荆鱼
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2023-07-17 16:26
计算机组成原理实验
课程设计
经验分享
硬件工程
单片机
FPGA
课程设计——数字电子时钟VERILOG（基于正点原子新起点开发板，支持8位或6位共阳极数码管显示时分秒毫秒，可校时，可设闹钟，闹钟开关，led指示）
2019级电子科学与技术专业
FPGA
课程设计报告2022年5月20日多功能数字电子钟的设计摘要电子设计自动化（EDA）是一种实现电子系统或电子产品自动化设计的技术，使用EDA技术设计的结果既可以用
FPGA
嗨菜鸡
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2023-07-17 16:26
课程设计
fpga开发
FPGA
实现简易电梯控制系统设计
这是某高校数字电路实验II课设，已实现2022年秋季学期所有功能软硬件配置系统：win10软件：Vivado2018.3开发板芯片：xc7a35tftg256-2设计要求1、实现2层楼的简易电梯控制系统。2、电梯有4个按键。1楼外只有向上按键（KEY0），2楼外只有向下按键（KEY1），电梯内还有2个按键分别为1楼按键(KEY2)和2楼按键(KEY3）。所有楼层外和电梯内的按键产生的信号作为给电梯
lue_app
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2023-07-17 16:56
fpga开发
基于
FPGA
的按键消抖
文章目录基于
FPGA
的按键消抖一、按键消抖原理二、按键消抖代码三、仿真代码编写四：总结基于
FPGA
的按键消抖一、按键消抖原理按键抖动：按键抖动通常的按键所用开关为机械弹性开关，当机械触点断开、闭合时，由于机械触点的弹性作用
辣子鸡味的橘子
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2023-07-17 15:01
fpga开发
FPGA
软核调试方法
软核工程创建步骤创建如下工程目录bin目录：存放SDK工程生成的elf文件(Release编译模式)hdf目录：存放
fpga
工程师提供的的hdf文件prj目录：工程目录(包含SDK工程源码)doc目录：
缥缈孤鸿_jason
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2023-07-17 15:55
fpga开发
Python爬虫学习笔记（三）————urllib
目录1.使用urllib来获取百度首页的源码2.下载网页图片视频3.总结-14.请求对象的定制（解决第一种反爬）5.
编解码
（1）get请求方式：urllib.parse.quote（）（2）get请求方式
阿波拉
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2023-07-17 13:21
python
爬虫
学习
网络爬虫
【正点原子STM32连载】 第五十四章 音乐播放器实验摘自【正点原子】STM32F103 战舰开发指南V1.2
手册+视频下载地址：http://www.openedv.com/thread-340252-1-1.html#第五十四章音乐播放器实验正点原子战舰STM32F103板载了VS1053B这颗高性能音频
编解码
芯片
正点原子
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2023-07-17 11:16
stm32
嵌入式硬件
单片机
FPGA
--IP核之RAM
RAM的英文全称是RandomAccessMemory，即随机存取存储器，它可以随时把数据写入任一指定地址的存储单元，也可以随时从任一指定地址中读出数据，其读写速度是由时钟频率决定的。RAM主要用来存放程序及程序执行过程中产生的中间数据、运算结果等。ISE软件自带了BMGIP核（BlockMemoryGenerator，块RAM生成器），可以配置成RAM或者ROM。这两者的区别是RAM是一种随机存
小灿532
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2023-07-17 10:45
fpga开发
学习
Xilinx
FPGA
----ISE软件使用
项目需求更换了XC6SLX9-3TQG144C，Spartan6系列
FPGA
，需要使用ISE开发环境，我使用的是ISE14.7版本。一、新建工程点击Finish新建工程完成。
仲南音
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2023-07-17 10:14
FPAG
fpga开发
FPGA
----Verilog矩阵求逆
1、本人使用纯Verilog语言实现了方阵矩阵求逆的并行计算，代码复用性强、可扩展性强、包含矩阵的四则运算，下面的例子是8*8的，本人代码可以向上封装以2^n阶数增长。2、下面是8*8矩阵的仿真截图。实验结果为：3e08542e（0.13313362002372742）be255bd1（-0.1614830642938614）bea23938（-0.31684279441833496）3ed3ec
发光的沙子
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2023-07-17 10:14
fpga开发
矩阵
线性代数
verilog
FPGA
学习---6.PLL 锁相环
六PLL锁相环Phase-LockedLoopPLL的完整英文拼写为Phase-LockedLoop。即相位锁定的环路，也就是我们常说的锁相环。锁相环在模拟电路和数字电路系统中均有广泛的使用，很多的MCU芯片如STM32、MSP430等都集成了片上PLL，用来通过片外较低频率的晶振产生的时钟倍频得到较高频率的时钟信号以供MCU的内核和片上外设使用。在很多的协议芯片中，也用到了PLL来通过较低频率的
堪堪多写博客少睡觉
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2023-07-17 10:14
FPGA
fpga
FPGA
----IP核cordic使用
之前说过，使用IP核要先百度，然后看文档，然后再百度最后使用。本篇文章以cordIC核的sin、cos来进行实验（全网最详教程）。1、定点数、浮点数、反码、补码首先要明确这几个词的概念。废话不多说，直接上例子：采用32位的有符号定点数表示方法，第一位表示符号位（0是正数，1是负数），因此还剩31个位置来表示数据，具体整数部分与小数部分是几位，看自己设定。我们下面假设整数部分2位（因为-pi~pi=
发光的沙子
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2023-07-17 10:44
Verilog
fpga开发
verilog
FPGA
-DFPGL22学习3-调试手段
文章目录前言一、调试前瞻二、FabricInserter使用步骤1、选择探针2、开启调试总结前言@和原子哥一起学习
FPGA
开发环境：正点原子ATK-DFPGL22G开发板参考书籍：《ATK-DFPGL22G
子歌的宏定义
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2023-07-17 10:12
FPGA
fpga开发
学习
FPGA
-DFPGL22学习4-仿真平台学习
文章目录前言一、仿真的步骤二、使用步骤1.PDS编译仿真库2.编写仿真tb文件3.选择行为仿真4.查看观察窗口5.修改代码后重新编译总结前言@和原子哥一起学习
FPGA
开发环境：正点原子ATK-DFPGL22G
子歌的宏定义
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2023-07-17 10:12
FPGA
fpga开发
学习
FPGA
-DFPGL22学习5-VERILOG
系列文章之上章
FPGA
-DFPGL22学习4-仿真平台学习文章目录系列文章之上章前言一、Verilog简介二、Verilog基础1.逻辑值2.进制3.标识符4.数据类型寄存器类型线网类型参数类型5.运算符三
子歌的宏定义
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2023-07-17 10:12
FPGA
fpga开发
学习
FPGA
-DFPGL22学习2-开发平台学习
文章目录前言一、PangoDesignSuite软件的使用流程二、使用步骤1.新建一个工程2.设计输入3.配置工程4.分析与综合（编译检查）5.约束输入6.编译工程7.下载程序总结前言@和原子哥一起学习
FPGA
子歌的宏定义
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2023-07-17 10:12
FPGA
fpga开发
学习
高云
FPGA
初体验-LED流水灯实验
高云
FPGA
初体验-流水灯实验硬件环境操作步骤创建工程添加设计文件添加约束文件编译工程下载运行资源链接硬件环境开发板：高云DK_START_GW2A55-PG484_V1.3开发板
FPGA
芯片型号：高云
芬奇说
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2023-07-17 10:39
国产FPGA
fpga开发
FPGA
学习-vivado软件的使用
FPGA
学习-vivado软件的使用1.杂谈2.vivado新建工程1.杂谈又被封了7天。
丸子的蓝口袋
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2023-07-17 10:08
fpga
fpga开发
学习
[从零开始学习
FPGA
编程-22]：进阶篇 - 架构 -
FPGA
内部硬件电路的设计与建模
作者主页(文火冰糖的硅基工坊)：文火冰糖（王文兵）的博客_文火冰糖的硅基工坊_CSDN博客本文网址：目录前言：第1章什么是数字硬件电路1.1什么是硬件电路
文火冰糖的硅基工坊
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2023-07-17 10:08
从零开始学FPGA编程
fpga开发
学习
建模
分层
设计
京微齐力
FPGA
-M5 学习（二）- Blink_LED
京微齐力
FPGA
-M5学习（二）-Blink_LED简介
FPGA
部分硬核8051部分如有疑问或错误的请留言！
九四一二
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2023-07-17 10:08
京微齐力-M5学习
FPGA
-DFPGL22学习6-led
系列文章之上章
FPGA
-DFPGL22学习5-VERILOG文章目录系列文章之上章前言一、原理图端口对应二、程序设计三、程序编写四、仿真五、工程下载前言@和原子哥一起学习
FPGA
开发环境：正点原子ATK-DFPGL22G
子歌的宏定义
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2023-07-17 10:37
FPGA
fpga开发
学习
流水灯——
FPGA
文章目录前言一、流水灯介绍二、系统设计1.模块框图2.RTL视图三、源码四、效果五、总结六、参考资料前言环境：1、Quartus18.02、vscode3、板子型号：EP4CE6F17C8要求：每隔0.2s循环亮起LED灯一、流水灯介绍从LED0开始亮起到LED3又回到LED0循环往复。二、系统设计1.模块框图2.RTL视图三、源码moduleled#(parameterMAX_NUM=26'd9
混子王江江
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2023-07-17 09:47
FPGA
fpga开发
FPGA
adrv9002 4收4发板卡，支持NVME SATA EMMC 光口 FMC
板卡采用ADI射频直采芯片ADRV9002，支持4收4发支持外部本振跳频同时支持4X10G光口对外传输，FMC扩展。同时支持4XNVME接口，可以实时流盘，备份一路SATA接口，板卡同时预留了EMMC，可以PSPL选通访问，PS直接可以用来放操作系统的根文件系统，PL访问可以当做一个低速的固态存储接口
FPGA_Linuxer
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2023-07-17 09:44
fpga开发
【
FPGA
】基于C5的第一个SoC工程
文章目录前言SoC的Linux系统搭建前言本文是在毕业实习期间学习
FPGA
的SoC开发板运行全连接神经网络实例手写体的总结。
听海—
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2023-07-17 07:26
fpga开发
FPGA
Verilog移位寄存器应用：边沿检测、信号同步、毛刺滤波
文章目录1.端口定义2.边沿检测3.信号同步4.信号滤波5.源码6.总结输入信号的边沿检测、打拍同步、毛刺滤波处理，是
FPGA
开发的基础知识，本文介绍基于移位寄存器的方式，实现以上全部功能：上升沿、下降沿
whik1194
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2023-07-17 06:42
FPGA
Xilinx
Verilog
边沿
上升沿
滤波
同步
电子器件系列四：锁相环
其主要作用是为ADC、DAC、
FPGA
提供时钟信号，满足系统对时钟抖动的要求。
Gutie_bartholomew
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2023-07-17 03:23
硬件相关-电路设计
电子器件系列
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