FPGA学习指南第25页

安路IP核应用举例(OSC、UART)

1.OSC(内部振荡器)按照Project->NewProject顺序新建工程后，后按照Tools->IPGenerator顺序，创建IP核，如下图：安路FPGA的内置OSC振荡模块频率可选30MHz、

SDAU2005·2023-12-16 16:57

FPGA使用乘法的方式

FPGA使用乘法的方式方法一：直接使用乘法符“＊”源代码modulemultiply(input[7:0]a,input[7:0]b,outputwire[15:0]result);(*use_dsp48

傻童:CPU·2023-12-16 16:55

Verilog自学还是报班？

FPGA作为国内领先的芯片产品，和传统芯片相比并不局限于单纯的研究和设计芯片，而是针对多种领域的产品通过特定的芯片模型进行优化设计。

程老师讲FPGA·2023-12-16 16:20

开发板ARM+FPGA架构运动控制卡详细解析

开发板ARM+FPGA架构运动控制卡运动控制器本运动控制卡采用ARM单片机+FPGA架构；ARM单片机是基于Cortex-M3内核的LM3S6911，插补核心算法均在该ARM内完成，一方面通过以太网与上位机界面交换加工数据

QzrbNxXCD·2023-12-16 16:19

【 TES720D】基于国内某厂商的FMQL20S400全国产化ARM核心模块

该款核心板的主芯片兼容XILINX的ZYNQ7010或ZYNQ7020系列FPGA。核心板上布了DDR3SDRAM、EMMC、SP

北京青翼科技·2023-12-16 16:33

verilog高级语法-原语-ibuf-obuf-LUT

概述：原语直接操作FPGA的资源，对FPGA的结构更加清晰，使用原语之前需要对FPGA的资源进行了解，本节为初识原语学习内容1.输入缓冲原语IBUF2.输出缓冲原语OBUF3.查找表原语LUT1.IBUF

q511951451·2023-12-16 15:20

单片机——通信协议（FPGA+c语言应用之iic篇）

一.I2C的功能特点（1）功能包括：1.只需要两条总线；2.没有严格的波特率要求，例如使用RS232，主设备生成总线时钟；3.所有组件之间都存在简单的主/从关系，连接到总线的每个设备均可通过唯一地址进行软件寻址；4.I²C是真正的多主设备总线，可提供仲裁和冲突检测；（2）传输速度标准模式：StandardMode=100Kbps快速模式：FastMode=400Kbps高速模式：Highspeed

我来挖坑啦·2023-12-16 15:18

【动手学深度学习】(十三)深度学习硬件

释怀°Believe·2023-12-16 14:58

AGM FPGA，pin to pin兼容Altera

AGMFPGA，pintopin兼容Altera国内最好的FPGA，有CPLD，FPGA等多种规格器件目前大尺寸LED控制，大屏控制器，小屏驱动器应用领域巨大完美兼容AlteraEPM240T100系列

Embeded_FPGA·2023-12-16 14:21

具超高性价比的AG10K FPGA

AG10KFPGA器件面向大批量，对成本敏感的应用，使系统设计人员能够满足不断增长的性能要求，同时降低成本。

Embeded_FPGA·2023-12-16 14:50

AG10KSDE176（+ MCU）+ SDRAM器件

MCU硬IP嵌入在FPGA逻辑结构中，所有MCU内部IO可根据用户要求连接到设备的IO垫和/或内部FPGA的逻辑。MCU内核具有高达64KB的可用代码空间，可通过SP

Embeded_FPGA·2023-12-16 14:20

Initial用法-FPGA入门3

Initial是什么FPGAInitial是一种在FPGA中进行初始化的方法。在FPGA设备上，初始值决定了逻辑门的状态和寄存器的初始值。

Kent Gu·2023-12-16 13:17

【课程文章】微信小程序学习指南

本文章是配合【微信小程序】视频教程的指南目录文章准备软件：这些软件可以在（点击这里）【微课百家】下载。1.MySQL数据；2.Navicat工具；3.TodoDemo或者TeachDemo，配合小程序使用的后端对接平台源代码；4.JDK和Tomcat；

潭池先生·2023-12-16 12:19

verilog语法进阶-分布式ram

概述:FPGA的LUT查找表是用RAM设计的，所以LUT可以当成ram来使用，也并不是所有的LUT都可以当成ram来使用，sliceM的ram可以当成分布式ram来使用，而sliceL的ram只能当成rom

q511951451·2023-12-16 11:38

ISP IC/FPGA设计-第一部分-MT9V034摄像头分析（0）

MT9V034为CMOS图像传感器，有着极其优秀的图像成像性能，同时支持丰富的功能用于isp的开发；MT9V034的HDR宽动态、10bit数据深度、RAW格式（bayer阵列）图像、dvp和lvds接口、60fps正是学习isp开发的理想传感器；MT9V034有两款类型，一个是单色型号，直接输出灰度的图像，在机器视觉领域应用很广，我的双目视觉毕业设计也是采用这款摄像头；另一个就是彩色款，不过输出

芯王国·2023-12-16 10:36

PXI/PCIe/VPX机箱 ARM|x86 + FPGA测试测量板卡解决方案

PXI便携式测控系统是一种基于PXI总线的便携式测试测控系统，它填补了现有台式及机架式仪器在外场测控和便携测控应用上的空白，在军工国防、航空航天、兵器电子、船舶舰载等各个领域的外场测控场合和科学试验研究场合都有广泛的应用。由于PXI便携式测控系统的特殊性，不同的测控项目，要求各异，测控领域国内外著名厂商很难专门投入研发去设计满足这类小批量多样化的定制需求。本文从介绍NI和PXI总线入手，逐步展开，

深圳信迈科技DSP+ARM+FPGA·2023-12-16 05:57

一些AG10K FPGA 调试的建议-Douglas

PLLAGMFPGA在配置成功时，PLL已经完成锁定，lock信号已经变高；如果原设计中用lock信号输出实现系统reset的复位功能，就不能正确完成上电复位；同时，为了保证PLL相移的稳定，我们需要在

Embeded_FPGA·2023-12-16 05:55

企业直呼FPGA人才难寻

FPGA是即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

程老师讲FPGA·2023-12-16 05:25

要学FPGA还要学单片机

当今，FPGA和单片机的应用非常广泛，在有FPGA知识的基础上，可以把FPGA作为主要的学习目标，单片机作为辅助技能。其实二者是相互促进的。

程老师讲FPGA·2023-12-16 05:55

如何分配FPGA管脚

如何有效的利用FPGA的资源，管脚分配也是必须考虑的一个重要问题。

程老师讲FPGA·2023-12-16 05:55

基于FPGA的视频接口之高速IO

简介相对于其他视频接口来说，高速IO接口（以Xilinx公司为例，spartan6系列的GTP、Artix7系列的GTP，KENTEX7系列的GTX和GTH等）具有简化设计、充分利用FPGA资源、降低设计成本等功能

Eidolon_li·2023-12-16 00:59

基于FPGA的视频接口之高速IO（PCIE）

简介相对于其他高速IO接口应用，PCIE协议有专门的的IP来进行操作，通过8对输入高速IO，以及输出高速IO，来实现PCIEX8功能。原理框图原理图软件调用

Eidolon_li·2023-12-16 00:59

基于FPGA的视频接口之高速IO（光纤）

简介对于高速IO口配置光纤，现在目前大部分开发板都有配置，且也有说明，在此根据自己的工作经验以及对于各开发板的说明归纳通过高速IO接口，以及硬件配置，可以实现对于光纤的收发功能，由于GTX的速率在500Mbs到10Gbps之间，但通道高速io可配置光纤10G硬件，物理通完成，则可传输常见的光纤协议，例如UDP协议，FC-AC协议，ARINC818协议等来完成对于视频的发送和接收功能。原理框图如上图

Eidolon_li·2023-12-16 00:24

FPGA UltraScale GTY 全网最细讲解，aurora 8b/10b编解码，HDMI视频传输，提供vivado工程源码和技术支持

目录1、前言免责声明2、我这里已有的GT高速接口解决方案3、详细设计方案设计框图视频源选择ADV7611解码芯片配置及采集动态彩条视频数据组包UltraScaleGTY全网最细解读UltraScaleGTY基本结构UltraScaleGTY参考时钟的选择和分配UltraScaleGTY发送和接收处理流程UltraScaleGTY发送接口UltraScaleGTY接收接口UltraScaleGTYI

9527华安·2023-12-15 23:10

FPGA高端项目：图像采集+UltraScale GTY + PCIE，aurora 8b/10b编解码+PCIE视频传输，提供工程源码和QT上位机源码和技术支持

9527华安·2023-12-15 23:10

FPGA UltraScale GTY 全网最细讲解，aurora 8b/10b编解码，板对板视频传输，提供2套工程源码和技术支持

目录1、前言免责声明2、我这里已有的GT高速接口解决方案3、详细设计方案设计框图视频源选择ADV7611解码芯片配置及采集动态彩条视频数据组包UltraScaleGTY全网最细解读UltraScaleGTY基本结构UltraScaleGTY参考时钟的选择和分配UltraScaleGTY发送和接收处理流程UltraScaleGTY发送接口UltraScaleGTY接收接口UltraScaleGTYI

9527华安·2023-12-15 23:39

FPGA高端项目：UltraScale GTH + SDI 视频解码，SDI转DP输出，提供2套工程源码和技术支持

9527华安·2023-12-15 23:30

Yolov5双目测距-双目相机计数及测距教程（附代码）

本教程将为小白用户提供一个简明扼要的学习指南，涵盖了关键步骤，包括标定、公示推倒以及重要的代码片段。第一步：环境搭建首先，确保你的环境已经正确搭建。

阿利同学·2023-12-15 22:03

cordic 算法学习记录

参考：b站教学视频FPGA：Cordic算法介绍与实现_哔哩哔哩_bilibiliFPGA硬件实现加减法、移位等操作比较简单，但是实现乘除以及函数计算复杂度高且占用资源多，常见的计算三角函数/平方根的求解方式有

little ur baby·2023-12-15 21:38

FPGA主芯片选型

第一步：选定器件特色（重点关注FPGA的专用资源）1、高速BANK的引脚①若需要高速接口，需要多少个通道②每个通道的最高收发速度是多少。

客家元器件·2023-12-15 20:12

无线通信算法工程师学习指南

无线通信算法工程师学习指南主体框架通信专业基础课学习:中国大学MOOC通信原理信号与系统了解协议：3GPP协议原文协议相关书籍在线网站：sharetechnote通信系统MATLAB仿真全面详解LTE：

zhou12135·2023-12-15 20:11

7.MATLAB变量——矩阵操作二

FPGA教程目录MATLAB教程目录-----------------------------------------------------------------------------------

fpga和matlab·2023-12-15 20:30

6.MATLAB变量——矩阵操作一

FPGA教程目录MATLAB教程目录-----------------------------------------------------------------------------------

fpga和matlab·2023-12-15 20:29

【INTEL（ALTERA）】 quartus 专业版软件 23.4 中模拟以太网子 FPGA IP 时p_ss_app_st_tx_ready 信号变为 X

问题描述选择启用前导码直通参数时，为什么在模拟以太网子英特尔®FPGAIP系统的40GbE和50GbEIntelAgilex®7F-Tile变体时，p_ss_app_st_tx_ready信号变为X。

神仙约架·2023-12-15 18:32

【INTEL（ALTERA）】 quartus错误“英特尔 FPGA IP在设计中实例化，需要将DEVICE_INITIALIZATION_CLOCK选项设置为 OSC_CLK_1_25MHZ

错误“英特尔FPGAIP在设计中实例化，需要将DEVICE_INITIALIZATION_CLOCK选项设置为OS

神仙约架·2023-12-15 18:02

verilog基础语法，wire,reg,input,output,inout

在FPGA中的基本定义为wire，reg，input,output,inout。只有正确的认识到这些基本概念，才能进行正确的开发。

q511951451·2023-12-15 12:58

verilog语法基础-移位寄存器

本节针对移位寄存器的基本应用场景给出基本的模版，并观测FPGA综合后的结构图。

q511951451·2023-12-15 12:57

verilog基础语法-计数器

概述：计数器是FPGA开发中最常用的电路，列如通讯中记录时钟个数，跑马灯中时间记录，存储器中地址的控制等等。本节给出向上计数器，上下计数器以及双向计数器案例。

q511951451·2023-12-15 12:57

verilog基本语法-时序逻辑基础-记忆单元

通常不会使用锁存器来保存信息，但是在FPGA中，保留了大量的锁存器的功能，这是因为触发器本身是由锁存器构造成的，保留锁存器功能并不会消

q511951451·2023-12-15 12:45

【【RGB LCD字符和图片的显示实验】】

RGBLCD字符和图片的显示实验本次实验参考自《正点原子领航者ZYNQ之FPGA开发指南》RGBLCD字符和图片显示实验本次实验采用的板子是正点原子ZYNQ7020本次实验的大体代码可以参照上次实验的代码主要是为了学习字体取模的操作然后将其显示在屏幕上实验任务通过领航者开发板上的

ZxsLoves·2023-12-15 12:10

verilog语法基础-算术运算

FPGA能够进行算术运算仅仅是低位的整数运算。其中性能比较好的是加法运算，减法运算，乘法运算，和左移除法运算。其中加法运算和减法运算可以看成一种运算。本节主要讨论简单的算术运算结构。

q511951451·2023-12-15 12:36

HI3559AV100和FPGA 7K690T的PCIE接口调试记录-续

上文https://blog.csdn.net/fzktongyong/article/details/134963814?spm=1001.2014.3001.5501上一篇文中PCIE实测速度和理论计算有较大偏差，经过尝试后有所提升。1、提升效果1）、RC写操作，实测速度817MB/s（410+407）先前为670MB/s。2）、RC读操作，实测速度710MB/s（357+353）先前为500

雨之小·2023-12-15 12:04

【FPGA/verilog -入门学习12】Verilog可配置的PWM设计，参数传递的3种方式

需求：基于任务（task）的PWM设计仿真验证需求分析：1,需求实现可配置PWM输出（频率，占空比）2,输入，输出端口inputi_clk,//clk=50Mhzinputi_rst_n,inputi_en,outputrego_vld,//有效信号outputrego_pwm3,定义计数寄存器reg[7:0]cnt;用于计数，0~分频最大值，o_pwm在计数到0~正数占空比来临前置高，其他时间置

王者时代·2023-12-15 12:33

vivado约束方法4

它分析了网表、时钟网络连接和现有的定时限制，以便根据《超快设计方法指南》提供建议用于FPGA和SoC（UG949）。以下11涵盖了三类约束页面，然后是摘要。

cckkppll·2023-12-15 12:03

西南科技大学数字电子技术实验七（4行串行累加器设计及FPGA实现）预习报告

一、计算/设计过程说明：本实验是验证性实验，计算预测验证结果。是设计性实验一定要从系统指标计算出元件参数过程，越详细越好。用公式输入法完成相关公式内容，不得贴手写图片。（注意：从抽象公式直接得出结果，不得分，页数可根据内容调整）（1）激励表现态输入次态输出双稳输入QnEFQn+1SJK000000x001010x010010x011101x10001x110110x011010x011111x0设

Myon⁶·2023-12-15 12:31

西南科技大学数字电子技术实验四（基本触发器逻辑功能测试及FPGA的实现）FPGA部分

4、学会用FPGA实现本实验内容。

Myon⁶·2023-12-15 12:30

西南科技大学数字电子技术实验四（基本触发器逻辑功能测试及FPGA的实现）预习报告

一、计算/设计过程说明：本实验是验证性实验，计算预测验证结果。是设计性实验一定要从系统指标计算出元件参数过程，越详细越好。用公式输入法完成相关公式内容，不得贴手写图片。（注意：从抽象公式直接得出结果，不得分，页数可根据内容调整）（1）D触发器特征方程：Qn+1=D特性表：DQnQn+1100010101111（2）JK触发器特征方程特性表：JKQnQn+1000000110100011010011

Myon⁶·2023-12-15 12:55

FPGA知识汇集-ASIC移植中的FPGA芯片划分

通常，FPGA单芯片难以容纳下整个ASIC设计，因此需要将整个系统划分到多颗FPGA芯片中运行（见图1），工程师往往需要借助原型验证平台来实现这样的目标。

FPGA技术联盟·2023-12-15 11:33

FPGA芯片选型十步

FPGA芯片选型十步拍明芯城拍明芯城元器件交易平台www.iczoom.comFPGA全称是FieldProgrammableGateArray，中文名是现场可编程门阵列，是一种硬件可重构的集成电路芯片

bk094·2023-12-15 11:28

特权FPGA 学习笔记

存储器可用于异步时钟域的信号处理，双口RAM多用于交互式数据，FIFO多用于单向数据传输；以task的方式封装testbench子程序，以提高复用程度；模板中，vho是vhdl模板，veo是verilog模板；runblockautomation，实际实例化相关的处理器模块生成bdoutput之后，再生成wrapper顶层文件，再exportHardware到SDK，打开SDK后就会有文件mem_

chinxue2008·2023-12-15 11:55

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