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Verilog电路设计
超大规模集成
电路设计
----FPGA时序模型及FSM的设计（八）
绝大部分资料来自中国科学院段成华教授PPT超大规模集成
电路设计
----RTL级设计之FSM（八）7.1CPLD的时序模型7.1.1XPLA3时序模型7.1.2具体时序组成（重点）1.PadtoPad(tPD
MinJohnson
·
2023-12-14 12:59
FPGA/Verilog
数字集成电路
fpga开发
MOS管加三个元件就组成BUCK电路，为何说难点在于电感？
然而在我们的
电路设计
中，会用到各种芯片，各种芯片所需要的电压值也不一样。
Risehuxyc
·
2023-12-06 23:02
电子产品认识与测试
硬件工程
FPGA-EEPROM读写记录
整篇文章会首先对AT24C64技术文档进行分析，其次分析AT24C64在FPGA上的引脚分配情况，最后逐步分析正点原子给出的
Verilog
代
Authony.
·
2023-12-06 18:22
FPGA
fpga开发
verilog
语法tips
近来有感于技能不足了，所以继续学习FPGA、ASIC相关基础知识，分享一点微不足道的经验，也希望各位大佬多多指点蛤（软件工具：ISE）。1.if...else与caseif..else与case语句的作用都是选择，不同的是综合后的RTL视图下，我们可以看到if...else趋向于具有优先级的结构，而case则是并行结构，但是在TechnologyMapViewer下，两者的视图几乎一样。（煮：RT
我喜欢唱跳rap打篮球
·
2023-12-06 15:35
Verilog
中generate的用法
c语言中常用for语句来解决此类问题，
verilog
则为我们提供了generate语句。
一只迷茫的小狗
·
2023-12-06 14:40
verilog
verilog
Multisim：振幅调制器的设计（含仿真程序+文档+原理图+PCB）
原理图高频课程设计报告题目振幅调制器的设计姓名不眠者科技指导教师XXX学科专业XXX起止日期2021/10/30目录高频课程设计报告一、设计要求1.总体设计要求2.参考指标二、设计方案的选择1.振幅调制产生原理2.方案选择三、
电路设计
千歌叹尽执夏
·
2023-12-06 01:51
Multisim
振幅调制器的设计
PCB
Altium Designer（AD）局域网内使用解冲突
1.AltiumDesigner版本AD15.0.8，
电路设计
软件，硬件工攻城狮必备技能，软件攻城狮也要会一点点2.AD软件出现“Yourlicenseisalreadyusedoncomputer“LAPTOP-F99R6OR1
张小兔爱钱钱
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2023-12-05 21:04
mcu
硬件工程
物联网
嵌入式硬件
System
Verilog
基础：并行块fork-join、join_any、join_none（一）
相关阅读System
Verilog
基础https://blog.csdn.net/weixin_45791458/category_12517449.html?
日晨难再
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2023-12-05 21:33
SystemVerilog基础
fpga开发
数字IC
硬件工程
Verilog
SystemVerilog
Verilog
基础：$time、$stime和$realtime系统函数的使用
相关阅读
Verilog
基础https://blog.csdn.net/weixin_45791458/category_12263729.html$time、$stime和$realtime这三个系统函数提供了返回当前仿真时间方法
日晨难再
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2023-12-05 21:33
#
系统函数与系统任务
Verilog基础
fpga开发
数字IC
Verilog
硬件工程
Verilog
基础：编译指令`timescale
相关阅读
Verilog
基础https://blog.csdn.net/weixin_45791458/category_12263729.html?
日晨难再
·
2023-12-05 21:57
Verilog基础
数字IC
fpga开发
硬件工程
Verilog
波形文件(wlf,vcd,fsdb,shm,vpd)的区别
在
verilog
和system
verilog
等逻辑仿真的过程中，最关心的就是最后生成的波形是如何，我们才能根据波形去具体分析。
Bug_Killer_Master
·
2023-12-05 16:20
技术百科
fpga开发
【沁恒蓝牙mesh】程序烧录 硬件
电路设计
与原理
本文基于沁恒CH58X单片机的程序烧录硬件
电路设计
原理解释【沁恒蓝牙mesh】目录1.程序烧录方式2.USB烧录过程描述3.硬件设计原理图3.1官方开发板原理图3.2自开发设计原理图4.电容在上电瞬间为什么相当于短路
Intoxicated_Rookie
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2023-12-05 16:55
沁恒蓝牙mesh二次开发
c语言
USB
嵌入式C
物联网
单片机
超大规模集成
电路设计
----MOS器件原理（三）
绝大部分资料来自----数字集成电路——电路、系统与设计(第二版)及中国科学院段成华教授PPT超大规模集成
电路设计
----MOS器件原理（三）3.1半导体物理知识补充1.半导体材料2.固体类型3.2二极管
MinJohnson
·
2023-12-05 12:49
数字集成电路
数字集成电路设计
超大规模集成
电路设计
----基本概念（二）
绝大部分资料来自----数字集成电路——电路、系统与设计(第二版)及中国科学院段成华教授PPT超大规模集成
电路设计
----基本概念（二）简短的历史回顾(ABriefHistoricalPerspective
MinJohnson
·
2023-12-05 12:48
数字集成电路
数字集成电路设计
超大规模集成
电路设计
----学习框架（一）
绝大部分资料来自----数字集成电路——电路、系统与设计(第二版)及中国科学院段成华教授PPT超大规模集成
电路设计
----学习框架（一）这门课在学什么？这门课该怎么学？
MinJohnson
·
2023-12-05 11:46
数字集成电路
数字集成电路设计
「
Verilog
学习笔记」占空比50%的奇数分频
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网根据题意7分频，实际上是第一次电平变化经历了4个上升沿+3个下降沿，第二次电平变化是4个下降沿+3个上升沿，所以用两个计数器就行了
KS〔学IC版〕
·
2023-12-05 09:44
Verilog学习笔记
学习
笔记
Verilog
[
Verilog
语法]：===和!==运算符使用注意事项
[
Verilog
语法]：===和!==运算符使用注意事项1，===和!==运算符使用注意事项2，3，1，===和!==运算符使用注意事项参考文献：1，[System
Verilog
语法拾遗]===和!
向兴
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2023-12-04 20:31
Verilog语法
练习十一：简单卷积器的设计
，卷积器的设计，RTL：con1.v4，前仿真和后仿真，测试信号：test_con1.v5，A/D转换器的
Verilog
HDL模型所需要的技术参数，RTL代码adc.v5.1问题：这个文件没找到，待解决中
向兴
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2023-12-04 20:59
Verilog数字系统设计教程
fpga开发
芯片设计
Vivado & Modelsim联合进行UVM仿真指南
在下方的Compilation栏中，点击
Verilog
options右侧的…按钮，添加D:/Program_F
一只迷茫的小狗
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2023-12-04 16:44
vivado
uvm
FPGA
fpga开发
Vivado
uvm
【电机课程设计（开源）——基于STM32的PID电机控制系统设计-第二章 系统硬件设计】
第二章系统硬件设计仅为记录之前学习的电机课程设计所用第一章系统设计及方案设定第二章系统硬件设计文章目录电机课程设计（开源）——基于STM32的PID电机控制系统设计-第二章系统硬件设计前言二、系统硬件设计2.1硬件设计方案2.1.1整体设计2.1.2扩展板PCB2.2扩展板电路分模块设计简介2.2.1稳压
电路设计
维京海盗Jack
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2023-12-04 14:51
电机课程设计
stm32
嵌入式硬件
单片机
加法器的实现
verilog
实现加法器，从底层的门级电路级到行为级，本文对其做出了相应的阐述。1、一位半加器所谓半加器就是有两个输入，两个输出，不考虑进位。
li_li_li_1202
·
2023-12-04 14:00
计算机基础（1）——
Verilog
语法入门
为了能够跟上课程进度，提前了解一些
Verilog
语法是很有必要的。
苍山有雪，剑有霜
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2023-12-04 10:24
学习笔记
Verilog
计算机基础
fpga开发
hdlbits系列
verilog
解答（真值表）-50
文章目录一、问题描述二、
verilog
源码三、仿真结果一、问题描述本节我们学习用真值表来描述组合逻辑的行为，通过真值表我们将组合逻辑的每一种输入和输出对应值都罗列出来。
zuoph
·
2023-12-04 02:25
verilog语言
fpga开发
数字逻辑电路基础-组合逻辑电路之加法器
文章目录一、加法器二、
verilog
源码三、综合及仿真结果一、加法器本文介绍数字逻辑电路中常用的基础组合逻辑电路加法器。它是处理器内部ALU算术逻辑单元的基础构件。
zuoph
·
2023-12-04 02:25
数字电路
fpga开发
数字逻辑电路基础-组合逻辑电路之4位加减法器
文章目录一、4位加减法器二、
verilog
源码三、综合及仿真结果一、4位加减法器本文在上一篇加法器的基础上，更进一步介绍如何实现4位加减法器。在计算机中如何表示负数呢？
zuoph
·
2023-12-04 02:18
数字电路
fpga开发
国防科技大学孙志刚：时间敏感网络数据平面关键技术
其团队自2019年开始研究TSN网络，基于开源的OpenTSN平台推出了枫林一号开源TSN芯片和一系列的产品，其芯片的
Verilog
代码是公开的。该开源平台也得到了主机厂、科研机构的合作和推广。
Mike吕
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2023-12-04 00:24
汽车以太网
汽车
网络
「
Verilog
学习笔记」自动贩售机2
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网自动贩售机中可能存在的几种金额：0，0.5，1，1.5，2，2.5，3。
KS〔学IC版〕
·
2023-12-03 12:21
Verilog学习笔记
学习
笔记
Verilog
「
Verilog
学习笔记」状态机-重叠序列检测
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网读入数据移位寄存，寄存后的数据与序列数做对比，相等则flag为1，不等则为0`timescale1ns/1nsmodulesequence_test2
KS〔学IC版〕
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2023-12-03 12:51
Verilog学习笔记
学习
笔记
Verilog
「
Verilog
学习笔记」自动贩售机1
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网自动贩售机中可能存在的几种金额：0，0.5，1，1.5，2，2.5，3。
KS〔学IC版〕
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2023-12-03 12:19
Verilog学习笔记
学习
笔记
Verilog
计算机组成与设计实训-用
Verilog
HDL 玩转计算机硬件系统设计（头歌实践教育平台） 学习过程记录
Verilog
（知识&实验）Author:PeterHan计算机组成与设计实训-用
Verilog
HDL玩转计算机硬件系统设计(educoder.net)//
Verilog
HDL模块的模板（仅考虑用于逻辑综合的程序
Peter1146717850
·
2023-12-03 12:01
学习
数字逻辑——时序
电路设计
（下）
一、实验目的掌握时钟的使用方法掌握锁存器和触发器的原理掌握计数器模块的设计方法掌握移位寄存器的设计方法掌握存储器阵列的设计方法了解点阵屏在数字电路中的应用理解时序
电路设计
在应用场景中的作用二、实验环境本实验采用
jmu-pfm
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2023-12-03 10:44
算法
FPGA学习之
Verilog
语言入门指导（嵌入式）
FPGA学习之
Verilog
语言入门指导（嵌入式）
Verilog
是一种硬件描述语言（HDL），广泛用于FPGA（可编程逻辑器件）的设计和开发。
技术无限探索
·
2023-12-02 22:57
fpga开发
学习
嵌入式
FPGA系列：1、FPGA/
verilog
源代码保护：基于Quartus13.1平台保护
verilog
源码发给第三方但不泄露源码
catlog需求具体步骤工程描述去掉相关调试文件切换顶层模块并导出相应模块为网表文件切换回原顶层模块并添加相应保护模块的qxp文件再次编译工程注意事项parameter参数参考：需求有时需要将源码交付给第三方，但是源码中部分模块涉及到的核心代码无法暴漏给第三方。因此，我们需要一种能够让第三方拿到源码对部分参数进行修改、但同时又无法触及到核心代码的代码保护方法。本文结合部分资料，给出了如何将quar
天城寺电子
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2023-12-02 18:08
FPGA
fpga开发
「
Verilog
学习笔记」时钟分频（偶数）
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网`timescale1ns/1nsmoduleeven_div(inputwirerst,inputwireclk_in
KS〔学IC版〕
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2023-12-02 09:23
Verilog学习笔记
学习
笔记
fpga开发
Verilog
FPGA纯
verilog
实现 LZMA 数据压缩，提供工程源码和技术支持
FPGA纯
verilog
实现LZMA数据压缩，提供工程源码和技术支持目录1、前言2、我这儿已有的FPGA压缩算法方案3、FPGALZMA数据压缩功能和性能4、FPGALZMA数据压缩设计方案输入输出接口描述数据处理流程
hexiaoyan827
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2023-12-02 09:21
fpga开发
高速信号处理
LZMA
数据压缩
FPGA压缩算法方案
加速计算
北邮22级信通院数电：
Verilog
-FPGA（12）第十二周实验（2）彩虹呼吸灯
北邮22信通一枚~跟随课程进度更新北邮信通院数字系统设计的笔记、代码和文章持续关注作者迎接数电实验学习~获取更多文章，请访问专栏：北邮22级信通院数电实验_青山如墨雨如画的博客-CSDN博客目录一.代码部分二.管脚分配三.实验效果一.代码部分rainbow_breathing_light.vmodulepwm(input[7:0]duty,inputclk,outputregout);reg[7:
青山入墨雨如画
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2023-12-02 09:51
北邮22级信通院数电实验
fpga开发
北邮22级信通院数电：
Verilog
-FPGA（12）第十二周实验（1）设计一个汽车尾灯自动控制系统
北邮22信通一枚~跟随课程进度更新北邮信通院数字系统设计的笔记、代码和文章持续关注作者迎接数电实验学习~获取更多文章，请访问专栏：北邮22级信通院数电实验_青山如墨雨如画的博客-CSDN博客目录一.题目要求二.代码部分2.1car_system.v2.2divide.v三.管脚分配四.实现效果一.题目要求设计一个汽车尾灯自动控制系统，要求根据汽车行驶状态自动控制汽车尾灯：直行：尾灯不亮；右转：右侧
青山入墨雨如画
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2023-12-02 09:49
北邮22级信通院数电实验
fpga开发
modelsim-SE仿真error问题
3.如果是Error(10054):
Verilog
HDLFileI/Oerroratsdram_ctrl_tb.v(6):can'tope
会飞的珠珠侠
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2023-12-02 07:19
FPGA
fpga
国内某知名半导体公司：实现虚拟化环境下的文件跨网安全交换
立足特定应用领域的创新型企业上海某半导体公司是中国10大集成
电路设计
公司之一的子公司。该半导体公司是一家特色工艺集成电路芯片制造企业，专注模拟电路、功率器件所需的特色生产工艺研发与制造，。
Ftrans
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2023-12-01 23:08
跨网文件交换
内外网文件交换
安全
网络
大数据
【ESP32-S3的开发】| 2.ESP32S3 驱动 RGB-LED
【ESP32-S3的开发】第二章驱动RGB-LED【ESP32-S3的开发】前言一、RGB-LED硬件
电路设计
二、WS2812LED驱动器1.遇见问题不要慌，先找一下SDK的example2.原理图的SK68xx
信仰爆炸
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2023-12-01 17:07
ESP32S3
单片机
物联网
嵌入式硬件
SystemC Study
简介SystemC的意义，网上能查到，这里总结一下，SystemC是C++的library，类似UVM是system
verilog
的library下图是SystemC在整个项目中的角色硬件架构探索，创建算法
Vinson_Yin
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2023-12-01 16:36
SystemC
systemc
【【FPGA的 MicroBlaze 的 介绍与使用 】】
FPGA的MicroBlaze的介绍与使用可编程片上系统（SOPC）的设计在进行系统设计时，倘若系统非常复杂，采用传统FPGA单独用
Verilog
/VHDL语言进行开发的方式，工作量无疑是巨大的，这时调用
ZxsLoves
·
2023-12-01 16:30
FPGA学习
fpga开发
【每日一题】一起学
Verilog
001-004
001画出CMOS反相器的电路原理图这个学过数集应该都会画，NMOS接地，PMOS接高电平。002反向器的速度与哪些因素有关？什么是转换时间（transitiontime）和传播延迟（propagationdelay）？反相器的速度与哪些因素有关。（1）电容（负载电容、自载电容、连线电容）较小，漏端扩散区的面积应尽可能小。输入电容要考虑：（1）Cgs随栅压而变化（2）密勒效应（3）自举效应（2）加
不求上进的夏天
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2023-12-01 15:43
AI时代FPGA厂商与FPGA工程师该如何转型？
《单片机与嵌入式系统应用》小编特意邀请了专家给大家答疑解惑~业界声音掌握
Verilog
FPGA设计和验证方法是AI时代系统设计师的生命线北航电子信息工程学院退休教授北京至芯
喜欢打酱油的老鸟
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2023-12-01 13:06
人工智能
AI时代
FPGA
转型
基于51单片机的数字频率计设计
2.2系统硬件
电路设计
根据系统设计方案进行软、硬件的分配，软、硬件设计分别进行。硬件设计包括单片机最小系统和扩展接
K11mvp
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2023-12-01 10:03
51单片机
单片机
嵌入式硬件
芯引擎·新力量 | 第五届浦东新区长三角集成电路技能邀请赛圆满落幕
9月27日，2023年全国工业和信息化技术技能大赛上海选拔赛、上海职工职业技能系列赛暨第五届浦东新区长三角集成电路技能邀请赛汽车芯片设计竞赛及颁奖典礼在上海集成
电路设计
产业园举办，上海市经济和信息化委员会人事教育处处长黄春华
Eecourse
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2023-12-01 08:20
人工智能
用linux集成电路版图设计,集成电路版图设计项目化教程(第2版)
章集成电路及版图设计概念、方法与工具11.1集成电路的制造和设计概念21.1.1集成电路的概念与产品21.1.2集成电路的制造流程31.1.3集成电路的设计要求41.1.4集成电路的设计流程51.1.5集成
电路设计
的分类
一朵小Rose
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2023-12-01 04:02
用linux集成电路版图设计
【合集一】每日一练30讲，轻松掌握
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小眼睛FPGA
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2023-12-01 00:49
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【合集二】每日一练30讲，轻松掌握
Verilog
语法
本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处（www.meyesemi.com)第十六练：reg型存储器声明（二维数组）题目：声明一个位宽为8，深度为32的二维数组变量ram答案：reg[7:0]ram[31:0];解析：reg［wordsize：0］array_name［arraysize：0］;wordsize表示位宽，arraysize表示深度第十七
小眼睛FPGA
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2023-12-01 00:49
算法
Verilog
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基础：时序调度中的竞争（一）
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Verilog基础
数字IC
硬件工程
前端
fpga开发
Verilog
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