FPGA时序

FPGA——HC-05蓝牙串口实验

HC-05蓝牙模块买来的模块背面就长这样子，总共有六个引脚，实际只用四个脚（RXD、TXD、GND和VCC）就可以进行数据的收发，以默认的9600bps的波特率，由于目前项目对速度要求不高，因此也没有深入研究AT指令等。关于蓝牙模块的协议其实就是一个串口协议，在蓝牙配对成功后，就相当于以无线的方式进行串口通信。关于串口协议可参考我之前的一篇博客：串口回环蓝牙串口实验做这个实验的目的就是更好地理解蓝
Spider X·2024-01-01 02:13

ZYNQ使用Tri Mode Ethernet MAC千兆网光通信

一，原理SFP接口的FPGA开发板可以通过安装SFP转RJ45模块或者直接通过光纤进行以太网通信。
寒听雪落·2024-01-01 02:12

基于低功耗蓝牙和微信小程序的门禁系统(FPGA课设设计)

基于低功耗蓝牙和微信小程序的门禁系统(FPGA课设设计)文章目录基于低功耗蓝牙和微信小程序的门禁系统(FPGA课设设计)一、低功耗蓝牙(BLE)的配置和与FPGA通信代码1.1低功耗蓝牙的介绍及配置1.2
A DOG BY MY SIDE·2024-01-01 02:11

FPGA--ZCU106通过SFP+/SGMII模块传输数据-第一讲（全网唯一）

1引言距离上次文章已经过去了一个半月，但并没有停止研究fpga的脚步，今天给大家带来的是基于ZCU106开发板的通过SFP+/SGMII口通过光纤或网线与PC机传输数据的内容，本系列教程计划写三篇，如有不对之处还请海涵
发光的沙子·2024-01-01 02:10

8—基于FPGA(ZYNQ-Z2)的多功能小车—软件设计—寻迹模块、寻光模块、跟随模块

目录1.寻迹模块2.寻光模块3.跟随模块1.寻迹模块寻迹模块的实现需要两个TCRT5000传感器。简单地说，检测到黑线输出低电平，检测到白线输出高电平。因此两个TCRT5000放在黑色地面的白线循迹线左右，左边检测到白线左转，右边检测到白线右转，都是黑的前进，都是白线停止。算法比较容易实现。OUT信号输出，黑色为0，白色为1VCC5V供电GND接地代码如下：//寻迹模式elseif(data==8
贡橙小白鼠·2024-01-01 02:38

9—基于FPGA(ZYNQ-Z2)的多功能小车—拓展功能—OpenMV的色块识别

由于之前的红外遥控已经外接了Arduino，因此我依然借助Arduino对红绿蓝进行编码，使用两个IO实现信息传递，在FPGA上进行译码，最后根据对应的信息实现数码管显示。流程如下:2
贡橙小白鼠·2024-01-01 02:38

1—基于FPGA(ZYNQ-Z2)的多功能小车—硬件设计—电源模块

目录1.稳压模块设计1.1LM317可调稳压1.2LM2596-5V1.3AMS1117-3.3V2外围电路设计3.电源模块原理图1.稳压模块设计我们的小车使用7.4V的锂电池供电，无法直接为各模块和FPGA
贡橙小白鼠·2024-01-01 02:08

2—基于FPGA(ZYNQ-Z2)的多功能小车—硬件设计—电机驱动模块(TB6612FNG)

目录1.驱动电路2.TB6612FNG介绍3.电路原理图1.驱动电路FPGA的引脚电流都比较小，一般为几十微安，但是驱动电机的电流远大于此。因此需要一个电机驱动模块来作为桥梁，连接FPGA与电机。
贡橙小白鼠·2024-01-01 02:08

4—基于FPGA(ZYNQ-Z2)的多功能小车—软件设计—电机驱动模块

我使用的FPGA是Xilinx的PYNQ-7020（ZYNQ-Z2），在Vivado2018.3平台使用Verilog进行编程。
贡橙小白鼠·2024-01-01 02:08

10—基于FPGA(ZYNQ-Z2)的多功能小车—软件设计—顶层代码

在之前的文章中具体控制代码已经全部进行了分析与解释，顶层模块进行模块的输入输出的定义、内部变量的定义、模块的实例化与蓝牙信号的判断。代码如下：moduletop_modlue(inputclk,//系统时钟inputreset,//复位按键inputrx,//蓝牙接收inputwire[3:0]signal,//红外信号inputwireEcho,//超声波接收input[3:0]track,//
贡橙小白鼠·2024-01-01 02:08

0—基于FPGA(ZYNQ-Z2)的多功能小车

目录1.题目2.题目分析：3.器件使用4.工程文件5.传送门1.题目基于FPGA的多功能小车1、基本要求设计一个多功能的智能小车，通过多传感器的数据融合可以实现智能小车的红外避障、循迹、寻光、红外遥控、
贡橙小白鼠·2024-01-01 02:37

Verilog跑马灯 nexy4ddr

基于小梅哥b站FPGA视频要求：八个Led灯每隔0.05s循环闪烁verilog设计：moduleled_run(inputclk,//时钟100MHZ1/100000000=10nsinputrst_n
夏澄啊·2024-01-01 02:07

基于FPGA的蓝牙遥控，超声波避障，红外循迹的智能小车

闲来无事整个小车玩玩，设想的小车可以有蓝牙模块来控制模式切换，通过发送指令来更改相对应的功能，当避障的时候可以自动规避障碍物，当处于红外循迹时，可以跟随规划的轨迹前线，当手动遥控时可以控制前进后退左右转向停止等功能。先介绍一下使用的红外模块，其上有四个管脚，vcc接电源，gnd接地，D0传输红外线是否被吸收，A0传输模拟信号主要是不同距离输出不同的电压，但是此脚一般可以不接.然后思路就是通过判断D
林中一只虎·2024-01-01 02:37

FPGA——基于Verilog HDL语言的交通信号灯控制系统

1、系统设计要求该交通灯控制器用于主干道与支道公路的交叉路口，要求是优先保证主干道的畅通，因此，设计要求如下。1、平时处于“主干道绿灯，支道红灯”状态，只有在支道有车辆要穿过主干道时，才将交通灯切向“主干道红灯，支道绿灯”，一旦支道无车辆通过路口，交通灯又回到“主干道绿灯，支道红灯”的状态。2、主干道每次通行的时间不得短于1min，支路每次通行的时间不得长于20s，而这两个状态交换过程中出现“主干
陈曦子。·2024-01-01 02:37

什么是VHDL？一文带你了解VHDL语言

基于FPGA的SOC在嵌入式系统应用越来越广了，比较流行的硬件描述语言有两种VerilogHDL/VHDL，均为IEEE标准。VHDL如果有C语言基础的话就会比较容易上手。
IC修真院·2024-01-01 02:36

【FPGA】Verilog：BCD 加法器的实现 | BCD 运算 | Single-level 16 bit 超前进位加法器 | 2-level 16-bit 超前进位加法器

0x00BCD运算在BCD中，使用4位值作为操作数，但由于只表示0到9的数字，因此只使用0000到1001的二进制数，而不使用1010到1111的二进制数（don'tcare）。因此，不能使用常规的2'complement运算来计算，需要额外的处理：如果4位二进制数的运算结果在1010到1111的范围内，需要将6(即0110)，添加到运算结果中。BCD运算例子0x01BCD加法器的实现
柠檬叶子C·2024-01-01 02:34

FPGA平台以太网学习：涉及1G/2.5G Ethernet 和Tri Mode Ethernet MAC两个IP核的学习记录（一）——知识补给

学习不能稀里糊涂，要学会多思考，发散式学习以及总结：FPGA作为一种器件，只是实现目的的一种方法，过度追求实现的技术细节(用hdl还是hls，用啥芯片，用啥接口)容易只见树木不见森林。
FPGA_青年·2024-01-01 02:33

5—基于FPGA(ZYNQ-Z2)的多功能小车—软件设计—蓝牙串口

即FPGA约束的TX对应蓝牙模块的RX，约束的RX对应蓝牙模块的TX。2.UART介绍蓝牙模块使用UART串口通信协议，具体介绍如下：UART（通用异步收发器
贡橙小白鼠·2024-01-01 02:33

单细胞 拟时序分析 | diffusionMap

1.简介DiffusionMap（扩散映射）是一款R软件，通过高斯模型和马尔科夫模型，把单细胞（scRNA）表达矩阵的非线性结构映射为连续性结构，并关联至对应细胞分组。数据计算主要包括以下几步：A.由四种不同细胞类型组成的n×G单细胞表达矩阵。矩阵右侧的最后一列代表每个细胞的类型;B.在G维基因空间中，由高斯函数表示每个细胞。由于高斯波干扰，具有相对高概率密度的连续路径在数据流形上形成扩散路径;C
biomooc·2024-01-01 00:02

STM32 IIC开发学习

1IIC总线时序图①起始信号当SCL为高电平期间，SDA由高到低的跳变。起始信号是一种电平跳变时序信号，而不是一个电平信号。该信号由主机发出，在起始信号产生后，总线就会处于被占用状态，准备数据传输。
LEEE@FPGA·2023-12-31 22:14

关于使用复旦微procise软件，网卡的MAC被禁怎么办？

笔者在使用复旦微FPGA开发的时候。由于复旦微的软件开发平台procise需要用到license。
sysrst·2023-12-31 20:52

复旦微ZYNQ EMIO控制PL LED

一，复旦微和XILINX对比（我的了解）1，复旦微ZYNQFPGA开发工具是Procise，ARM开发工具是IAR；2，它与xilinxZYNQ不同的是，xilinx移植的是两个ARMCONTEXA9或者高端
寒听雪落·2023-12-31 20:22

【xdma】 pcie.bar设置

FPGA优质开源项目–PCIE通信xdma两者保持一致FPGA开源项目–PCIEI/O控制卡xdmaPCIe的XDMA应用读写部分分为两种，一种是数据的读写，另一种是配置数据的读写，在数据读写部分，DMA
黄埔数据分析·2023-12-31 20:08

Quartus的Signal Tap II的使用技巧

概述：SignalTapII全称SignalTapIILogicAnalyzer，是第二代系统级调试工具，它集成在QuartusII软件中，可以捕获和显示实时信号，是一款功能强大、极具实用性的FPGA片上调试工具软件
GBXLUO·2023-12-31 20:37

Grafana增加仪表盘

1.Grafana介绍grafana是一款采用Go语言编写的开源应用，主要用于大规模指标数据的可视化展现，是网络架构和应用分析中最流行的时序数据展示工具，目前已经支持绝大部分常用的时序数据库。
tuoluzhe8521·2023-12-31 17:34

计网——物理层

机械特性形状和尺寸引脚数目和排列固定和锁定装置2.电气特性信号电压的范围阻抗匹配的情况传输速率距离限制3.功能特性规定接口电缆的各条信号线的作用4.过程特性规定在信号线上传输比特流的一组操作过程，包括各信号间的时序关系
小孩瞎学着玩的·2023-12-31 15:06

【FPGA/verilog -入门学习14】vivado FPGA按键消抖

//led流水1s//1，按键触发变化，上升沿or下降沿，都清除计数//2，当20ms计数到来时，加载一次按键状态，如果中途有按键变化，清除计数`timescale1ns/1psmodulevlg_design(inputi_clk,inputi_rest_n,input[7:0]key,outputreg[7:0]led);`defineSIMULATION`ifdefSIMULATIONpar
王者时代·2023-12-31 12:30

【FPGA/verilog -入门学习13】verilog 1s流水灯实验

//led1S实验//使用分屏实验1s计数`timescale1ns/1psmodulevlg_design(inputi_clk,inputi_rest_n,input[7:0]key,outputreg[7:0]led);`defineCNT_1S_DEBUG`ifndefCNT_1S_DEBUGparameterCNT_1S_MAX=1_000_000_000/20-1;`else/*CNT
王者时代·2023-12-31 12:59

时间注意力——给时间步赋予权重（有的时间不重要，权重很低，有的时间步重要，权重很高）

时间注意力机制是什么时间注意力机制是深度学习中用于处理时序数据的一种技术。它允许模型在处理序列数据时，对不同时间步的信息赋予不同的重要性或关注度。
盐巴饭团193·2023-12-31 12:18

【INTEL（ALTERA）】使用HDMI FPGA IP 2.0 TX 和 HDMI FPGA IP RX 2.1时为何 HDMI IP 没有视频输出？

说明由于英特尔®Quartus®Prime专业版软件23.1及更早版本存在问题，将HDMI英特尔®FPGAIP2.0TX和HDMI英特尔®FPGAIP2.1RX集成到设计中时，不会显示HDMI视频输出。
神仙约架·2023-12-31 11:02

【INTEL（ALTERA）】为什么 BurstMin 增强调度在 F-tile Interlaken 英特尔® FPGA IP中没有按预期工作?

说明由于英特尔®Quartus®PrimeProEdition软件22.4及更早版本存在问题，数据包模式的BurstMin增强调度无法在F-tileInterlaken英特尔®FPGAIP中按预期工作。
神仙约架·2023-12-31 11:32

【INTEL（ALTERA）】为什么低延迟以太网 10G MAC 英特尔® Stratix® 10 FPGA IP 设计示例生成完成并出错？

说明由于英特尔®Quartus®Prime专业版软件21.3版本存在问题，无法成功生成低延迟以太网10GMAC英特尔®Stratix®10FPGAIP设计示例。
神仙约架·2023-12-31 11:32

时序分解 | Matlab实现ICEEMDAN改进的完全自适应噪声集合经验模态分解时间序列信号分解

时序分解|Matlab实现ICEEMDAN改进的完全自适应噪声集合经验模态分解时间序列信号分解目录时序分解|Matlab实现ICEEMDAN改进的完全自适应噪声集合经验模态分解时间序列信号分解效果一览基本介绍程序设计参考资料效果一览基本介绍
机器学习之心·2023-12-31 08:52

时序分解 | Matlab实现贝叶斯变化点检测与时间序列分解

时序分解|Matlab实现贝叶斯变化点检测与时间序列分解目录时序分解|Matlab实现贝叶斯变化点检测与时间序列分解效果一览基本介绍程序设计参考资料效果一览基本介绍Matlab实现贝叶斯变化点检测与时间序列分解
机器学习之心·2023-12-31 08:17

实验九 基于FPGA的计数译码显示电路设计

基本任务一：利用FPGA硬件平台上的4位数码管做静态显示，用SW0-3输入BCD码，用SW4-7控制数码管位选m100：frediv：decoder：基本任务二：利用FPGA硬件平台上的4位数码管显示m10
22的卡卡·2023-12-31 08:40

FPGA与DSP的区别（粗略整理）

FPGA与DSP的区别（粗略整理）一、结构特点FPGAa.片内有大量的逻辑门和触发器，多为查找表结构，实现工艺多为SRAMb.可以通过硬件描述语言进行快速设计和改进，能够重复编程c.掉电后一般会丢失原有逻辑配置
Clara_D·2023-12-31 08:39

FPGA和DSP的区别

FPGA与DSPFPGA与DSP的区别（粗略整理）https://blog.csdn.net/clara_d/article/details/82355397ARM,DSP,FPGA三者比较csdn链接
sangba2019·2023-12-31 08:38

HI3559AV100和FPGA 7K690T的PCIE接口调试记录

系统主要功能是FPGA采集srio接口过来的图像数据，再通过pcie把数据传递给3559，3559再实现图像数据的存储、AI处理、编码输出等。
雨之小·2023-12-31 07:08

【Matlab】CNN卷积神经网络时序预测算法

资源下载：https://download.csdn.net/download/vvoennvv/88681558一，概述CNN（ConvolutionalNeuralNetwork，卷积神经网络）是一种前馈神经网络，主要用于处理具有类似网格结构的数据，例如图像和音频。CNN的主要特点是卷积层和池化层的交替使用来提取数据特征，以及使用全连接层对这些特征进行分类和识别。CNN的主要结构包括卷积层、池
千源万码·2023-12-31 05:34

【Matlab】ELM极限学习机时序预测算法

资源下载：https://download.csdn.net/download/vvoennvv/88681649一，概述ELM（ExtremeLearningMachine）是一种单层前馈神经网络结构，与传统神经网络不同的是，ELM的隐层神经元权重以及偏置都是随机产生的，并且在网络训练过程中不会更新。这种随机初始化的方法使得ELM的训练速度非常快，同时避免了传统神经网络中需要反复调整权重的问题。
千源万码·2023-12-31 05:34

【Matlab】基于遗传算法优化BP神经网络 (GA-BP)的数据时序预测

资源下载：https://download.csdn.net/download/vvoennvv/88682033一，概述基于遗传算法优化BP神经网络(GA-BP)的数据时序预测是一种常用的机器学习方法
千源万码·2023-12-31 05:34

【Matlab】BP 神经网络时序预测算法

资源下载：https://download.csdn.net/download/vvoennvv/88681507一，概述BP神经网络是一种常见的人工神经网络，也是一种有监督学习的神经网络。其全称为“BackPropagation”，即反向传播算法。BP神经网络主要由输入层、隐藏层和输出层组成，每一层都由多个神经元组成。BP神经网络的学习过程是通过不断地调整权值和偏置值来逐步提高网络的精度。BP神
千源万码·2023-12-31 05:26

基于AM62x的ARM+FPGA+Codesys低成本软PLC解决方案

GPMC是AM62x、AM64x、AM437x、AM335x、AM57x等处理器专用于与外部存储器设备的接口，如：(1)FPGA器件(2)ADC器件(3)SRAM内存(4)NOR/NAND闪存G
深圳信迈科技DSP+ARM+FPGA·2023-12-31 05:16

【MATLAB】BiGRU神经网络时序预测算法

有意向获取代码，请转文末观看代码获取方式~也可转原文链接获取~1基本定义BiGRU神经网络时序预测算法是一种基于双向门控循环单元（GRU）的多变量时间序列预测方法。
Lwcah·2023-12-31 05:26

夕阳下，徒步灵江南岸城防公园

清风徐来，有点凉凉的感觉，毕竟盛夏已过，时序已入
细雨寒沙·2023-12-31 05:49

利用fpga(verilog)实现SPI-flash芯片全擦除实验

最近在学习spi协议，看了看野火的视频，感觉野火的代码是一坨大便，寄存器太多了，看的眼花缭乱。跟着野火的波形图做了一遍，仿真正确但是上板没成功。看了看师兄的代码，然后自己又换了一种方法实现全擦除。最后上板成功，各位大佬有更好的见解可以和我交流，代码如下：//-----------------------------------------------------------------------
守雲开见月明·2023-12-31 04:58

利用FPGA（verilog）实现SPI-FLASH芯片扇区擦除

一.M25P16flash芯片介绍本设计使用了M25P16flash芯片，它拥有16Mbit的空间。M25P16flash芯片有32个扇区，每个扇区有256页，每页有256个位空间。32*256*256=2097152=16M。因此它的地址有24位。它的各扇区地址如下表。二.扇区擦除原理扇区擦除（SE）指令可以按照扇区擦除Flash。和块擦除不同的是，扇区擦除是要指定扇区地址，扇区擦除前也需要发送
守雲开见月明·2023-12-31 04:58

FPGA实现IIC接口（1）-EEPROM芯片读取数据

fpga型号：EP4CE6F17C8开发工具：Quartusll13.0+Modelsim10.1c系统时钟：50MHZIIC
守雲开见月明·2023-12-31 04:25

基于FPGA的数字电路（PWM脉宽调制）

二.FPGA设计框图把上面的描述再抽象化一下，就可以画出的模块框图。锯齿波实际上就可以用计数器生成，阈值就是一个数值而已，比较器是用来生成最后输出高低电平用的。三.代码实现设
我来挖坑啦·2023-12-31 00:27

时序数据库TDengine安装及c#连接读写数据

物联网数据采集，需写入大量数据，这时就用到时序数据库来存储和快速读取我个人使用感觉国产的开源项目TDengine，比InfluxDB操作方便很多，容易上手，支持使用SqlSugar进行数据操作，跟操作mysql
.net亦洪·2023-12-30 23:46
上一页 29 30 31 32 33 34 35 36 下一页
按字母分类： ABCDEFGHIJKLMNOPQRSTUVWXYZ其他