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Linux
xilinx；
已经有的HLS高层次综合(High Level Synthesis,HLS)产品-参考
AutoPilotfromAutoESL(
Xilinx
已经收购AutoESL)BlueSpecCompilerfromBlueSpecC-to-SiliconfromCadenceDesignSystemsSynphonyCCompilerfromSynopsysCynthesizerfromForteDesignSystemsLegUpfromUniversityofToronto
FPGA-ALGOer
·
2020-08-15 10:16
FPGA基本功
Vivado中开发ZYNQ系列芯片，在SDK中进行xilffs文件系统开发遇到的问题解决方法
由于在裸机下进行开发不像具有操作系统那样，直接可以读写文件，因此文件系统的移植是一个很很大的问题，好在查阅相关资料以后发现
Xilinx
公司竟然提供了文件系统，也就是xilffs，这东西的实质说白了就是FATFS
STM32F7
·
2020-08-15 10:11
浅谈vivado HLS从C/C++到硬件描述语言转换
高层次综合（HighLevelSynthesis,HLS）是
Xilinx
公司推出的最新一代的FPGA设计工具，它能让用户通过编写C/C++等高级语言代码实现RTL级的硬件功能。
LLJ505
·
2020-08-15 10:39
EDA
Zynq Fatfs文件系统应用笔记
ZynqFatfs文件系统应用笔Hello,panda笔记介绍基于所描述的ZynqFatfs基于
Xilinx
xilffsv3.0和Sdpsv2.4，文件系统采用在Bare-Metal和轻量级操作系统中常用的
_Hello_Panda_
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2020-08-15 10:55
xilinx随笔
晶圆级封装(WLCSP) & 倒片封装(Flip-Chip)
FPGA封装比如CSG，G（green）表示无铅；https://china.
xilinx
.com/support/answers/15023.html"G"and"V"packageHowdo"G"and"V"packagedesignatorsdifferwithrespecttoRoHS
碰碰跳跳
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2020-08-14 13:55
xilinx
EDA
器件
《FPGA功耗及热点分析》论文解读
功耗分析工具
Xilinx
的XPowerEstimator
xiaonan0902
·
2020-08-14 12:59
FPGA
jesd204b实战操作笔记
本篇的内容基于jesd204b接口的ADC和FPGA的硬件板卡，通过调用jesd204bip核来一步步在FPGA内部实现高速ADC数据采集，jesd204b协议和
xilinx
的jesd204IP核相关基本知识已在前面多篇文章中详细介绍
小青菜哥哥
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2020-08-14 06:54
核探测器与核电子学
通信
数据处理
入门Verilog---赋值和各种运算符小结
以下很多内容都是借鉴书籍《
Xilinx
FPGA开发实用教程》而得。
qq_38374491
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2020-08-14 03:15
FPGA
入门
【接口时序】4、SPI总线的原理与Verilog实现
一、软件平台与硬件平台软件平台：1、操作系统：Windows-8.12、开发套件：ISE14.73、仿真工具：ModelSim-10.4-SE硬件平台：1、FPGA型号：
Xilinx
公司的XC6SLX45
weixin_30851409
·
2020-08-14 02:12
petalinux-bulid失败解决方法 ERROR: qemu-
xilinx
-native-v2.11.1-
xilinx
-v2019.1+gitAUTOINC+5f38ea92fb-r0
petalinux成功安装之后，建立工程并开始使用petalinux-build编译工程，但出现报错信息：ERROR:qemu-
xilinx
-native-v2.11.1-
xilinx
-v2019.1+
yohe12
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2020-08-14 02:46
ZYNQ学习
Xilinx
板卡夏季钜惠活动来袭！最高直降1500元！
夏日炎炎，酷暑当前作为FPGA的工程师的你需要清凉一“夏”米尔
Xilinx
板卡给你降温消暑夏季钜惠活动来袭~~~MYC-CZU3EG/4EV核心板型号：MYC-CZU3EG-4E4D-1200-C零售价
米尔MYIR
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2020-08-14 02:11
xilinx
zynq
开发板
如何用百度大脑FZ3深度学习卡+Paddle模型创建你的应用？
前言：米尔科技的FZ3是与百度紧密合作推出的一款基于
Xilinx
ZynqUltrascaleCZU3EG芯片打造的深度学习计算卡，芯片内部集成了4核ARMA53处理器+GPU+FPGA的架构，具有多核心处理能力
米尔MYIR
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2020-08-14 02:40
【经验整理.01】
Xilinx
网站资源导读 ISE11版
【经验整理.01】
Xilinx
网站资源导读ISE11版标签:ISE
Xilinx
入门资源2009-09-0120:41序虽然自己也曾想过，但如果不是向农要求，把曾经写过的文章编排整理，我是静不下心来好好做这件事的
weixin_30355437
·
2020-08-14 01:02
(原创)基于ZedBoard的Webcam设计(一)：USB摄像头(V4L2接口)的图片采集
Xilinx
官方给出了一个Webcam摄像头监控的例子，跑的是linaro，不知道是我的SD卡问题还是摄像头的问题，播放视频的时候总是会很卡，而且突然系统就死掉了。还是很喜欢自己动手，能学到新东西。
weixin_30611509
·
2020-08-13 20:36
基于
xilinx
异构平台上视频采集分析
1.设备树结构
xilinx
平台端vcap_csi{compatible="xlnx,video";dmas=;dma-names="port0";ports{#address-cells=;#size-cells
夕阳-鼬
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2020-08-13 19:17
2020-08-12总结依元素科技PYNQ直播Day two
视频链接输入192.168.2.99进入（用户名、密码：
xilinx
)Jupyterbook能识别的文件格式是--.ipynb搭建好底层环境系统，再对底层环境系统一个操控。
c4d82bfede08
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2020-08-13 03:13
xilinx
ddr3 MIG ip核使用详解
1，DDR3基本内容介绍1.1，DDR3简介DDR3全称double-data-rate3synchronousdynamicRAM，即第三代双倍速率同步动态随机存储器。所谓同步，是指DDR3数据的读取写入是按时钟同步的；所谓动态，是指DDR3中的数据掉电无法保存，且需要周期性的刷新，才能保持数据；所谓随机存取，即可以随机操作任一地址的数据；所谓double-data-rate，即时钟的上升沿和下
admiraion123
·
2020-08-12 22:20
Memory
Interface
LLVM初步了解
LLVM已经被IOS开发工具、
Xilinx
Vivado、Facebook、Google等采用。LLVM核心库提供了与编译器相关的支持，可以作为多种语言编译器的后台来使用。
bcbobo21cn
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2020-08-11 16:35
VC++
xilinx
apu ,rpu特点 及通信
ZynqUltraScale+MPSoC的PS有以下主要特点：一个四核64位ARMCortex-A53处理器，带L1和L2级缓存和ECC功能，可单独上电和关电；Cache一致性互联单元为PS和PL提供双向Cache一致性保证；SMMU（系统内存管理）单元用于PS和PL虚拟内存管理；双核ARMCortex-R5F处理器（带浮点扩展），可运行在锁步模式或独立工作模式，包含Cache和带ECC的存储，可
xiaotaiyangzuishuai
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2020-08-11 15:14
xilinx
Xilinx
FPGA “打一拍”“打两拍”以及IOB含义
Xilinx
FPGA“打一拍”“打两拍”以及IOB含义本次总结主要是参考网上的说法，最近在接触到异步时钟同步的时候了解到利用“非阻塞赋值datadelay，造成建立/保持时间的冲突。
请answer1996
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2020-08-11 14:53
FPGA初学
ERROR:Bitgen:342
ZedBoard学习-解决ERROR:Bitgen:3422013-02-2500:23:29分享：今天在看
xilinx
的官方手册ZedBoard-CTT-V14.1时发现手册中实验3.1AddingsoftIPinthePLtointerfacewiththeZynqPS
乔克sw
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2020-08-11 13:32
硬件开发
锁相环PLL（一）
Xilinx
PLL IP核使用方法
新建IP核文件如图所示，在“DesignàImplementation”下的任意空白处单击鼠标右键，弹出菜单中选择“NewSource…”。在弹出的“NewSourceWizardàSelectSourceType”下，如图所示，选择文件类型为“IP(COREGenerator&ArchitectureWizard)”。“Filename”可以给新创建的PLL取个名字，我们命名为“pll_cont
qq_30866297
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2020-08-11 12:15
FPGA
串口、COM口、TTL、RS232、RS485区别详解
原贴地址：http://
xilinx
.eetrend.com/article/107121、串口、COM口是指的物理接口形式(硬件)。而TTL、RS-232、RS-485是指的电平标准(电信号)。
Freelings
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2020-08-11 12:25
硬件
STM32
zynqmp + igh ethercat主站方案设计及程序
zynqmp纯PS端的主站方案，不涉及PL端，主站代码是IGH1.5.2，硬件平台
xilinx
官方zc102开发板，4核A53架构最便宜的开发板是FPGA开发板UltraScale+ZU3EGZYNQMPSOCEdgeboard
huoxian00
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2020-08-11 12:47
verilog语言RS232串口发送模块设计——采集ps2键盘数据在串口调试工具显示
该模块功能可以完成对ps2键盘的数据采集，采集数据在
xilinx
EXCD-1开发板的数码管输出（输出为按键值对
baijingdong
·
2020-08-11 11:58
verilog
ps2
rs232
uart
xilinx
Xilinx
FPGA的约束设计和时序分析总结 (转)
下面主要总结一下
Xilinx
FPGA时序约束设计和分析。一、周期约束周期约束是
Xilinx
FPGA时序约束中最常见的约束方式。它附加在时钟网线上，
RobinXiangZhi
·
2020-08-11 11:07
FPGA
fpga
FPGA---ucf文件编写
Xilinx
FPGA设计约束的分类
Xilinx
定义了如下几种约束类型：•“AttributesandConstraints”•“CPLDFitter”•“GroupingConstraints”•“LogicalConstraints
weixin_33690367
·
2020-08-11 04:48
ISE约束--UCF编辑的入门介绍
Xilinx
FPGA设计约束的分类
Xilinx
定义了如下几种约束类型：•“AttributesandConstraints”•“
sxlwzl
·
2020-08-11 04:15
fpga
Xilinx
UCF （ug625）
•
Xilinx
®keywords(suchasLOC,PROHIBIT,RLOC,andBLKNM)can
God_s_apple
·
2020-08-11 03:48
xilinx
FPGA
常识
vivado 2017.4安装步骤
xilinx
官网下载地址为：https://www.
xilinx
.com/support/download.html下载完解压后，如图所示进入
Xilinx
_Vivado_SDK_2017.4_1216_
叶听雪落
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2020-08-11 00:25
Petalinux常用命令记录
一、建立工程1)根据BSP包建立工程在当前工程路径下有
xilinx
-zc706-v2016.4-final1.bsp，指定工程名为zc706petalinux-
wsqyouth
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2020-08-10 22:21
嵌入式学习
petalinux常用命令
配置环境变量启动petalinuxsource/home/userroot/os/petalinux/settings.sh基于bsp文件创建petalinux-create-tproject-s
xilinx
-zc706
u013445609
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2020-08-10 22:48
Linux
xilinx
petalinux
Xilinx
板卡夏季钜惠活动来袭！最高直降1500元！
夏日炎炎，酷暑当前作为FPGA的工程师的你需要清凉一“夏”米尔
Xilinx
板卡给你降温消暑夏季钜惠活动来袭~~~MYC-CZU3EG/4EV核心板型号：MYC-CZU3EG-4E4D-1200-C零售价
myfeiyang
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2020-08-10 13:00
关于zedboard无法烧写bit流文件的解决办法
_98740ded0101dij6.htmlhttp://blog.sina.com.cn/s/blog_c248f6b70101apx9.html1.libCseDigilent的文件夹拷贝到D:\
Xilinx
iverson1991
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2020-08-10 04:35
zedboard学习
zedboard
ZYNQ XC7Z030平台Linux+裸机AMP实现（官方文档1078、1079）
根据
Xilinx
官方指导文档1078、1079来调试AMP模式启动比较费劲，因为已经很老的教程了。其实整个文档有用的就那么几个点。总结下来实现上，就几行代码。
无语僧314
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2020-08-10 04:58
嵌入式linux
嵌入式MCU
【
Xilinx
-Petalinux学习】-08-OpenAMP系统实现
Micrium的ucosOpenAMP例子与
Xilinx
的例子框架结构有些不同，尝试修改共享内存基地址、改变程序结构，还未成功。
weixin_30294295
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2020-08-10 02:31
VIVADO 之 TCL脚本工具 （基本语法）
而且最近跟着官网文档做SDSOC的flatform，发现
xilinx
官网
ReStart_11
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2020-08-10 01:06
xilinx
基本语法
2个月搭建一个嵌入式开发平台，你觉得可以实现吗？
zedboard开发板，
xilinx
的主打产品，官网有一些不错的支持，文档，视频都有不少。自己忽然觉得可以实现的原因主要是反思自己的实际工作，花了一周的时间做了一个按键挂起和唤醒系统，同时挂
tankaro
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2020-08-10 01:07
linux开发总结
Xilinx
FPGA ISE JTAG boundary scan 扫描出 unknown device的问题
第一次用FGPA，而且还是
Xilinx
的，感觉资料好少啊，买了个开发板，要做VGA采集，但是光盘里的资料真是太混乱了，而且都不全，连个基本的例程手册都没有，也真是无力吐槽了~大家第一次学习
Xilinx
FPGA
十万铁骑
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2020-08-09 16:39
Xilinx
FPGA
Xilinx
Zynq ZC-702 开发（02）—— 通过
Xilinx
SDK 调试 Linux 应用
远程调试环境由PC上运行的SystemDebugger（集成在
Xilinx
SDK中）和Zynq板上运行的LinuxTCFAgent共同构成，两者通过TCP连接，架构图如下图所示：注1：TCF->TargetCommunicationFramework
weixin_30648587
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2020-08-09 13:20
**
xilinx
SDK 2017.4 Linux GCC不兼容SDK2015.4的问题**
xilinx
SDK2017.4LinuxGCC不兼容SDK2015.4的问题遇到的问题今天升级了
xilinx
SDK2017.4以后遇到了很多bug，在编译Linux以前的应用程序（2015.4版本上）时发现生成的
黑夜魅影
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2020-08-09 12:30
zynq
xilinx
SDK关于调试中终端的设置
SDK提供了一个简单的终端。它是足够简单的文本输出,但你可能更喜欢不同的终端像特拉。现在,我们将向您展示如何利用SDK终端。选项卡切换到STDIO。选择端口USBUART，设置波特率为115200。这是一个固定的硬件设置由由硬件平台决定，单击Apply,然后点击run。您可以监视的进度下载在右下角(BaudRate)模拟线路信号的速率，也称调制速率，以波形每秒的振荡数来衡量。如果数据不压缩，波特率
kobesdu
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2020-08-09 09:02
zynq
ZYNQ学习之路
Xilinx
SDK使用教程
本文参考
Xilinx
SDK软件内置的教程，打开方法：打开SDK->Help->CheetSheets…->
Xilinx
SDKTutorials，这里有6篇文档。
IT耗子
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2020-08-09 09:54
FPGA
线路/信道编码技术(2)——64B/66B编码
当前，64B/66B编码主要应用于FiberChannel10GFC和16GFC、10G以太网、100G以太网、10GEPON、InfiniBand、Thunderbolt和
Xilinx
的Aurora协议
hit_wzj
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2020-08-09 08:03
线路/信道编码技术
petalinux(二）开启petalinux内核调试模式
原文地址：http://www.
xilinx
.com/support/answers/66853.html描述要调试基于
Xilinx
SDK的Linux内核模块，必须使能KERNEL_DEBUG_INFO
chawk1978
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2020-08-09 07:21
ZYNQ7000基于linux3.0操作系统驱动分析——GPIO驱动第二天
驱动代码源文件drivers\gpio\
xilinx
_gpiops.c。gpiops.c首先注册初始化一个设备xgp
AMOROUS
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2020-08-09 07:19
ZYNQ
gdbserver远程调试工具
TPSecNotice（二）gdbserver交叉编译（1）配置交叉编译环境exportCROSS_COMPILE=arm-
xilinx
-linux-gnueabi-exportPATH=/home/cyg
qq_41796918
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2020-08-09 05:25
arm调试
使用
XILINX
SDK工具通过网络进行基于linux系统的远程调试方法
2，打开SDK，选择FILES>NEW>
XILINX
PROJECT。3，在TARGETSOFTWARE中选择linux选项。4，选择LINUXHELLOWORLD,处
AMOROUS
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2020-08-09 04:25
ZYNQ
RISC-V的ARTY工程实现
1.在Ubuntu下安装Vivado2017.22.从github下克隆e200_opensource-master3.从digilent下载arty-a7-35的boardfile并放到\
Xilinx
zkf0100007
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2020-08-09 04:03
FPGA
zynq嵌入式opencv移植
1.首先安装交叉编译工具链，安装完成后，交叉编译的命令是arm-
xilinx
-linux-gnueabi-gcc,将交叉编译命令导入路径内2.makefile的写法：input=red_detc.cppcompiler
yanming901012
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2020-08-09 03:56
OPENCV
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