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Verilog学习日志
[
Verilog
语法]：===和!==运算符使用注意事项
[
Verilog
语法]：===和!==运算符使用注意事项1，===和!==运算符使用注意事项2，3，1，===和!==运算符使用注意事项参考文献：1，[System
Verilog
语法拾遗]===和!
向兴
·
2023-12-04 20:31
Verilog语法
练习十一：简单卷积器的设计
，卷积器的设计，RTL：con1.v4，前仿真和后仿真，测试信号：test_con1.v5，A/D转换器的
Verilog
HDL模型所需要的技术参数，RTL代码adc.v5.1问题：这个文件没找到，待解决中
向兴
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2023-12-04 20:59
Verilog数字系统设计教程
fpga开发
芯片设计
Vivado & Modelsim联合进行UVM仿真指南
在下方的Compilation栏中，点击
Verilog
options右侧的…按钮，添加D:/Program_F
一只迷茫的小狗
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2023-12-04 16:44
vivado
uvm
FPGA
fpga开发
Vivado
uvm
加法器的实现
verilog
实现加法器，从底层的门级电路级到行为级，本文对其做出了相应的阐述。1、一位半加器所谓半加器就是有两个输入，两个输出，不考虑进位。
li_li_li_1202
·
2023-12-04 14:00
周小结-收获满满·精力升级课2.6
【21天精力升级课·第2.6讲
学习日志
】这是2019年4月20日“崔律精时力”之“21天精力升级课”第2.6讲（中期充电篇：本周复盘&答疑）的
学习日志
。
木门_
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2023-12-04 13:02
计算机基础（1）——
Verilog
语法入门
为了能够跟上课程进度，提前了解一些
Verilog
语法是很有必要的。
苍山有雪，剑有霜
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2023-12-04 10:24
学习笔记
Verilog
计算机基础
fpga开发
学习日志
-时间记录营3.1 增减时间-20200427
【精时力
学习日志
】本训练营：时间记录营今日主题：3-1增减时间学习日期：2020年4月27日1.
幻雪美美哒
·
2023-12-04 06:53
学习日志
-11.5 断+舍+离-20190705
【100天崔律阅读营·Day74-11.5日志】这是2019年7月5日“100天崔律阅读营”之“整理术《断舍离》11.5断+舍+离”的
学习日志
。1.
幻雪美美哒
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2023-12-04 03:19
hdlbits系列
verilog
解答（真值表）-50
文章目录一、问题描述二、
verilog
源码三、仿真结果一、问题描述本节我们学习用真值表来描述组合逻辑的行为，通过真值表我们将组合逻辑的每一种输入和输出对应值都罗列出来。
zuoph
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2023-12-04 02:25
verilog语言
fpga开发
数字逻辑电路基础-组合逻辑电路之加法器
文章目录一、加法器二、
verilog
源码三、综合及仿真结果一、加法器本文介绍数字逻辑电路中常用的基础组合逻辑电路加法器。它是处理器内部ALU算术逻辑单元的基础构件。
zuoph
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2023-12-04 02:25
数字电路
fpga开发
数字逻辑电路基础-组合逻辑电路之4位加减法器
文章目录一、4位加减法器二、
verilog
源码三、综合及仿真结果一、4位加减法器本文在上一篇加法器的基础上，更进一步介绍如何实现4位加减法器。在计算机中如何表示负数呢？
zuoph
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2023-12-04 02:18
数字电路
fpga开发
国防科技大学孙志刚：时间敏感网络数据平面关键技术
其团队自2019年开始研究TSN网络，基于开源的OpenTSN平台推出了枫林一号开源TSN芯片和一系列的产品，其芯片的
Verilog
代码是公开的。该开源平台也得到了主机厂、科研机构的合作和推广。
Mike吕
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2023-12-04 00:24
汽车以太网
汽车
网络
1-5入睡小妙招·树懒法
【精时力
学习日志
】本训练营：早起营（4月版）今日主题：1-5入睡小妙招·树懒法学习日期：2020年4月14日1.[知识]我在课程中的收获：【温故】a.@李杨（温故新知和思考）；缺乏睡眠与醉酒危害一样。
孔雀勇士
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2023-12-03 22:49
1-2心力的不同阶段·栗子
【精时力
学习日志
】本训练营：2021年100天精时力营·乘法今日主题：1-2心力的不同阶段·栗子学习日期：2021年11月9日1、[我记]我学(客观)+我思(主观)+正反栗子+行动：①【我学】心力的不同阶段
孔雀勇士
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2023-12-03 13:16
「
Verilog
学习笔记」自动贩售机2
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网自动贩售机中可能存在的几种金额：0，0.5，1，1.5，2，2.5，3。
KS〔学IC版〕
·
2023-12-03 12:21
Verilog学习笔记
学习
笔记
Verilog
「
Verilog
学习笔记」状态机-重叠序列检测
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网读入数据移位寄存，寄存后的数据与序列数做对比，相等则flag为1，不等则为0`timescale1ns/1nsmodulesequence_test2
KS〔学IC版〕
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2023-12-03 12:51
Verilog学习笔记
学习
笔记
Verilog
「
Verilog
学习笔记」自动贩售机1
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网自动贩售机中可能存在的几种金额：0，0.5，1，1.5，2，2.5，3。
KS〔学IC版〕
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2023-12-03 12:19
Verilog学习笔记
学习
笔记
Verilog
计算机组成与设计实训-用
Verilog
HDL 玩转计算机硬件系统设计（头歌实践教育平台） 学习过程记录
Verilog
（知识&实验）Author:PeterHan计算机组成与设计实训-用
Verilog
HDL玩转计算机硬件系统设计(educoder.net)//
Verilog
HDL模块的模板（仅考虑用于逻辑综合的程序
Peter1146717850
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2023-12-03 12:01
学习
FPGA学习之
Verilog
语言入门指导（嵌入式）
FPGA学习之
Verilog
语言入门指导（嵌入式）
Verilog
是一种硬件描述语言（HDL），广泛用于FPGA（可编程逻辑器件）的设计和开发。
技术无限探索
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2023-12-02 22:57
fpga开发
学习
嵌入式
FPGA系列：1、FPGA/
verilog
源代码保护：基于Quartus13.1平台保护
verilog
源码发给第三方但不泄露源码
catlog需求具体步骤工程描述去掉相关调试文件切换顶层模块并导出相应模块为网表文件切换回原顶层模块并添加相应保护模块的qxp文件再次编译工程注意事项parameter参数参考：需求有时需要将源码交付给第三方，但是源码中部分模块涉及到的核心代码无法暴漏给第三方。因此，我们需要一种能够让第三方拿到源码对部分参数进行修改、但同时又无法触及到核心代码的代码保护方法。本文结合部分资料，给出了如何将quar
天城寺电子
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2023-12-02 18:08
FPGA
fpga开发
时间大富翁| 并非所有的学习，都能改变大脑！这样做，才可以！
Betty的
学习日志
：•栗子•过去，我常常觉得一心两用是高效的表现，所以常常让大脑处于多个任务并行的复杂运作状态，整个人很迷糊。迷恋上这种感觉，一种假装高效的状态。
精时力崔律
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2023-12-02 17:24
「
Verilog
学习笔记」时钟分频（偶数）
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网`timescale1ns/1nsmoduleeven_div(inputwirerst,inputwireclk_in
KS〔学IC版〕
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2023-12-02 09:23
Verilog学习笔记
学习
笔记
fpga开发
Verilog
FPGA纯
verilog
实现 LZMA 数据压缩，提供工程源码和技术支持
FPGA纯
verilog
实现LZMA数据压缩，提供工程源码和技术支持目录1、前言2、我这儿已有的FPGA压缩算法方案3、FPGALZMA数据压缩功能和性能4、FPGALZMA数据压缩设计方案输入输出接口描述数据处理流程
hexiaoyan827
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2023-12-02 09:21
fpga开发
高速信号处理
LZMA
数据压缩
FPGA压缩算法方案
加速计算
北邮22级信通院数电：
Verilog
-FPGA（12）第十二周实验（2）彩虹呼吸灯
北邮22信通一枚~跟随课程进度更新北邮信通院数字系统设计的笔记、代码和文章持续关注作者迎接数电实验学习~获取更多文章，请访问专栏：北邮22级信通院数电实验_青山如墨雨如画的博客-CSDN博客目录一.代码部分二.管脚分配三.实验效果一.代码部分rainbow_breathing_light.vmodulepwm(input[7:0]duty,inputclk,outputregout);reg[7:
青山入墨雨如画
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2023-12-02 09:51
北邮22级信通院数电实验
fpga开发
北邮22级信通院数电：
Verilog
-FPGA（12）第十二周实验（1）设计一个汽车尾灯自动控制系统
北邮22信通一枚~跟随课程进度更新北邮信通院数字系统设计的笔记、代码和文章持续关注作者迎接数电实验学习~获取更多文章，请访问专栏：北邮22级信通院数电实验_青山如墨雨如画的博客-CSDN博客目录一.题目要求二.代码部分2.1car_system.v2.2divide.v三.管脚分配四.实现效果一.题目要求设计一个汽车尾灯自动控制系统，要求根据汽车行驶状态自动控制汽车尾灯：直行：尾灯不亮；右转：右侧
青山入墨雨如画
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2023-12-02 09:49
北邮22级信通院数电实验
fpga开发
modelsim-SE仿真error问题
3.如果是Error(10054):
Verilog
HDLFileI/Oerroratsdram_ctrl_tb.v(6):can'tope
会飞的珠珠侠
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2023-12-02 07:19
FPGA
fpga
时间记录训练营
学习日志
1
【精时力
学习日志
】本训练营：精时力·时间记录营今日主题：1-2修改与新增类别学习日期：2020年3月24日1.
伊伊妈妈亲子阅读会
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2023-12-01 21:59
SystemC Study
简介SystemC的意义，网上能查到，这里总结一下，SystemC是C++的library，类似UVM是system
verilog
的library下图是SystemC在整个项目中的角色硬件架构探索，创建算法
Vinson_Yin
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2023-12-01 16:36
SystemC
systemc
【【FPGA的 MicroBlaze 的 介绍与使用 】】
FPGA的MicroBlaze的介绍与使用可编程片上系统（SOPC）的设计在进行系统设计时，倘若系统非常复杂，采用传统FPGA单独用
Verilog
/VHDL语言进行开发的方式，工作量无疑是巨大的，这时调用
ZxsLoves
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2023-12-01 16:30
FPGA学习
fpga开发
【每日一题】一起学
Verilog
001-004
001画出CMOS反相器的电路原理图这个学过数集应该都会画，NMOS接地，PMOS接高电平。002反向器的速度与哪些因素有关？什么是转换时间（transitiontime）和传播延迟（propagationdelay）？反相器的速度与哪些因素有关。（1）电容（负载电容、自载电容、连线电容）较小，漏端扩散区的面积应尽可能小。输入电容要考虑：（1）Cgs随栅压而变化（2）密勒效应（3）自举效应（2）加
不求上进的夏天
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2023-12-01 15:43
AI时代FPGA厂商与FPGA工程师该如何转型？
《单片机与嵌入式系统应用》小编特意邀请了专家给大家答疑解惑~业界声音掌握
Verilog
FPGA设计和验证方法是AI时代系统设计师的生命线北航电子信息工程学院退休教授北京至芯
喜欢打酱油的老鸟
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2023-12-01 13:06
人工智能
AI时代
FPGA
转型
2022/6/28
学习日志
主流的激光雷达的扫描技术有三角测距和TOF（timeofflight）两种。12.2.2飞行时间测距TOF即飞行时间。TOF激光雷达，利用光的飞行时间来测距。核心部件有激光发射器，接收器，高精度计时器。测量原理就是C*△t.2.3点云获取点云数据通常用向量集合来表示，在坐标系中，一般用X,Y,Z来表示。激光雷达扫描周围的环境一周就可获得一帧的点云数据，表示为一下集合：这些点云数据描述了扫描环境中的
黄卷青灯77
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2023-12-01 13:33
学习
人工智能
计算机视觉
6月份阅读营·关系力1-1 开营+喜欢别人
【精时力
学习日志
·小可爱版】本训练营：阅读营·关系力学习书籍：《人性的弱点》学习日期：2020年6月1日学习主题：1-1开营+喜欢别人1[我学]在课程中的收获：1.1开营@本营主题是100天精时力训练营四大核心主题的第二个核心主题
TracyWXM
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2023-12-01 03:15
【合集一】每日一练30讲，轻松掌握
Verilog
语法
本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处（www.meyesemi.com)第一练：如何区分＜＝表示的含义？题目：请描述以下两种方法产生的信号有何区别？答案：根据“b)?a:b;解析：condition_expr?true_expr1:false_expr2;condition_expr为逻辑真则结果为true_expr1，condition_expr
小眼睛FPGA
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2023-12-01 00:49
Verilog
【合集二】每日一练30讲，轻松掌握
Verilog
语法
本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处（www.meyesemi.com)第十六练：reg型存储器声明（二维数组）题目：声明一个位宽为8，深度为32的二维数组变量ram答案：reg[7:0]ram[31:0];解析：reg［wordsize：0］array_name［arraysize：0］;wordsize表示位宽，arraysize表示深度第十七
小眼睛FPGA
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2023-12-01 00:49
算法
Verilog
Verilog
基础：时序调度中的竞争（一）
相关阅读
Verilog
基础https://blog.csdn.net/weixin_45791458/category_12263729.html?
日晨难再
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2023-11-30 20:13
Verilog基础
数字IC
硬件工程
前端
fpga开发
Verilog
Verilog
基础：时序调度中的竞争（二）
相关阅读
Verilog
基础https://blog.csdn.net/weixin_45791458/category_12263729.html?
日晨难再
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2023-11-30 20:12
Verilog基础
fpga开发
数字IC
硬件工程
Verilog
前端
2020年12月21日打卡
【精时力
学习日志
】本训练营：100天精时力训练营（2020年版）今日主题：2-2【睡眠】日间小睡学习日期：2020年9月29日【2020年12月21日】课后实践：来1次日间小睡1、[进步]我今天在课程中的收获
b2633446e42e
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2023-11-30 14:37
【
Verilog
】ROM & RAM
文章目录RAM&ROMROM：只读存储器概念源代码testbench仿真波形RAM：随机访问内存概念源代码与testbench仿真波形RAM&ROMROM：只读存储器概念ROM内部的数据是在ROM制造工序中，在工厂里用也输的方法被烧录进去的，其中的内容只能读不能改，一旦烧录进去，用户只能验证写入的资料是否正确，不能再做任何修改，如果发现资料有任何错误，则只能舍弃不用，重新订做一份，ROM是在生产线
秃头仔仔
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2023-11-30 13:26
数字芯片研发
#
Verilog
fpga开发
ROM
RAM
Verilog
数字芯片研发
uvm 平台搭建3 - 安装VCS SCL
前面做好linux系统的安装之后，这里开始安装一些相关的验证工具准备：VCS（TM）是Synopsys全系列功能验证解决方案的一部分，支持
Verilog
，VHDL，混合HDL和复杂SoC设计的混合信号仿真
zenos876
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2023-11-30 11:19
【时间记录：助力作计划（日清单）】
【精时力
学习日志
】本训练营：时间记录营今日主题：3-3助力做时间计划学习日期：2020年4月9日1.[知识]我在课程中的收获：【温故】*赵松南。
海南冰青
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2023-11-30 11:28
学习日志
-《gmtc-低代码》笔记
前言本文记录了学习gmtc-低代码过程中的所有笔记。低代码平台架构深度剖析-百度营销页，建站，管理后台方向低代码通用架构：dsl及解释器（通常是将json转为实际组件），默认组件库（业务场景中提炼的通用业务组件），自定义组件编写和接入机制，可视化编辑器（画布，可选），后端业务接入模块（node_firefly_svc）百度-爱速搭平台百度开源低代码前端框架AMIS，可覆盖管理后台场景amis-ed
用户780371189327
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2023-11-30 07:29
低代码与无代码与前端智能化专项
前端
前端框架
学习日志
-4.3 魔法粉末-20220525
【精时力冥想日志】本训练营：战疫公益·感恩冥想今日主题：0525魔法粉末1学习日期：2022年5月25日1、[我学]今日冥想收获：1.1基本信息谢谢崔律今天带着我们做魔法粉末的感恩冥想。今天崔律以早晨出门后的时间段为例，引导我们进行了邻居、保洁、保安、交通等的感恩。1.2魔法粉末【我学】感恩是一股很强的能量，我对谁表达感激，这股力量就会流向哪里。感恩的能量就像是闪闪发光的魔法粉末，当我表达感激时，
幻雪美美哒
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2023-11-30 05:24
Verilog
笔记（四）状态机
~）状态机是
Verilog
里非常常用的语法结构状态机1状态机概念1.1引子1.2概念2状态机模型3状态机设计3.1状态空间定义3.2状态跳转（时序逻辑）3.3下个状态判断（组合逻辑）3.4各
班花i
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2023-11-30 04:33
FPGA
fpga
状态机（
verilog
）
-------------------------------------------------------------------------------------------笔记（正点原子等）
Verilog
交芯
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2023-11-30 04:03
数字IC
fpga
asic
1024程序员节
FPGA学习笔记五：Moore状态机与Mealy状态机的区别（基于
Verilog
）
目录前言一、状态机及其描述二、Moore状态机和Mealy状态机设计对象描述及其原理（一）Moore状态机（二）Mealy状态机总结前言本篇博客主要基于一些状态机书写的规范以及其构成结构進行相应的简单分析，同时依据HDLBits中两道典型的题目（HDLBits第139题：简单Moore状态机的实现和HDLBits第140题：简单Mealy状态机的实现）分析两種状态机的异同和电路描述特点。一、状态机
STI浅结隔離
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2023-11-30 04:00
HDLBits题目
有限状态机
verilog
fpga
moore状态机
mealy状态机
「
Verilog
学习笔记」状态机-非重叠的序列检测
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网根据题意定义一个五位的中间变量lock每次始终上升沿来临时判断当前寄存器的低四位+新数据是否等于10111如果等于则下一时刻
KS〔学IC版〕
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2023-11-29 16:19
Verilog学习笔记
学习
笔记
Verilog
「
Verilog
学习笔记」非整数倍数据位宽转换8to12
专栏前言本专栏的内容主要是记录本人学习
Verilog
过程中的一些知识点，刷题网站用的是牛客网要实现8bit数据至12bit数据的位宽转换，必须要用寄存器将先到达的数据进行缓存。
KS〔学IC版〕
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2023-11-29 16:46
Verilog学习笔记
学习
笔记
Verilog
System
Verilog
入门--1
数据类型
Verilog
-->register-reg|->net-wire/…SV-->logic----不关心对应的逻辑如何综合，单纯作为变量logic四值逻辑表示0,1,x,z-->SV的硬件世界bit
孤独的旅者
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2023-11-29 13:07
SV入门
systemverilog
推荐system
Verilog
相关书籍
System
Verilog
在多数情况下被用于IC验证，相关书籍其实比较多，这里先提供绿皮书，红宝书，希望对大家有用。
电路_fpga
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2023-11-29 13:06
书籍推荐
fpga开发
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