FPGA学习教程第86页

FPGA实验三：状态机的设计

目录一、实验目的二、实验要求三、实验代码1.designsource文件部分代码2.测试文件代码四、实验结果及分析1、引脚锁定2、仿真波形及分析（1）设计好序列检测器（2）仿真波形（检测11010）3、下载测试结果及分析（检测11011）五、实验心得1.关于实验设计过程中遇到的困难与解决心得2.实验完成的心得一、实验目的（1）掌握序列发生和检测的工作原理；（2）掌握时序电路中状态机的应用；（3）掌

长安er·2023-07-16 00:58

ZYNQ PL 添加IP 串口UART AXI UART16550

目录开发环境、硬件FPGA部分SDK部分PL串口相关寄存器源代码下载开发环境、硬件vivado2018.3正点原子领航者v2开发板7020使用管脚：COM2对应PL的K14M15FPGA部分openblockdesign

韬_17·2023-07-15 23:50

【FPGA】Verilog：时序电路 | 触发器电路 | 上升沿触发 | 同步置位 | 异步置位

前言：本章内容主要是演示Vivado下利用Verilog语言进行电路设计、仿真、综合和下载示例：触发器电路功能特性：采用XilinxArtix-7XC7A35T芯片配置方式：USB-JTAG/SPIFlash高达100MHz的内部时钟速度存储器：2MbitSRAMN25Q064ASPIFlash（样图旧款为N25Q032A）通用IO：Switch：x8LED：x16Button：x5DIP：x8通

流继承·2023-07-15 21:33

领测推出全套免费软件测试培训学习视频

这段带点小幽默、小霸气的“凡客体”学习宣言，是领测国际(www.ltesting.cn)免费软件测试学习教程专题的篇首语。据了解，领测国际推出

hxcat·2023-07-15 17:00

microblaze生成download.bit 报错：Program FPGA failed Reason： couldn‘t open......

报错信息：couldn’topen“E:/Xilinx_Project/……/……/…….sdk/top_wrapper_hw_platform_0/download.bit”:nosuchfileordirectory[Updatemem57-153]FailedtoupdatetheBRAMINITstringsforE:\Xilinx_Project\……\……\…….sdk\……\Debu

RyanLee90·2023-07-15 16:07

基于simulink的微电网虚拟同步发电机vsg控制系统仿真

FPGA教程目录MATLAB教程目录-----------------------------------------------------------------------目录一、理论基础二、核心程序三

fpga和matlab·2023-07-15 14:24

静态数码管——FPGA

文章目录前言一、数码管1、数码管简介2、共阴极数码管or共阳极数码管3、共阴极与共阳极的真值表二、系统设计1、模块框图2、RTL视图三、源码1、seg_led_static模块2、time_count模块3、top_seg_led_static(顶层文件)四、效果五、总结六、参考资料前言环境：1、Quartus18.02、vscode3、板子型号：EP4CE6F17C8要求：六位数码管全选，每间隔

混子王江江·2023-07-15 14:00

HLS入门简述

HLS在其中起了重要的转换作用，将高层次的抽象语言转换为寄存器传输级语言（registertransferlevel，RTL），这样我们可以将其映射到FPGA的器件中，进行硬件实现，此谓综合。

日拱一卒_未来可期·2023-07-15 14:59

基于STM32 ARM+FPGA伺服控制系统总体设计方案(一）

设计需求一套完整的伺服控制方案包括了上位机、驱控一体控制器和功率板三者。操作人员通过上位机发送各种不同指令，然后控制器解析指令后执行相应的伺服功能，其次控制器将驱动信号传输至功率板驱动电机，最后控制器采集反馈信息进行闭环控制并上传数据。结合国内外嵌入式伺服控制器的发展现状和功能需求，制定了本文伺服控制系统的主要功能需求如下：（1）开发一款驱控一体控制板卡。（2）开发刚柔耦合平台伺服控制系统的同时兼

深圳信迈科技DSP+ARM+FPGA·2023-07-15 14:22

基于 RK3399+fpga 的 VME 总线控制器设计(二）硬件和FPGA逻辑设计

3.2FPGA最小系统设计FPGA最小系统是指可以使FPGA正常工作的最基本的系统，主要包括电源电路、配置电路、时钟和复位电路。

深圳信迈科技DSP+ARM+FPGA·2023-07-15 14:51

【NI USRP】 USRP 硬件资源和性能是怎么样的呢？是如何构成的呢

B系列型号频段最大带宽通道FPGAADI芯片B200mini70MHZ-6GHZ56MHz1X1XilinxSpartan-6XC6SLX150AD9364B200mini-i70MHZ-6GHZ56MHz1X1XilinxSpartan

乌恩大侠·2023-07-15 14:49

基于STM32 ARM+FPGA伺服控制系统(二）软件及FPGA设计

完整的伺服系统所包含的模块比较多，因此无法逐一详细介绍，所以本章着重介绍设计难度较高的FPGA部分并简单介绍ARM端的工作流程。

深圳信迈科技DSP+ARM+FPGA·2023-07-15 14:48

FPGA系列：ZCU102开发板上的第一个工程（MIG控制器）

XILINX官网：Xilinx-灵活应变.万物智能.FPGA上电后IO的默认状态|电子创新网赛灵思社区Vivado之时序约束XDC-kevinc-电子技术应用-AET-中国科技核心期刊-最丰富的电子设计资源平台一

哈德维尔·2023-07-15 11:40

【FPGA】Verilog编程实现SDRAM读写（一） ----- 初识SDRAM

文章目录一.存储器及SDRAM分类1.存储器分类2.半导体存储器分类3.SDRAM分类二.什么是SDRAM？1.SDRAM基本概念2.SDRAM存储阵列3.SDRAM基本存储单元4.BANK概念5.SDRAM容量计算6.SDRAM功能框图7.SDRAM信号引脚8.SDRAM操作命令8.1禁止命令（INHIBIT）8.2空操作命令（NOP）8.3加载模式寄存器命令（LOADMODEREGISTER）

白码王子小张·2023-07-15 11:09

基于 FPGA 的 HDMI/DVI 显示

文章目录前言一、HDMI与DVI的区别与联系1.1DVI接口含义1.2HDMI接口含义1.3HDMI与DVI的区别1.4HDMI与DVI的兼容性1.5HDMI与DVI接口对比二、DVI数据链路介绍2.1输入接口层2.2TMDS发送器2.3TMDS接收器2.4输出接口层三、传输原理与实现3.1TMDS原理3.2实现方式3.2.1传输最小化3.2.1.1最小化传输实现原理3.2.2直流平衡编码3.3T

C.V-Pupil·2023-07-15 11:38

基于 FPGA 的彩色图像灰度化的设计实现（image_stitche_x）

文章目录前言一、图像合并模块的设计二、仿真文件前言image_stitche_x模块：将串口接收的尺寸为400480大小的彩色图像与灰度化处理后的400480大小的图像数据以左右形式合并成一张800*480的图像。提示：以下是本篇文章正文内容，下面案例可供参考一、图像合并模块的设计要实现图像以左右形式合并，首先要分析下“基于DDR3的串口传图帧缓存系统”是如何实现在TFT上显示一张图片的过程。这个

C.V-Pupil·2023-07-15 11:07

FPGA 驱动数码管动态显示（Verilog&Vivado）

FPGA驱动数码管动态显示前言一、数码管驱动原理二、设计思路三、实现代码四、hex8_tb文件五、上板测试1.74HC595时序图2.HC595_Driver设计3.HC595_Driver_tb文件4

C.V-Pupil·2023-07-15 11:37

vivado DDR配置讲解

双击图中所示图2三、配置步骤说明：官方的教程可以点击配置界面左下方的userguide,去其网站上下载官方的英文说明文档**1.确认一下器件**图32.是否设置axi4接口配置（1）纯FPGA的芯片（A

qq_41869515·2023-07-15 11:06

大家一起从零设计RISC-V处理器（一）之开篇

1.渊源现在我还记得初学FPGA时候，问过学长FPGA能做什么，他回答：无所不能，比如可以实现51单片机；但当时我初学无知，无法理解在实现FPGA上单片机，那时候对图像识别感兴趣，因此FPGA大部分用在图像处理上

芯王国·2023-07-15 07:37

FPGA好找工作吗？薪资待遇怎么样？

FPGA：即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

IC修真院·2023-07-15 07:19

数字 IC 设计职位经典笔/面试题（二）

共100道经典笔试、面试题目（文末可全领）FPGA中可以综合实现为RAM/ROM/CAM的三种资源及其注意事项？

IC修真院·2023-07-15 07:17

如何把 SAP ABAP 系统里一张数据库表的内容，显示在 Adobe PDF Form 里试读版

本专栏计划的文章数在150篇左右，到2022年9月12日为止，目前已经更新了51篇，专栏完成度为34%零基础ABAP学习教程系列文章的目录1.ABAP标准培训教程BC400学习笔记之一：ABAP服务器的架构和一个典型的

JerryWang_汪子熙·2023-07-15 06:52

LabVIEW FPGA利用响应式数字电子板快速开发空间应用程序

LabVIEWFPGA利用响应式数字电子板快速开发空间应用程序与传统的基于文本的语言相比，LabVIEW的编程和设计已被证明可以缩短开发时间。各种研究表明，生产率的提高在3到10倍之间。

LabVIEW开发·2023-07-15 06:15

FPGA纯verilog实现10G UDP协议栈，XGMII接口UltraScale GTY驱动，提供工程源码和技术支持

目录1、前言2、我这里已有的UDP方案3、该UDP协议栈性能4、详细设计方案SFPSGMII收发接口模块AXISFIFOUDP协议栈UltraScaleFPGAsTransceiversWizardGTY5

9527华安·2023-07-15 05:32

FPGA XDMA 中断模式实现 PCIE X8 AD7606采集提供2套工程源码和QT上位机源码

目录1、前言2、我已有的PCIE方案3、PCIE理论4、总体设计思路和方案AD7606数据采集和缓存XDMA简介XDMA中断模式QT上位机及其源码5、vivado工程1--BRAM缓存6、vivado工程2--DDR3缓存7、上板调试验证8、福利：工程代码的获取1、前言PCIE（PCIExpress）采用了目前业内流行的点对点串行连接，比起PCI以及更早期的计算机总线的共享并行架构，每个设备都有自

9527华安·2023-07-15 05:02

FPGA纯verilog实现UDP协议栈，GMII接口驱动88E1111，提供工程源码和技术支持

、详细设计方案网络PHYGMIIAXIS接口模块AXISFIFOUDP协议栈5、vivado工程详解6、上板调试验证并演示准备工作查看ARPUDP数据回环测试7、福利：工程代码的获取1、前言目前网上的fpga

9527华安·2023-07-15 05:02

FPGA XDMA 中断模式实现 PCIE X8 测速试验提供工程源码和QT上位机源码

目录1、前言2、我已有的PCIE方案3、PCIE理论4、总体设计思路和方案XDMA简介XDMA中断模式QT上位机及其源码5、vivado工程详解6、上板调试验证7、福利：工程代码的获取1、前言PCIE（PCIExpress）采用了目前业内流行的点对点串行连接，比起PCI以及更早期的计算机总线的共享并行架构，每个设备都有自己的专用连接，不需要向整个总线请求带宽，而且可以把数据传输率提高到一个很高的频

9527华安·2023-07-15 05:01

FPGA基于XDMA实现PCIE X8视频采集HDMI输出提供工程源码和QT上位机程序和技术支持

目录1、前言2、我已有的PCIE方案3、PCIE理论4、总体设计思路和方案5、vivado工程详解6、驱动安装7、QT上位机软件8、上板调试验证9、福利：工程代码的获取1、前言PCIE（PCIExpress）采用了目前业内流行的点对点串行连接，比起PCI以及更早期的计算机总线的共享并行架构，每个设备都有自己的专用连接，不需要向整个总线请求带宽，而且可以把数据传输率提高到一个很高的频率，达到PCI所

9527华安·2023-07-15 05:31

XDMA IP学习

xilinxxdmaipcore官方手册PG195一XDMAIP概述Xilinx®DMA/BridgeSubsystemforPCIExpress®(PCIe®)（XDMA）是Xilinx公司2017年前后新推出的PCIeFPGA

搬砖的MATTI·2023-07-15 05:26

XDMA IP学习2——细节补充+问题记录

FPGA利用DDR等存储资源做数据缓存，XDMA的DMAcontroller将数据在上位机内存与FPGA内搬运。如下

搬砖的MATTI·2023-07-15 05:26

基于XDMA 中断模式的 PCIE 上位机与FPGA数据交互架构提供工程源码和QT上位机源码

目录1、前言2、我已有的PCIE方案3、PCIE理论4、总体设计思路和方案图像产生、发送、缓存数据处理XDMA简介XDMA中断模式图像读取、输出、显示QT上位机及其源码5、vivado工程详解6、上板调试验证7、福利：工程代码的获取1、前言PCIE（PCIExpress）采用了目前业内流行的点对点串行连接，比起PCI以及更早期的计算机总线的共享并行架构，每个设备都有自己的专用连接，不需要向整个总线

9527华安·2023-07-15 05:24

【Quartus FPGA】EMIF DDR3 IP 仿真记录

EMIF(ExternalMemoryInterface)是Quartus平台提供的IP，用于实现高速存储器件接口与控制器。通过IntelQuartusPrime软件，可以很方便地实现EMIFIP电路。本文记录了使用EMIF实现DDR3控制器的仿真过程，软件平台为QuartusPrimePro21.3，器件型号为10CX220YF780E6G.目录1EMIFIP介绍2EMIFDDR3IP配置3EM

洋洋Young·2023-07-15 02:57

紫光同创 FPGA 开发跳坑指南（一）—— 在线 debug

最近在调试公司一个项目的千兆以太网通信链路，项目用到紫光同创的FPGA，正好利用空余时间记录一下紫光同创FPGA的调试过程。

洋洋Young·2023-07-15 02:56

紫光同创 FPGA 开发跳坑指南（三）—— 联合 Modelsim 仿真

Modelsim是FPGA开发中重要的EDA设计仿真工具，主要用于验证数字电路设计是否正确。紫光PangoDesignSuite开发套件支持联合Modelsim仿真，这里作简要的介绍。

洋洋Young·2023-07-15 02:56

紫光同创 FPGA 开发跳坑指南（四）—— DDR3 控制器 IP 的使用

DDR3是一种大容量的存储器件，采用了预取技术和双边沿采样技术，以实现高速数据存储与读取，在视频处理中可以用来缓存1帧或多帧图像。目录一、紫光DDR3IP的安装二、紫光DDR3IP的配置三、DDR3IP的使用3.1DDR3写操作3.2DDR3读操作一、紫光DDR3IP的安装在PangoDesignSuit中，选择Tools->IPCompiler，菜单栏选择File->Update...，在弹出来

洋洋Young·2023-07-15 02:56

FPGA简介、工作原理、优势与劣势

一、FPGA简介FPGA（Field-ProgrammableGateArray）是一种基于可编程逻辑门阵列（PLA）和可编程交叉开关（PCS）的可编程逻辑器件。

Lightning-py·2023-07-14 23:27

SOPC之NiosⅡ系统（一）

1.基础概念1.1CPU软核与硬核简单来说CPU硬核就是在FPGA上的一颗硬件结构固定并且用户不能对其结构进行任何更改、只能进行编程控制的芯片。

STATEABC·2023-07-14 23:52

远程升级flash三大原语使用（K7325T）

但是想做远程程序更新功能就必须这么干，通过串口或者网口或者什么其他通信接口将要更新的程序发送至fpga，fpga存储空间不够的话就暂存到ddr或者外置sram里，再按顺序操作flash烧入外部存储器的时钟管脚一般与

燎原星火*·2023-07-14 22:50

RISC-V开发与应用学习系列——序言

序言开源verilog编译器Icarus&wave查看工具gtkwave高云国产FPGAWindows下的Makefile工具和GCC交叉编译工具其他工具如今开源CPU架构RSIC-V如火如荼地流行开来

TimFang1990·2023-07-14 17:19

如何向RT-Thread提交一个BSP?

一、前言今年6月，我在一款智能混合型的FPGA芯片上，完成了RT-Thread的移植，并向RT-Thread提交了一个完整的BSP，后续又根据审查意见进行了一些完善，最近（11.18）被合并到RT-Thread

嵌入式资讯精选·2023-07-14 17:38

基于FPGA的DDS在Gowin和combat开发板的实现

前言在全球市场中，Xilinx、Altera两大公司对FPGA的技术与市场占据绝对垄断地位。两家公司占有将近90%市场份额，专利达6000余项之多，而且这种垄断仍在加强。

ю.·2023-07-14 17:38

Gowin FPGA学习记录——前言

好久没有写博客了，想想是不是又该写点啥东西了么，准备写点国产FPGA的使用经历吧得益于目前国内的政策对国产化芯片扶持，越来越要求核心器件能够自主可控，因此作为核心芯片FPGA，国产FPGA的势头也发展很快

十年老鸟·2023-07-14 17:03

分享瑞芯微RK3568J与FPGA的PCIe通信案例，嵌入式必读！

ARM+FPGA架构有何种优势近年来，随着中国新基建、中国制造2025的持续推进，单ARM处理器越来越难满足工业现场的功能要求，特别是能源电力、工业控制、智慧医疗等行业通常需要ARM+FPGA架构的处理器平台来实现特定的功能

Tronlong创龙·2023-07-14 16:20

FPGA概要

FPGA构成要素IO块，逻辑块，连接块，开关块，布线通道构成。

小天才dhsb·2023-07-14 12:13

FPGA原理和结构

4.逻辑综合将RTL描述生成网表文件5.技术映射将网表文件映射到FPGA的实际逻辑元素（如查找表

小天才dhsb·2023-07-14 12:13

FPGA纯verilog实现UDP协议栈，sgmii接口SFP光口收发，提供工程源码和技术支持

AXISFIFOUDP协议栈1G/2.5GEthernetPCS/PMAorSGMII5、vivado工程详解6、上板调试验证并演示准备工作查看ARPUDP数据回环测试7、福利：工程代码的获取1、前言目前网上的fpga

9527华安·2023-07-14 12:40

FPGA——pwm呼吸灯

文章目录一、实验环境二、实验任务三、实验过程3.1verilog代码3.2引脚配置四、仿真4.1仿真代码4.2仿真结果五、实验结果六、总结一、实验环境quartus18.1modelsimvscodeCycloneIV开发板二、实验任务呼吸灯是指灯光在微电脑的控制之下完成由亮到暗的逐渐变化，感觉好像是人在呼吸。本次实验是使用开发板上的四个led灯实现1s间隔的呼吸灯。使4个led灯由暗到亮，再由亮

漠影zy·2023-07-14 12:36

FPGA——静态数码管

文章目录一、实验环境二、实验原理三、实验任务四、实验过程4.1time_count模块4.2seg_led_static模块4.3top_seg_led_static模块4.4引脚配置五、仿真5.1仿真代码5.2仿真结果六、实验结果七、总结一、实验环境quartus18.1modelsimvscodeCycloneIV开发板二、实验原理我们使用的数码管是8段数码管，每段是由led组成。通过控制每段

漠影zy·2023-07-14 12:36

vivado 添加 pynq-z2板

以vivado2019.02版本为例1下载地址https://www.tulembedded.com/FPGA/ProductsPYNQ-Z2.html2.点击下载3.解压添加注：如果没有board_files

頔枫·2023-07-14 12:36

FPGA——点亮led灯

文章目录一、实验环境二、实验任务三、实验过程3.1编写verliog程序3.2引脚配置四、仿真4.1仿真代码4.2仿真结果五、实验结果六、总结一、实验环境quartus18.1vscodeCycloneIV开发板二、实验任务每间隔1S实现led灯的亮灭，实现流水灯的效果。三、实验过程3.1编写verliog程序//每间隔1S实现LED的亮灭moduleled(inputclk,inputrst_n

漠影zy·2023-07-14 12:06

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vivado 添加 pynq-z2板

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