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vhdl
基于
VHDL
的多功能电子钟设计
掌握用
VHDL
语言进行数字系统设计的基本方法和流程，加深对EDA课程内容的理解，提高工程设计实践能力。用
VHDL
实现一个数字钟的功能：实现小时，分钟，秒的计数和动态显示和整点报时等功能。
技术苦行僧
·
2023-11-24 12:03
FPGA开发
VHDL
fpga开发
硬件工程
模块测试
经验分享
硬件学习路线调研
学习路线《Verilog传奇》、《VerilogHDL高级数字设计》或者是《用于逻辑综合的
VHDL
》。不看书也能写出个三段式状态机就可以进入下一阶段了。
zianren
·
2023-11-22 11:55
FPGA
学习
fpga开发
VHDL
测试文件的读入和写出
相关库usestd.textio.all;useIEEE.STD_LOGIC_TEXTIO.ALL;相关参数fileoutput_file:text;//fidvariablefstatus:file_open_status;variablebuf:line;//buffer相关函数//文件打开函数file_open(file_open_status,fid,file_name,file_perm
Layznana
·
2023-11-19 21:42
FPGA
算法
嵌入式硬件
基于FPGA的五子棋（论文+源码）
将在硬件设计的基础上完成程序的设计，其中拟打算VERILOGHDL语言进行程序的编写，该语言和
VHDL
是两种FPGA的编程语言之一，VERILOGHDL相对来说语法更偏近于C，同时由于选用ALTTE
沐欣工作室_lvyiyi
·
2023-11-19 12:58
fpga开发
单片机
嵌入式硬件
stm32
毕业设计
物联网
VDHL基础知识
VHDL
语言要素库：存放已编译的实体、结构体、程序包和配置程序包：存放各种设计模块能共享的数据类型、常数、程序等实体：描述所设计硬件系统的外部接口信号结构体：描述所设计硬件系统的内部结构和功能配置：从库中选取所需单元来组成新系统
峙峙峙
·
2023-11-18 17:48
算法
数字后端零基础学习记录01-SMIC0.18um工艺库文件解析
calibre2.digital2.1apollo2.1.1clf2.1.2smic182.1.3tf2.2doc2.3lef2.4primetime2.5symbols2.6synopsys2.6Verilog
VHDL
糊涂小桃子
·
2023-11-15 20:59
数字后端学习记录
学习
【VCS】（1）VCS仿真基础
常用执行选项库的调用仿真示例一仿真示例二实验中遇到的一个问题编译过程中生成的文件保存日志编译后立即仿真指定生成的仿真文件名称宏相关的编译选项VSC用途：数字逻辑仿真主要是用于前端VCS除了支持对Verilog、SystemVerilog、
VHDL
Tranquil_ovo
·
2023-11-15 20:55
#
VCS
VCS
verilog语法基础
文章目录前言一、硬件描述语言1.1什么是硬件描述语言1.2主要的硬件描述语言1.2.1VerilogHDL1.2.2
VHDL
1.2.3SystemVerilog二、基础知识2.1逻辑值2.2进制格式2.3
FPGA中国创新中心
·
2023-11-14 04:31
FPGA学习
fpga开发
verilog
硬件工程
HLS学习一
相比之下，Verliog、
VHDL
等低层次语言，通常用来描述时钟周期精确的寄
lovely@
·
2023-11-13 20:06
嵌入式系统应用开发
FPGA
Verilog
VHDL
三种建模描述方式——2选1数据选择器
标题QuartusII标题Verilog
VHDL
三种建模描述方式——2选1数据选择器1，结构化描述方式：是使用实例化低层次模块的方法，即调用其他已经定义过的低层次模块对整个电路的功能进行描述，或者直接调用
ZikH�
·
2023-11-12 00:17
fpga开发
Quartus II：
VHDL
组合逻辑-时序逻辑练习
在QuartusII中用原理图输入法设计4位加法器1.在之前的实验基础上设计4位全加器2.仿真波形图3.引脚绑定4.硬件测试二、应用QuartusII完成基本组合电路设计（一）2选1多路选择器1.新建
VHDL
WOOZI9600L²
·
2023-11-12 00:16
FPGA
fpga开发
物联网
6位简易处理器的设计与实现-DE2|
VHDL
|EDA|FPGA/CPLD
基于
VHDL
的6位简易处理器的设计与实现传送门：本项目地址：Gitee|GitHub其他相关项目DE2-
VHDL
计时器：Gitee|GitHubDE2-
VHDL
实验：Gitee|GitHub前言该设计是笔者大二时的硬件课实践作品
MylesYYY
·
2023-11-12 00:15
硬件
硬件
vhdl
cpu
fpga
cpld
VHDL
基础知识笔记（2）
1.赋值语句：（1）在
VHDL
中，只能在
VHDL
程序的并行部分进行信号说明，但是可以在
VHDL
的并行语句和顺序语句中同时使用信号的赋值语句。
非洲蜗牛
·
2023-11-07 23:35
FPGA
VHDL
fpga开发
VHDL
基础知识笔记(1)
1.实体：其电路意义相当于器件，它相当于电路原理图上的元器件符号。它给出了器件的输入输出引脚。实体又被称为模块。2.结构体：这个部分会给出实体（或者说模块）的具体实现，指定输入和输出的行为。结构体的begin后面是一组并行语句，它的执行是不以书写顺序为准的。3.数据对象：（1）常量一旦赋值就不会发生变化，格式为：constant常数名:数据类型:=表达式;（2）变量声明的示例：（3）对信号赋值使用
非洲蜗牛
·
2023-11-07 10:58
FPGA
fpga开发
ModelSim 仿真流程 实践总结
1建立库并映射在modelsim中，任何使用
VHDL
、Verilog
msgoc
·
2023-11-05 03:45
FPGA/CPLD
Zynq UltraScale+ XCZU7EV 纯
VHDL
解码 IMX214 MIPI 视频，2路视频拼接输出，提供vivado工程源码和技术支持
目录1、前言免责声明2、我这里已有的MIPI编解码方案3、本MIPICSI2模块性能及其优越性4、详细设计方案设计原理框图IMX214摄像头及其配置D-PHY模块CSI-2-RX模块Bayer转RGB模块伽马矫正模块VDMA图像缓存VideoScaler图像缓存DP输出5、vivado工程详解PL端FPGA硬件设计PS端VitisSDK软件设计6、工程移植说明vivado版本不一致处理FPGA型号
9527华安
·
2023-11-04 06:02
FPGA解码MIPI视频专题
菜鸟FPGA图像处理专题
fpga
Zynq
UltraScale+
XCZU7EV
VHDL
IMX214
MIPI
初步了解FPGA中的HLS
与
VHDL
/Verilog有什么关系?HLS是什么？
饿丸
·
2023-11-03 05:49
嵌入式
FPGA
hls
FPGA基础之HLS
FPGA基础之HLS目录一、HLS基本知识简述1、HLS简介2、IntelHLS的编译器3、HLS相关知识概念4、HLS属于研究重点原因二、HLS技术认识1、与
VHDL
/Verilog关系2、关键技术问题
兄弟抱一下~
·
2023-11-03 05:17
FPGA
HLS
Zynq UltraScale+ XCZU5EV 纯
VHDL
解码 IMX214 MIPI 视频，2路视频拼接输出，提供vivado工程源码和技术支持
目录1、前言免责声明2、我这里已有的MIPI编解码方案3、本MIPICSI2模块性能及其优越性4、详细设计方案设计原理框图IMX214摄像头及其配置D-PHY模块CSI-2-RX模块Bayer转RGB模块伽马矫正模块VDMA图像缓存VideoScaler图像缓存DP输出5、vivado工程详解PL端FPGA硬件设计PS端VitisSDK软件设计6、工程移植说明vivado版本不一致处理FPGA型号
9527华安
·
2023-10-31 13:21
FPGA解码MIPI视频专题
菜鸟FPGA图像处理专题
fpga开发
Zynq
UltraScale+
XCZU5EV
VHDL
IMX214
MIPI
EDA硬件描述语言
VHDL
（二）
文章目录1、设计实体2、
VHDL
程序结构3、程序4、生成的模块5、仿真时序波形6、实体和端口模式7、结构体的一般语言格式8、功能描述语句结构9、
VHDL
语言所使用的库可分为两类：10、库和包11、库和程序包的调用方法
北巷番茄鱼
·
2023-10-31 12:20
EDA硬件描述语言VHDL
vhdl
VHDL
硬件描述语言（一）基本概念
一、EDA技术概述电子设计自动化(EDA)技术是新一代电子设计工程师及从事电子技术开发和研究人员的必备技能,也是电子技术类专业学生学习的重要内容。EDA以功能强大的计算机为工具，在EDA工具软件平台上，根据设计文件（硬件描述语言HardwareDescriptionLanguage为系统的主要逻辑描述手段），自动完成编译、仿真、综合、优化、适配（或布局布线）以及下载，实现既定的电子线路系统功能。典
dtge
·
2023-10-31 12:19
FPGA
java
前端
servlet
学习日记之
VHDL
(1)
context:anewdesignmethodandlogicofFSM(finitestatemachine)twodifferentkindsofresetsafeFSMsometrifles1.thestructureofFSMcanbedividedinto2parts:combinationallogicandregisterlogiccombinationallogicdescrib
Akimoto Akira
·
2023-10-30 15:57
vhdl
基于
VHDL
的全自动洗衣机控制器设计
全自动洗衣机控制器设计《数字电子技术》课程设计报告《数字电子技术》课程设计任务书设计内容与要求1.概述1.1EDA简介1.2开发软件quartus简介2.基本原理2.1洗衣机原理2.2定时器原理2.3状态转换原理3.设计方案4.设计验证与测试4.1设计软件环境搭建4.2定时模块实现（DSMK.vhd和DSMK.vwf）4.3状态机实现（ZTJ.vhd和ZTJ.vwf）4.4顶层设计实现（DCSJ.
Sheep懒
·
2023-10-30 15:53
quartus-VHDL
vhdl
fpga
VHDL
入门基础——语法规则（2）
VHDL
基础语法（2）——数据类型篇数据类型1.Boolean：truefasle，用于逻辑运算2.bit：0或1，用于逻辑运算3.bit_vector：基于bit类型的数组，用于逻辑运算4.整数integer
是vin没错
·
2023-10-30 15:20
vhdl
vhdl
VHDL
语法小结
参考：http://blog.sina.com.cn/s/blog_72cd3a5c01014wl1.html一个
VHDL
程序代码包含实体（entity）、结构体（architecture）、配置（configuration
shanekong
·
2023-10-30 15:49
FPGA
VHDL
的语法
1、数据类型和对象对象：信号（Signal）、变量（Variable）、常量（Constant）和文件（File）。SIGNALsignal_name:signal_type[:=initial_value];类型：自定义类型：--自定义数组TYPE数据类型名ISARRAY范围OF原数据类型名；2、std_logic是长度为1的逻辑与bit相似，只是bit只能是'0’和'1‘而std_logic有
大西纸
·
2023-10-30 15:46
学习下FPGA
vhdl
VHDL
硬件描述语言学习笔记（二）
本文主要参考b站视频：【考研】EDA技术(
vhdl
技术)，建议有时间的跟着听一下，从第8节开始，一直到31节都是讲
VHDL
，讲的很全面，赶时间的可以直接看我这个笔记。
凳子花❀
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2023-10-30 15:46
数字IC设计
VHDL
vhdl
EDA硬件描述语言
VHDL
（四）--
VHDL
并行语句
目录1.并行语句的特点：2.结构体2.1并行信号赋值语句2.2条件信号赋值语句2.3选择信号赋值语句3.元件例化语句4.生成语句5.参数传递映射语句及其使用方法参数传递说明的一般书写格式如下：6.参数传递映射语句及其使用方法参数传递映射语句的格式是：7.其他数据类型7.1.限定性数组型数据类型定义7.2非限定性数组型数据类型定义7.3.枚举型数据类型定义7.4.枚举型子类型数据类型定义8.信号属性
北巷番茄鱼
·
2023-10-30 15:45
EDA硬件描述语言VHDL
vhdl
1.
VHDL
的基础知识
目录1.
VHDL
语言基础1.1.标识符（Identifiers）关键字（保留字）：1.2.数据对象（DateObjects）常量Constant变量Variable信号Signal1.3.数据类型
VHDL
冷暖自知_源
·
2023-10-30 15:15
VHDL学习笔记
VHDL
读写txt文件
直接上代码模板：libraryieee;useieee.std_logic_1164.all;useieee.std_logic_arith.all;useieee.std_logic_unsigned.all;--//TXT相关的Library库usestd.textio.all;useieee.std_logic_textio.all;--//实体entitywr_txt_tbis--gene
花猫小屋
·
2023-10-30 15:15
编程语言语法
vhdl
fpga开发
仿真器
VHDL
语法简单总结
VHDL
语法简单总结(2012-04-0111:23:32)转载▼标签：it分类：Quartus/
VHDL
/verilog一个
VHDL
程序代码包含实体（entity）、结构体（architecture）
qijitao
·
2023-10-30 15:44
VHDL
vhdl
具有闹钟功能的电子时钟设计
--数字时钟libraryieee;useieee.std_logic_1164.all;useieee.std_logic_unsigned.all;entityclockisport(clk:instd_logic;--输入1mhz时钟reset:instd_logic;--时钟复位mod_set:instd_logic_vector(1downto0);--模式调节选择00：显示时间01：调
渐入式痴迷
·
2023-10-30 15:44
vhdl
vhdl
fpga
电子时钟
闹钟
设计
一周掌握 FPGA
VHDL
Day 3
三、
VHDL
语句3.1并行语句在结构体中的执行是同时进行，执行顺序与书写顺序无关。
ONEFPGA
·
2023-10-30 15:08
fpga开发
出租车计价器设计
VHDL
出租车计价器设计题目总体结构分析与设计实现与仿真设计结论与分析小结与心得体会题目题目九：出租车计价器设计（平台实现）★★完成简易出租车计价器设计，选做停车等待计价功能。基本功能：（1）起步8元/3公里，此后２元/公里；（2）里程指示信号为每前进50米一个高电平脉冲，上升沿有效；显示行公里数，精确到0.1公里。（模拟时速40KM/h）（3）前进里程开始之前显示价钱，精确到0.1元；（4）用两个按键分
C-learning
·
2023-10-30 15:38
vhdl
程序人生
VHDL
语法入门 （三） 运算操作符与属性
1.运算操作符
VHDL
提供了6种预定义的运算操作符：赋值运算符逻辑运算符算术运算符关系运算符移位运算符并置运算符1.1赋值运算符赋值运算符用于给信号，变量，常数赋值，有以下三种：：给矢量中某些位赋值，或对于某些位之外的其他位
EfunStudy
·
2023-10-30 15:07
VHDL语法入门
fpga开发
嵌入式硬件
单片机
VHDL
语法入门 （二） 数据类型
预定的数据类型位（BIT）和位矢量（BIT_VECTOR）;值为“0”或“1”例--信号的声明signalx:bit;--x为一位的BIT信号signaly:bit_vector(3downto0);--y为4位的位矢量信号，最左侧是最高位（MSB）signalw:bit_vector(0downto7);--w为8位的位矢量信号，最右侧是最高位（MSB）--信号的赋值x)ofbit;--用户定义
EfunStudy
·
2023-10-30 15:37
VHDL语法入门
fpga开发
嵌入式硬件
单片机
开发语言
[FPGA]
VHDL
语言初学笔记和小Tips
前言：本人使用Xilinx的FPGA，使用的语言是
VHDL
。在这将自己学习查的，自己遇到的关于
VHDL
问题都总结在这，都是很基础的东西，会不时的更新。
GG_band
·
2023-10-30 15:37
FPGA
fpga
VHDL
if ( x =(x‘range =＞ ‘0‘))
VHDL
if(x=(x’range=>‘0’))
VHDL
中遇到
VHDL
if(x=(x’range=>‘0’))这种语法，之前也遇到过，当时弄明白了，现在过了一段时间又忘记了，好记性不如烂笔头
薛定谔的bug~
·
2023-10-30 15:33
fpga开发
Quartus与modelsim联合仿真报错--Fatal error in Process MEMORY
#**Error:(vsim-7)Failedtoopen
VHDL
file"./
VHDL
/ROM_WAVE/hann_sin60k.mif"inrbmode.
V&C小白
·
2023-10-29 21:40
fpga开发
好的FPGA编码风格（2）--多参考设计软件的语言模板（Language Templates）
不论是Xilinx的Vivado，还是Altera的QuartusII，都为开发者提供了一系列Verilog、SystemVerilog、
VHDL
、TCL、原语、XDC约束等相关的语言模板（LanguageTemplates
孤独的单刀
·
2023-10-29 10:12
FPGA设计与调试
fpga开发
Verilog
xilinx
altera
IC
Templates
语言模板
线性反馈移位寄存器（LFSR）
VHDL
代码及视频
名称：线性反馈移位寄存器（LFSR）
VHDL
代码软件：ISE语言：
VHDL
代码功能：线性反馈移位寄存器（LFSR）
VHDL
代码演示视频：线性反馈移位寄存器（LFSR）Verilog代码_Verilog/
蟹代码丫
·
2023-10-29 01:25
fpga开发
LFSR
VHDL
伪随机数
温湿度计传感器DHT11控制数码管显示verilog代码及视频
采集环境的温度和湿度，并在数码管显示本代码已在开发板验证开发板资料：大西瓜第一代FPGA升级板原理图.pdfDHT11传感器电路图:演示视频：温湿度计传感器DHT11控制数码管显示verilog_Verilog/
VHDL
蟹代码丫
·
2023-10-29 01:55
fpga开发
DHT11
温湿度计
verilog
数码管
8通道模数转换AD7091驱动代码SPI接口ADC，verilog
FPGA代码Verilog/
VHDL
代码资源下载网：www.hdlcode.com代码下载：8通道模数转换AD7091驱动代码（代码在文末付费下载）软件：QuartusII语言：Verilog
蟹代码丫
·
2023-10-29 01:25
fpga开发
AD7091
模数转换
verilog
AD7321代码SPI接口模数转换连接DAC0832输出verilog
名称：AD7321代码12位ADC，SPI接口模数转换连接DAC0832输出软件：QuartusII语言：
VHDL
代码功能：使用
VHDL
语言编写代码，实现AD7321的控制，将模拟信号转换为数字信号，再经过处理后
蟹代码丫
·
2023-10-29 01:24
fpga开发
AD7321
VHDL
模数转换
数字电路与逻辑设计实验一 译码器的实现
数字电路与逻辑设计实验一译码器的实现一、实验目的二、实验内容三、实验方法1、实验方法2、实验步骤A.异或门的
VHDL
语言与原理图设计B.3-8译码器的
VHDL
语言与原理图实现C.模拟机指令集译码器的
VHDL
Flechazo_z
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2023-10-28 19:08
数字电路与逻辑设计实验
嵌入式
vhdl
Riviera-PRO 2022.04 最新完美
AldecRiviera-PRO2022.04还包括SystemVerilog和
VHDL
-2019仿真增强功能。
技术服务173
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2023-10-27 12:01
算法
简单电子琴设计verilog蜂鸣器8音阶,视频/代码
简易电子琴电路1、输入为8个按键，每个按键对应一个音阶2、输出为speaker蜂鸣器，当其中一直按键按下时，输出特定频率的音阶方波信号演示视频：简单电子琴设计verilog蜂鸣器8音阶_Verilog/
VHDL
蟹代码丫
·
2023-10-27 01:07
fpga开发
电子琴
verilog
蜂鸣器
Zynq UltraScale+ XCZU15EG 纯
VHDL
解码 IMX214 MIPI 视频，2路视频拼接输出，提供vivado工程源码和技术支持
目录1、前言免责声明2、我这里已有的MIPI编解码方案3、本MIPICSI2模块性能及其优越性4、详细设计方案设计原理框图IMX214摄像头及其配置D-PHY模块CSI-2-RX模块Bayer转RGB模块伽马矫正模块VDMA图像缓存VideoScaler图像缓存DP输出5、vivado工程详解PL端FPGA硬件设计PS端VitisSDK软件设计6、工程移植说明vivado版本不一致处理FPGA型号
9527华安
·
2023-10-26 14:10
FPGA解码MIPI视频专题
菜鸟FPGA图像处理专题
fpga开发
Zynq
UltraScale+
XCZU15EG
VHDL
IMX214
MIPI
Zynq UltraScale+ XCZU9EG 纯
VHDL
解码 IMX214 MIPI 视频，2路视频拼接输出，提供vivado工程源码和技术支持
目录1、前言免责声明2、我这里已有的MIPI编解码方案3、本MIPICSI2模块性能及其优越性4、详细设计方案设计原理框图IMX214摄像头及其配置D-PHY模块CSI-2-RX模块Bayer转RGB模块伽马矫正模块VDMA图像缓存VideoScaler图像缓存DP输出5、vivado工程详解PL端FPGA硬件设计PS端VitisSDK软件设计6、工程移植说明vivado版本不一致处理FPGA型号
9527华安
·
2023-10-25 10:17
FPGA解码MIPI视频专题
菜鸟FPGA图像处理专题
fpga开发
Zynq
UltraScale+
XCZU9EG
VHDL
IMX214
MIPI
FPGA设计FIR滤波器低通滤波器，代码及视频
名称：FIR滤波器低通滤波器软件：Quartus语言：Verilog/
VHDL
本资源含有verilog及
VHDL
两种语言设计的工程，每个工程均可实现以下FIR滤波器的功能。
蟹代码丫
·
2023-10-23 01:21
fpga开发
FIR
低通滤波器
verilog
VHDL
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